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  • cache line

    2019-07-31 18:39:20
    1.回顾 我们计算机相关的人士,CPU从内存上取某个...2.cache line:缓存行 好了,这个基本过程了解了,再来说一下cache line这个概念: cache line:是CPU进行缓存时的最小单位,大小一般为32B~256B之间 3.实例: 对于我...

    1.回顾
    我们计算机相关的人士,CPU从内存上取某个变量的值后一定是要存放在当前CPU的寄存器中,

    于此同时,还会发生另外一件事,当前的CPU还会将这个变量所处的缓存行复制到当前
    CPU的高速缓存上来.(实际上就是该数据所在的一块内存)

    2.cache line:缓存行
    好了,这个基本过程了解了,再来说一下cache line这个概念:

    cache line:是CPU进行缓存时的最小单位,大小一般为32B~256B之间
    

    3.实例:

    对于我们的一个数组,他是线性的,假如这个数组中存储的是int型的数据
    
    我们取一个值到CPU得到寄存器上,于此同时还会发生一件事就是CPU还会将这个变量的缓存行范围内的数据
    缓存到当前CPU的告诉缓存上,这个缓存范围指的是上面说的32~256B,会缓存这么多的数据.
    

    4.<<深入理解计算机系统>>

    遍历数组的实现方法1:

    //按行访问
    for(int i = 0; i < n; i++) {
        for(int j = 0; j < n; j++) {
            int num;   
            arr[i][j] = num;
        }
    }
    

    遍历数组的实现方法2:

    //按列访问
    for(int i = 0; i < n; i++) {
        for(int j = 0; j < n; j++) {
            int   num;       
            arr[j][i] = num;
        }
    }
    

    分析:

    按行读:毋庸置疑,CPU会把数据的缓存行进行缓存,这样没什么问题,以后CPU读取时直接去缓存中读取即可,
    就不用去内存中取值了;
    
    按列读:按列读,同样的,读取也会进行缓存,遗憾的是,他是按列进行读取的,缓存是按行缓存的,那么严重的问题
    就出现了,缓存的数据是没什么卵用的,其实这就是"缓存失效"或者"缓存未命中"
    

    5.多CPU的缓存过程:
    在这里插入图片描述
    在这里插入图片描述
    在这里插入图片描述
    在这里插入图片描述

    如果说不刷新CPU7的缓存会发生什么:

    同时对该数据进行修改,造成回写不一致,这无疑会大大增加软件开发的难度.
    

    实际上,真是的过程可能远比上述过程复杂的多.

    未完待续…

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  • Cache line

    千次阅读 2013-05-23 21:35:44
    一个L1 DATA CACHE相当于一块小的内存,我们假设它为16K大,它会与一般物理内存交互。  它和内存交互一般一次传输16个字节(32个字节),...这些一次被传输的字节被称为cache line。  ------------------------------
    一个L1 DATA CACHE相当于一块小的内存,我们假设它为16K大,它会与一般物理内存交互。 
    它和内存交互一般一次传输16个字节(32个字节),也就是: 
    CACHE 字节0-15一次写到/读取物理内存 ,字节16-31一次写到/读取物理内存.32-47 ... ... 
    这些一次被传输的字节被称为cache line。 
    -------------------------------------------------------------- 
    另外,cache写到物理内存的位置不是任意的, 
    我们假定内存为64K,那么cache地址0的数值只能和物理内存的地址0, 16K, 32K交互;cache地址1的数值只能和物理内存的地址1, 16K+1, 32K+1交互 
    。。。 。。。cache地址16K-1的数值只能和物理内存的地址6K-1, 16K+16K-1, 32K+16K -1交互 
    这说明了两点: 
    (1)假设对象A的一个字段长为16个字节,如果它放在物理地址 0-15,那么它将和cache的第一个cache line 交互,如果放在物理地址 8-23,那么 
    如果CPU要访问这个字段,必须将第一个和第二个cache line 都读入,才能获得这个字段的信息,显然这样速度慢,所以一般字段需要cache line对齐, 
    在这里就是16个字节对齐。 
    (2)关于colour 
    一般一个对象某些字段访问频繁些。 
    假定一个cache(这个cache指slab的cache,不是上面提到CPU的L1 DATA CACHE)占用5个页面也就是20K. 
    假定其中对象大小为32个字节,前16个字节访问频繁许多。 
    假定对象A起始于物理地址0,对象C起始于31,对象B起始于物理地址16K,那么对象A,对象B的前16个字节都和第一个cache line 交互,后16个字节都和第二个cache line 交互 
    对象C前16个字节与第3个cache交互。 
    我们假定内核访问A后就访问B,再访问A,交错进行,并且前16个字节次数都是50次,后16个为10次。C也是。 
    这样第一个cache line 要交互100次,第二个20次,一共120次。 
    如果让对象B向后移动16个字节,也就是对象B的前16个字节与第二个cache line 交互,后16个与第3个交互。 
    那么第一个为2次,因为只有开头结尾2次要与内存交互,其它每次都在L1 DATACACHE 中写就可以了。第2个cache line为20次左右(后面的只须在CACHE中读写),第3个cache line为20次, 
    3个line一共才41次,你不妨仔细模拟一下。 
    所以进行错位能降低CACHE的交互次数,从而提高CPU处理速度能力。 
    这个错位(也就是上面的16个字节)就是colour.
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  • Cache Line

    2018-11-22 16:52:00
    转载: https://yq.aliyun.com/articles/46550 转载于:https://www.cnblogs.com/Jason2zhang/p/10002130.html

    转载:

    https://yq.aliyun.com/articles/46550

    转载于:https://www.cnblogs.com/Jason2zhang/p/10002130.html

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  • cacheline

    2016-03-16 10:32:52
    近期的工作中需要对cpu的结构做更多的了解,项目中见到比较多cpu cache的信息,想对其做一个基本的了解。 第一步肯定是希望知道哪里能看到cpu cache的信息呢? 有多种办法,lscpu, cat /proc/...

    近期的工作中需要对cpu的结构做更多的了解,项目中见到比较多cpu cache的信息,想对其做一个基本的了解。


    第一步肯定是希望知道哪里能看到cpu cache的信息呢?


    有多种办法,lscpu, cat /proc/cpuinfo等。


    这里发现通过查看系统的/sys/目录能看到一些更详细的信息。


    tree /sys/devices/system/cpu/cpu0/cache/
    /sys/devices/system/cpu/cpu0/cache/
    ├── index0 //L1 data cache
    │   ├── coherency_line_size //记录cache line大小
    │   ├── level
    │   ├── number_of_sets
    │   ├── physical_line_partition
    │   ├── shared_cpu_list
    │   ├── shared_cpu_map
    │   ├── size //cache 大小
    │   ├── type  //cache类型
    │   └── ways_of_associativity
    ├── index1 //L1 instruction cache
    │   ├── coherency_line_size
    │   ├── level
    │   ├── number_of_sets
    │   ├── physical_line_partition
    │   ├── shared_cpu_list
    │   ├── shared_cpu_map
    │   ├── size
    │   ├── type
    │   └── ways_of_associativity
    ├── index2 //L2 cache
    │   ├── coherency_line_size
    │   ├── level
    │   ├── number_of_sets
    │   ├── physical_line_partition
    │   ├── shared_cpu_list
    │   ├── shared_cpu_map
    │   ├── size
    │   ├── type
    │   └── ways_of_associativity
    └── index3 //L3 cache
        ├── coherency_line_size
        ├── level
        ├── number_of_sets
        ├── physical_line_partition
        ├── shared_cpu_list
        ├── shared_cpu_map
        ├── size
        ├── type
        └── ways_of_associativity


    举例:

    cat /sys/devices/system/cpu/cpu0/cache/index0/coherency_line_size 
    64  //cache line 大小为64字节


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  • cache line大小

    千次阅读 2019-07-12 16:53:43
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  • CacheLine对齐

    千次阅读 2020-02-27 13:38:00
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  • cacheline 优化

    2019-12-20 10:30:28
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  • CPU cache line

    2019-02-09 18:07:17
    在读github.... minBitSize = 6 // 2**6=64 is a CPU cache line size CPU cache line是什么东西?Wikipedia给出下面的解释: Data is transferred between memory and cache in blocks of ...
  • cacheline基本理论

    2019-04-18 20:56:00
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  • 计算机缓存Cache以及Cache Line详解

    万次阅读 多人点赞 2018-06-06 10:56:36
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    2019-08-18 14:03:23
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  • cache line技术浅析

    千次阅读 2017-08-24 17:20:11
    最近组内有个同事在做cacheline相关的特性,向其学习了一下,对原来的cacheline的理解更近了一步。这里总结一下。请彭超大侠有空的话帮忙在斧正一下 Cache就是对内存的内容进行缓存的一个硬件。cache和内存的...
  • 伪共享与CPU cache line

    2020-05-21 21:30:46
    伪共享与CPU cache line
  • Cacheline技术浅析

    2017-05-17 16:23:15
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  • 2016/07/11 21:34:32 [ERROR][qshell] qupload.go:340: Invalid cache line <code>14 14412684965838689</code></p> <p>----------Upload Result---------- Total: 0 Success: 0 Failure: 0 Skipped: 0 <h2>Duration...
  • CPU的cache line原理

    2017-08-24 17:18:32
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  • cache line 优化

    2013-08-27 13:33:05
    多线程编程时,为了避免锁,有时会采用数据多份copy的方式,但是如果把这些数据放在了同一个cache line里面,性能得不到提高,是因为cache line的false sharing问题,可以看下这篇文章...
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空空如也

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