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葡萄属种质资源极为丰富,包括亚属、种、亚种、变种,可以鲜食、酿酒、制汁、制干、制罐,还可以作抗性砧木及杂交育种的重要材料等。葡萄属已确定的种有70多个,已登记的品种有16000个。 展开全文
葡萄属种质资源极为丰富,包括亚属、种、亚种、变种,可以鲜食、酿酒、制汁、制干、制罐,还可以作抗性砧木及杂交育种的重要材料等。葡萄属已确定的种有70多个,已登记的品种有16000个。
信息
拉丁学名
Vitis L.
被子植物门 Angiospermae
植物界
亚    纲
原始花被亚纲 Archichlamydeae
鼠李目 Rhamnales
葡萄属
中文学名
葡萄属
葡萄科 Vitaceae
双子叶植物纲 Dicotyledoneae
模式种
葡萄Vitis vinifera L.
分布区域
分布于世界温带或亚热带
葡萄属形态特征
木质藤本,有卷须。叶为单叶、掌状或羽状复叶;有托叶,通常早落。花5数,通常杂性异株,稀两性,排成聚伞圆锥花序;萼呈碟状,萼片细小;花瓣凋谢时呈帽状粘合脱落;花盘明显,5裂;雄蕊与花瓣对生,在雌花中不发达,败育;子房2室,每室有2颗胚珠;花柱纤细,柱头微扩大。果实为一肉质浆果,有种子2-4颗。种子倒卵圆形或倒卵椭圆形,基部有短喙,种脐在种子背部呈圆形或近圆形,腹面两侧洼穴狭窄呈沟状或较阔呈倒卵长圆形,从种子基部向上通常达种子1/3处;胚乳呈M形。x=19。 [1] 
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  • vitisvitis ai

    2021-05-16 13:29:28
    vitis vitis是赛灵思统一软件开发平台,边云设备都可在上面开发。其有4个组成部分(从下到上): 1、目标平台(target platform):基本软件和基本硬件(zynq-7000, zynqUltarScale + MPsoc, Alveo, Versal ACAPs...

    资料

    vitis

    • vitis是赛灵思统一软件开发平台,边云设备都可在上面开发。其有4个组成部分(从下到上):
      • 1、目标平台(target platform):基本软件和基本硬件(zynq-7000, zynqUltarScale + MPsoc, Alveo, Versal ACAPs)
      • 2、核心开发包(core development kit):
        • 图像和命令行开发工具(vitis 编译器,vitis 分析器和vitis 调试器):构建加速算法+分析性能瓶颈+进一步调试(C/C++/open GL)
        • xilinx runtime library(xrt):提供api,便于应用代码和硬件中部署的加速器进行通信
      • 3、vitis 加速库:开源的性能优化的软件库,包括视频图像处理库、数学和线性代数库以及其他三方库
      • 4、特定领域开发环境:caffe、tensorflow
    • 如下图:
      在这里插入图片描述

    vitis_ai

    • vitis_ai 是基于fpga中的dpu(深度学习处理单元)的全栈式ai推断解决方案,其主要包含3个主要部分:
      • 1、vitis_ai model zoo,支持tf、caffe和pytorch,包括自动驾驶、监控和金融等领域的已训练好的模型,可用于快速概念验证和生产。
      • 2、vitis_ai development kit,提供了5种工具用于部署网络。 5种工具如下:
        • ai 优化器:通过fine_turn的方法减少模型计算量,可以提高5-20倍计算速度。
        • ai 量化器:
          • 将float32的模型转化为int8模型,甚至更低精度。
          • 执行层融合和其他硬件友好型策略,加速网络推断效率。
        • ai 编译器(可支持model zoo和自定义模型):
          • 生成在dpu ip上运行的高效代码
          • 提供api,实现机器学习预处理和调用dpu进行网络前向推断。
        • ai 检测器:用于分析ai性能,集成到vitis analyzer种
        • ai library:
      • 3、deeplearning proccessing unit(dpu):高效执行前向计算。不同类型的dpu处理不同网络,如cnn/lstm/bert/mlp等。
      • 在这里插入图片描述
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  • vitis opencl

    2021-04-25 10:39:22
    Vitis_Libraries Vitis_Libraries/tree/master/vision Vitis-Tutorials ug1354

    DPU(Deep learning process unit) 是有AIE组成;
    在这里插入图片描述
    在这里插入图片描述

    Vitis_Libraries
    Vitis_Libraries/tree/master/vision
    Vitis-Tutorials
    opencl.org/hardware/xilinx

    ug1354

    异构计算
    emulation-sw 把cpu+fpga运行的代码都编译到cpu运行

    Vitis编译器提供了三种不同的构建目标,用于调试和验证目的的两个仿真目标,用来产生实际的FPGA二进制文件的默认硬件目标:

    • 软件仿真(sw_emu)
      主机应用程序代码和内核代码都被编译为在主机处理器上运行。这样可以通过快速的构建和运行循环来优化迭代算法。该目标对于识别语法错误,对与应用程序一起运行的内核代码执行源代码级调试以及验证系统的行为很有用。

    • 硬件仿真(hw_emu)
      内核代码被编译成硬件模型(RTL),该模型在专用模拟器中运行。这种构建和运行循环需要更长的时间,但可以提供详细的,周期精确的内核活动视图。该目标对于测试将在FPGA中使用的逻辑功能以及获得初始性能估计非常有用。

    • 系统(hw)
      内核代码被编译成硬件模型(RTL),然后在FPGA上实现,从而产生可以在实际FPGA上运行的二进制文件。
      在这里插入图片描述
      vector_addition.cl 运行在fpga
      在这里插入图片描述sdaccel 已经升级到vitis
      在这里插入图片描述
      OpenCL编程基本流程及完整示例-----opencl介绍

    b站demo

    opencl API

    github.com/Xilinx/SDAccel_Examples/tree/master/getting_started/hello_world
    Vitis指南 | Xilinx Vitis 系列

    xilinx2020_2/vitis_doc/index

    可以从Vitis IDE或Vivado IP目录访问RTL内核向导。无论哪种情况,它都会创建一个包含示例设计的Vivado项目,以用作定义自己的RTL内核的模板。

    具体示例见《ug1393》117页。
    基于OpenCL开发的深交所Binary协议行情解码

    吃猫粮的耗子 b站id

    需要设置

    在这里插入图片描述

    三个路径来源 安装 common images
    在这里插入图片描述

    能识别+跟踪
    在这里插入图片描述

    YOLO算法的ZYNQ移植尝试(SDx方法、ARM部分)

    SSD and YOLOv3 Customization Deployment Using Vitis AI Library

    Quantization–vitis py

    在这里插入图片描述

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  • vitis workflow

    2021-04-27 12:29:50
    Vitis Introduction for Embedded Software Development–youtube
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  • vitis 2019.2 链接:https://pan.baidu.com/s/17pk0PLyFy4V67CW-CTIqDQ 提取码:ryf1 复制这段内容后打开百度网盘手机App,操作更方便哦 vivado2019.1 sdx套件 链接:...

    说明一下:

     1)有些安装包有很多压缩包,这些压缩包是一个压缩文件,因为太大所以分卷压缩才能上传网盘,下载所有的压缩包后解压   “.part1.rar”  结尾的压缩包,自动解压所有文件。

    2).rar  的压缩包用WinRAR软件解压,其他解压软件容易出错。

    • vitis 2020.1

    链接:https://pan.baidu.com/s/1gsp-IruuqsothElEx_KnFw 
    提取码:sere

    下载所有的包,只解压红框中的压缩包

    • vitis 2019.2 

    链接:https://pan.baidu.com/s/1Nxm7sJDnWg-w6DtFFqjauQ 
    提取码:l9pt

    • vivado hls 2019.1 

    链接:https://pan.baidu.com/s/1ZpTm84zxgAWbPSALE6t3HQ 
    提取码:ny3p

    • vivado2018.3 sdx套件

    链接:https://pan.baidu.com/s/1DLbyyFdxKgUzdNkP8KpWCQ 
    提取码:sw5a

    • vivado2018.2 sdk套件

    链接:https://pan.baidu.com/s/1uxn4yfDd-sjlbsHlg1R_2g 
    提取码:shvw 
    复制这段内容后打开百度网盘手机App,操作更方便哦

    • vivado2017.4 sdx套件

    链接:https://pan.baidu.com/s/1Jh7j5wrfEo-2GNJvJAcFfg 
    提取码:uj1e 
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    • vivado license

    适用版本:适用于Vivado 2037年版 之前的任何版本

    链接:https://pan.baidu.com/s/1WbIsnTZ0lNwK46km_U4Wfg 
    提取码:w53y 
    复制这段内容后打开百度网盘手机App,操作更方便哦

     

    有些没有及时更新,需要其他的版本的可以留言;

    如有连接失效,需要到公众号里面获取!!

     

    欢迎关注我的公众号:芯王国,有更多的FPGA&数字IC的技术分享,还可以获取开源FPGA项目!

    在这里插入图片描述

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