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  • 青岛科技大学数电11第1节 SR锁存器第一节 SR锁存器 * 11.2 基本RS触发器 11.3 同步RS触发器 11.1 概述 下页 总目录 第十章 触发器 11.6 边沿触发器 11.5 主从触发器 11.4 触发器的逻辑功能描述 * 下页 返回 触发器...

    青岛科技大学数电11第1节 SR锁存器

    第一节 SR锁存器 * 11.2 基本RS触发器 11.3 同步RS触发器 11.1 概述 下页 总目录 第十章 触发器 11.6 边沿触发器 11.5 主从触发器 11.4 触发器的逻辑功能描述 * 下页 返回 触发器(Flip-Flop): 能够存储1位二值信号的基本单元电路。 一、触发器必须具备的两个基本特点: 具有两个能自行保持的稳定状态, 用来表示逻辑状态的 0 和 1 , 或二进制数的 0 和 1 。 在触发信号的操作下,根据不同的输入信号可以置成 1 或 0 状态。 11.1 概述 上页 * 触发器分类: 本章重点掌握: 触发器的外部逻辑功能和触发方式。 触发方式分类 逻辑功能分类 脉冲触发 电平触发 边沿触发。 RS触发器 JK触发器 T触发器 D触发器 动态触发器 存储数据原理分类 静态触发器 * 3. 逻辑功能的特性表描述 次态 原态 指触发器在输入信号变化前的原状态,用 Q 表示。 指触发器在输入信号变化后的新状态,用 Q* 表示。   触发器次态与输入信号和电路原有状态之间关系的真值表。 * 下页 返回 上页 归纳:用或非门组成SR锁存器的特性表 RD SD R S Q Q’ 图形符号 用或非门组成的SR锁存器的特性表 SD RD Q Q * 0 0 1 1 0 0 1 1 0 0 0 0 1 1 1 1 0 1 0 1 0 1 0 1 0 1 1 1 0 0 0* 0* 因为锁存器的新状态Q*(也叫做次态)不仅与输入状态有关, 而且与锁存器原来的状态Q(也叫做初态)有关, 所以把Q也作为一个变量列入了真值表,并将Q称做状态变量, 这种含有状态变量的真值表叫做锁存器的特性表(功能表)。 * S’D G1 G2 R’D Q Q’ 由与非门组成的基本R S触发器 1. 电路结构及逻辑符号 Q Q’ Q S’D R’D S R 置0端,也称复位端。 置1端,也称置位端。 信号输入端 互补输出端,工作时,输出状态相反。 低电平有效 11.2 RS(Reset-Set)触发器 各种触发器的基本构成部分 * S’D G1 G2 R’D Q Q’ 2. 工作原理及逻辑功能 0 1 1 1 1 0 触发器被置 0 触发器置 0 1 0 1 1 0 1 1 0 0 0 S’D R’D 功 能 说 明 输 入 Q’ Q 输 出 * S’D G1 G2 R’D Q Q’ 2. 工作原理及逻辑功能 1 0 0 1 1 1 触发器被置 1 触发器置 0 1 0 触发器置 1 0 1 1 1 0 1 1 0 0 0 S’D R’D 功 能 说 明 输 入 Q’ Q 输 出 * S’D G1 G2 R’D Q Q’ 1 1 0 1 1 0 0 0 S’D R’D 功 能 说 明 输 入 Q’ Q 输 出 2. 工作原理及逻辑功能 1 1 触发器置 0 1 0 触发器置 1 0 1 触发器保持原状态不变 不 变 G1 门输出 G2 门输出 * S’D G1 G2 R’D Q Q’ 1 1 0 1 1 0 0 0 S’D R’D 功 能 说 明 输 入 Q’ Q 输 出 2.基本RS触发器工作原理及逻辑功能 输出状态不定(禁用) 1* 1* 触发器置 0 1 0 触发器置 1 0 1 触发器保持原状态不变 不 变 0 0 1 1 * R’D 和 S’D 同时由 0 变 1 时,输出状态可能为 0,也可能为 1。   输出既非 0 状态,也非 1 状态。即输出状态不定。 * 3. 逻辑功能的特性表描述 次态 原态 指触发器在输入信号变化前的原状态,用 Qn 表示。 指触发器在输入信号变化后的新状态,用 Qn+1 表示。   触发器次态与输入信号和电路原有状态之间关系的真值表。 因为触发器的新状态Qn+1(也叫做次态)不仅与输入状态有关, 而且与锁存器原来的状态Qn(也叫做初态)有关, 所以把Q也作为一个变量列入了真值表,并将Q称做状态变量, 这种含有状态变量的真值表叫做触发器的特性表(功能表)。 * 下页 返回 上页111100000 1 1 1 0 0 1*1* * 的0状态同时消失以后状态不定 用与非门组成的基本RS触发器的特性表 保持 置1 置0 不定 在正常工作时应遵守: SDRD=0的约束条件, 动画 归纳:用与非门组成RS触发器特性表 基本 S R触发器特 性表的简化表示 Q 1 1 1 0 1 0 1 0 不定 0 0 Q

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  • 在认识锁存器之前,先有必要认识一下或门的真值表,但是其输入需要从输出端引出作为或门的一个输入。则它的真值表为当输入引脚为 2 时,假设 input 端口为真值表中的A,B为output的反馈信号,则在初始状态下,整个...

    在认识锁存器之前,先有必要认识一下或门的真值表,但是其输入需要从输出端引出作为或门的一个输入。

    95ad7ac69e1e2c037185864bac9f828c.png

    则它的真值表为

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    当输入引脚为 2 时,假设 input 端口为真值表中的A,B为output的反馈信号,则在初始状态下,整个电路处于状态1,输出为0;

    当input输入一个高电平时,整个电路进入状态2,此时输出为1,高电平;

    这时整个电路会自动进入状态3,此时电路的输出仍然是1、高电平;

    即使此时input=0,(输入一个低电平时),为状态4,也不会改变输出的状态。

    上述的状态变化可以使用74LS32芯片来进行验证状态的变化。


    或非门构建SR锁存器

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    其真值表为

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    假设使用74LS02芯片来搭建上述的电路,则有,在初始上电的情况,如下图所示:

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    初始上电的时候

    初始上电的时候,input1 和input2 都是 0(低电平),输出如上图中所示,并且应当注意的是,此时无论input 2 的状态如何,都不会改变该电路的输出情况。

    尤其应当注意的是,初始上电的时候没有这两个或非门是完全对称的,因此哪一个或非门的输出首先变为1,完全取决于哪一个电路速度更快,这也就是说,哪一个或非门输出为1,哪一个或非门输出为0,完全是随机的

    当input 1输入一个高电平时

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    则会改变output的状态,此时无论input1的变化情况,因为或非门的自有特性,都不会改变该电路的输出情况。

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    这就是一个SR锁存器(SR Latch),它的用途是非常广的。

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    SR锁存器的S、R分别代表的意思是Set和Reset。当使用它时,必须要给一个明确的信号,即要么是 R=1,S=1,一般不会使用两者为1 的情况。

    SR锁存器是计算机内存的重要的一个部件

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  • D锁存器(D Latch)完全是在SR锁存器的基础上发展得来的。既然SR锁存器是可以通过调整输入,来得到两种固定的输出状态。但是它存在的问题是需要有两个输入,那么能不能将SR锁存器的功能使用仅一个输入来进行切换呢?...

    D锁存器(D Latch)完全是在SR锁存器的基础上发展得来的。

    既然SR锁存器是可以通过调整输入,来得到两种固定的输出状态。但是它存在的问题是需要有两个输入,那么能不能将SR锁存器的功能使用仅一个输入来进行切换呢?

    Of course!仅仅只需要加入一个非门,就可以实现了,如下图所示。

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    SR Latch

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    D Latch

    注意如果是使用74LS02(或非门)芯片来实现上述电路时,可以很轻松地将或非门的输入都接入input,就可以得到非门了。

    那现在的问题是,只要有输入S/R的状态(或者是D的状态),就会有输出状态的变化,无法区分到哪一种状态的变化是有用的,因此需要加入使能端,也就是 ENABLE端口


    加入ENABLE的SR锁存器

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    加入ENABLE之后,从电路上可以很容易看出,想达到同之前的SR Latch一样的状态输出,必须要是E=1,那也就是说,可以认为设置ENABLE的状态,来确保该状态是否为有用的信息。

    该电路可以使用74LS08(与门)+74LS02(或非门)来实现

    加入ENABLE的D锁存器

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    这个电路就叫做D Latch,或者是叫做Data锁存器,它在计算机的内存和寄存器中是最基础的存储元件。这一个电路就可以存储1 bit的数据,并且是只有当E=1的情况下,才能够向计算机中写入数据。

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  • 1.环形计数器的有效状态为1000-0100-0010-0001扭环形计数器的有效状态为0000-1000-1100-1110-1111-0111-0011-0001...七段显示译码器4.74160构成十进制计数器5.SR锁存器的真值表6.同或、异或7.状态机流程图8.占空比的...

    1.环形计数器的有效状态

    1000-0100-0010-0001

    扭环形计数器的有效状态为

    0000-1000-1100-1110-1111-0111-0011-0001

    (呈循环状)

    2.负数的补码=反码+1

    反码由原码的符号位不变,其余位按位取反

    (第一位是1,其余位取反)

    正数的原码=反码=补码

    3.七段显示译码器

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    4.74160构成十进制计数器

    5.SR锁存器的真值表

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    5f4070053f6e20506461879f99d55dd1.png

    6.同或、异或

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    7.状态机流程图

    8.占空比的计算

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    9.ROM、RAM的分类

    随机储存器RAM分为静态和动态

    只读储存器ROM

    10.施密特触发器

    VT+ VT- △V

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    11.进制转换

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    12.组合/时序逻辑电路的特点

    组合逻辑电路的特点:任意时刻的输出,仅仅取决于该时刻的输入,与电路原来的状态无关。

    时序逻辑电路的特点:在任意时刻的输出信号不仅取决于当时的输入信号,而且还取决于电路原来的状态。

    13.各个触发器的特性方程

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    14.字扩展、位扩展

    字×位

    位数不够用位扩展

    字数不够用字扩展

    15.矩形脉冲常用概念

    16.555定时器的VT+ VT-

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    17.AD转换器性能优劣的主要标志

    转换精度和转换速度

    18.分析时序逻辑电路的步骤

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    19.各个触发方式的动作特点

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    20.电平、边沿触发的D触发器

    21.用160芯片实现计数器(置数法)

    22.给出逻辑函数,用卡诺图化简

    写时序逻辑电路的三个方程并画出状态转换表、状态转换图。

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  • 文章目录A SR锁存器A.a 触发器概述A.b SR锁存器 A SR锁存器 A.a 触发器概述 A.b SR锁存器
  • 数电SR锁存器与D触发器(转载)

    千次阅读 2019-08-29 14:25:34
    来聊聊锁存器跟触发器吧,下面是这次博文要介绍的主要内容: ·双稳态器件 ·锁存器常见结构 ·锁存器的应用 ·触发器 ·触发器的建立时间和保持时间 1、双稳态器件 双稳态器件是指稳定状态有两种,一种是0,一种是1...
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  • SR锁存器 其中(a)和(b)是等效的。 同步SR触发器,也称电平触发SR触发器: 如果把上述触发器的输入端加上一个反相器改为单端输入则构成了D触发器: D触发器也可以利用CMOS传输门来实现: 这类电平触发器...
  • 数电基础复习(三)

    2020-05-01 12:44:28
    (2)SR锁存器 用或非门 用与非门 利用SR锁存器,构成去抖动电路 门控SR锁存器 D锁存器 逻辑门控D锁存器 传输门控D锁存器 触发器与锁存器的区别: 触发器分类: (1)根据逻辑功能分类 SR触发器...
  • logisim数电期末实验设计.circ, ...实验四:基本SR锁存器功能测试。实验五:设计一个60进制的计数器。5个实验均包含电路图和实验步骤,实验心得等,请用logisim.exe软件打开,此乃原创,期末时得到优秀等级,欢迎下载。
  • 数电5_1——触发器

    2020-05-13 09:58:41
    简单介绍了触发器的概念,以及SR锁存器,同步SR触发器,异步输入SR触发器,D触发器(出入同),电平触发器的特点,以及容易出现空翻现象。 下一节将针对空翻现象,提出用脉冲触发解决的方法。
  • fpga数电基础之--------触发器

    千次阅读 2019-01-24 11:12:52
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