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  • 列出逻辑状态表
    千次阅读
    2020-12-21 14:28:34

    同或门符号,同或门逻辑符号

    异或与同或是一对互补的逻辑运算,因为它有直观的逻辑意义,具有某些特殊功能,所以用专门的逻辑符号表示这种逻辑关系,称作特殊门,在数字系统中得到了广泛的应用。

    ⑴ 2输入(偶数输入)变量异或与同或之间具有互补关系

    逻辑表达式如下:

    真值表:

    由动态模拟可以看出,2输入(也适用于偶数输入)变量异或与同或之间互为反码,称为具有互补关系。但是,3输入(或奇数输入)变量异或与同或之间具有什么关系呢?

    ⑵ 3 输入(奇数输入)变量异或与同或之间具有相等关系

    由动态模拟可以看出,3 输入(奇数输入)变量异或与同或之间具有相等关系。

    逻辑表达式:

    真值表:

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  • 交通灯电路设计

    千次阅读 热门讨论 2020-12-10 16:48:49
    交通灯电路设计一、交通灯电路实现功能二、总体方案三、单元电路设计3.1状态转换电路3.2秒发生器3.3计时电路3.4数码管显示3.5复位四 、总体电路图五、分析总结六、心得体会七、未来工作 一、交通灯电路实现功能 1.1...


    一、交通灯电路实现功能

    1.1主干道亮绿灯时,则支干道亮红灯,主干道通车,时间为 50 秒。
    1.2转换时,绿灯先变为黄灯,5 秒后再变为红灯,同时另一方向道路的红灯转换为绿灯。
    1.3主干道亮红灯时,则支干道亮绿灯,支干道通车,时间为 30 秒。
    1.4用数码管指示绿灯和黄灯亮倒计时,其中绿灯在最后15秒才开始显示,以达到节能效果。
    1.5黄灯闪烁,绿灯在最后5秒闪烁。

    二、总体方案

    首先进行逻辑抽象,用 G、Y、R 表示主干道的绿、黄、红灯,用 g、y、r 表示支干道的绿、黄、红灯,亮为‘‘1”。根据设计任务与要求,可知交通灯简单控制时序如图所示,图中系统运行共有四种状态:主干道绿灯亮(G=1),50 秒后熄灭(G ↓);主干道黄灯亮(Y=1),5 秒后熄灭(Y↓);支干道绿灯亮(g=1),30 秒后熄灭(g↓);支干道黄灯亮(y=1),5 秒后熄灭(y↓)。之后又回到第一种状态:主干道绿灯亮……如此循环。
    交通灯电压波形图

    图表 1.交通灯电压波形图

    总体设计方案

    图表 2.总体设计方案

    可将系统分为三大功能模块:主电路、定时电路、控制电路部分。进一步细分,可将主电路分为主干道及支手道交通灯电路、译码显示电路;定时电路分为秒发生器、五十进制减法计数器、三十进制减法计数器、五进制加法计数器、计数器 CP 端控制电路;控制电路部分分为控制电路、复位开关。这样把总体方案划分为若干相对独立的单元。参考原理框图如图所示。

    三、单元电路设计

    3.1状态转换电路

    在设计中要求实现四种状态的自动转换,首先把四种状态用数字表示出来,00-001010、01-100001、10-010001、11-001100。状态转换图和状态转化表如下:
    在这里插入图片描述

    图表 3.状态转换图


    表格 1.状态装换表
    ABGYRgyr
    000001010
    101100001
    210010001
    311001100

    本设计由两个JK触发器实现,由卡诺图化简,得到如下的公式,直接由与或非门连接即可 { G = A ′ B Y = A B ′ R = A ′ B ′ + A B g = A B y = A ′ B ′ r = A ′ B + A B ′ \left\{ \begin{array}{l} G=A'B\\ Y=AB'\\ R=A'B'+AB\\ g=AB\\ y=A'B'\\ r=A'B+AB'\\ \end{array} \right. G=ABY=ABR=AB+ABg=ABy=ABr=AB+AB

    在这里插入图片描述

    图表 4.状态转换模块电路

    3.2秒发生器

    秒发生器由555定时器连接成的多谐振电路组成,连接一定规格的电阻电容就可以产生方波脉冲。利用公式 T 1 = R 3 C 1 ln ⁡ 2 T_1=R_3C_1\ln 2 T1=R3C1ln2
    T 2 = R 4 C 1 ln ⁡ 2 T_2=R_4C_1\ln 2 T2=R4C1ln2得到 T=T1+T2=1s.
    在这里插入图片描述

    图表 5.秒发生器模块电路

    在这里插入图片描述

    图表 6.秒发生器波形图

    3.3计时电路

    计时电路由74LS190十进制加减计数器构成,分为5秒、30秒、50秒三组,且均为倒计时计数。如下图所示。在这里插入图片描述

    图表 7.计时器模块电路

    每一组的进位输出与JK触发器的输入时钟与或,从而达到将某一状态延时的作用。在这里插入图片描述

    图表 8.计时器控制电路

    3.4数码管显示

    数码管显示模块由74LS47和共阳极数码管组成,共三组,分别是5秒黄灯倒计时、支路与主干路绿灯的15秒倒计时。数码管电路图如下:在这里插入图片描述

    图表 9.数码显示电路

    30秒、50秒绿灯倒计时的显示控制信号均是倒计时模块的输出信号经逻辑门电路形成的开关控制信号,SR锁存器将开关状态锁定输出给47芯片的灭灯输入端,具体电路如下:在这里插入图片描述

    图表 10.数码管显示控制电路

    3.5复位

    复位电路分为上电复位和按键复位两部分。
    上电复位由电容和电阻组成,当上电时,电容处于充电导通状态,所以输出高电平,通过反相器输出低电平,即复位信号。
    按键复位由按压开关控制,按下开关,产生复位信号。在这里插入图片描述

    图表 11.复位模块电路图
    复位电路主要目的是将JK触发器的状态清零,减法计数器重新置位。 所以将置位信号分别输入到JK触发器的清零端与减法计数器的置位端即可。(其中减法计数器本身有一个置位信号且两个信号均是0有效,所以有与门)

    四 、总体电路图

    在这里插入图片描述

    图表 12.总体电路图

    五、分析总结

    竞争与冒险现象:
    A、红绿灯显示时的竞争与冒险现象:红绿灯状态转换时会出现十分短暂的中间状态,经分析应为竞争与冒险的结果,其中产生竞争与冒险的原因是“反相器”的传输延迟。
    B、数码显示时的竞争与冒险现象:如图,在数码显示信号“CB′A”到达之前,由于B′之前的“反相器”的传输延迟,波形图中的黄波迟于红波和绿波反相,出现短暂的“111”状态,经与门后的蓝波出现短暂的高电平。由于我们使用的时SR锁存器,在暂态后,显示状态经锁存,相当于显示信号提前两秒到达,最终出现的结果是数码管绿灯倒计时总是从“17秒”开始倒计时。我们的解决办法是在AC之前均添加两个“反相器”,经过调整之后,数码管倒计时从“15秒”开始。
    G9nLmNzZG4ubmV0L1puX25hbm5hbg==,size_16,color_FFFFFF,t_70#pic_center)

    图表 13.因竞争与冒险产生的波形

    在这里插入图片描述

    图表 14.消除竞争冒险后的波形

    六、心得体会

    从开始设计到全部完成历时两周,这中间出现了很多很多的问题,我们均一一解决,包括每个状态持续不同时间如何实现、绿灯倒计时和绿灯闪烁如何在15秒及5秒的时候才出现、555定时器仿真错误、电路中的竞争与冒险等等。收获一,电路不仅要正确无误,美观才更能体现设计的合理性,这样不仅能体现一个人的认真与耐心,更能为未来调试电路带来方便。收获二,电路出现问题后,可以使用示波器观察信号波形,找到问题后再分析出现的原因,寻找解决的办法,我们解决竞争与冒险的问题就是这样解决的。这样查错调试能力不是一时就能提高的,需要不断地尝试,动手多了才有经验。收获三,一个人的力量是有限的,团队合作才是王道,要懂得1+1>2的道理,团队之间相互配合,每个人发挥自己的优势能达到意想不到的效果。

    七、未来工作

    由于时间限制,我们的电路仍然存在一些不足,因此在未来我们需要做一定的改进,如
    a. 红绿灯四个状态之间短暂的其他状态没有得到消除。因为使用的与非门过多,电路过于复杂,此处的竞争与冒险现象没有像数码显示信号处一样得到很好的解决。时间充裕的话可以耐心分析每一个信号暂态出现的原因,寻找更好的解决办法。
    b. 由555定时器组成的秒发生器因为一些电阻电容参数等影响,电路仿真长时间后会出现仿真错误。因此研究一下555定时器组成的多谐振电路中电阻电容参数取值范围是有必要的。

    展开全文
  • 数字逻辑笔记

    千次阅读 2021-12-08 20:37:19
    数字逻辑与数字系统设计 边写每章作业边记的解题方法……应付考试用

    目录

    数制转换

    十进制数转二进制数和八进制数

    二进制、八进制与十六进制之间的转化

    所有进制转十进制

    十进制数转换成 8421BCD 码

    BCD 码 与循环码

     已知输入与输出的部分情况,列出真值表并写出输出信号的逻辑表达式

    化简逻辑函数/求函数的值

    代数法:

     求一个逻辑函数的对偶式

    卡诺图法:

    将函数展开为最小项表达式:

    逻辑图、波形图、VHDL语句

    与运算(逻辑乘):

    或运算(逻辑加):

    逻辑图的题型:

    组合逻辑

    组合逻辑分析:给出一逻辑电路图,其中有控制输入端,让列出真值表说明输出与输入的关系/说明逻辑功能

    用器件实现功能

    数据选择器/多路转换器( MUX )74LS153

    数据分配器( DMUX )

    译码器 74LS139(2:4)/74LS138(3:8)/74LS154(4:16)

    七段数字译码器 74LS48

    编码器

    比较器 74LS85

    加法器:全加器 FA / 半加器 HA

    奇偶校验器 74LS280

    判断竞争冒险

    时序逻辑

    锁存器:基本 SR 锁存器(高/低电平有效)、门控 SR 锁存器、门控 D 锁存器

    触发器:SR / RS 、D 、JK 、T

    寄存器(边沿 D 触发器)、移位寄存器

    同步计数器

    移位计数器

    题型一:给出一部分波形图,让补全输出信号的波形

    题型二:给出逻辑电路图,分析时序/计数电路

    自产自销类型(输入端和输出端连一起了)

    状态转移表 + 状态转移图

    判断自启动和几进制计数器

    题型:用触发器构成计数器

    判断米里型还是摩尔型

    做输入序列检测器

    根据波形确定计数器有几个状态

    状态编码

    设计寄存器堆

    阵列图

    ROM 容量计算 + 一堆乱七八糟芯片所需片数的计算


    数制转换

    • 基数:即 R 进制中的 R ,此进制中逢 R 进一
    • 位权:数码所处的位置,例如 a_{1}a_{0}a_{0} 的 位权 为 0 ,a_{1} 的 位权 为 1 ,一般认为 整数部分的最低位 为 第 0 位;若有小数部分,则小数部分首位的位权为 -1

    十进制数转二进制数和八进制数

    • 整数部分,除 基数 取余,商为 0 时可停止,否则一直将 商 作为 被除数 循环与 基数 除
    • 小数部分,乘 基数 取整,精度满足要求时可停止,否则一直将 积 作为 乘数 循环与 基数 乘
    • 题目未要求就是给出的数字的小数位数

    结果顺序:

    1. 整数部分:后出来的在高位(即,将得到结果倒过来写)
    2. 小数部分:先出来的在高位(即,将得到结果按顺序写)

    十进制数过大时,也可先转化为八进制,再进行 ↓

    二进制、八进制与十六进制之间的转化

    • 二进制与八进制位权对应关系:(三位 2 对应一位 8 )001 → 1 , 010 → 2 ,100 → 4 ,111 → 7 = 1 + 2 + 4 ,同理 8 转 2
    • 8 转 2:将八进制数 每一位 拆开用 三位 二进制数分别表示
    • 2 转 8:每三位 二进制数一位 八进制数 表示
    • 小数部分同理适用,位数不够时,整数部分为左边补零,小数部分为右边补零

    10 转 2 再转 8 的情况可在此方法下应用:

    由于 k_{\left ( 2 \right )}\times 2^{n} 意味着将 二进制数 k 左移 n 位(若是 ÷ 则是右移),

    那么,可将一个数字拆分,譬如49_{\left ( 10 \right )}=32+16+1=2^{5}+2^{4}+2^{0}=100000+10000+1=110001_{\left ( 2 \right )}

    备注:这个方法就是 2 转 10 的逆方法,在考试里若为大题不如按书上取余做,选填无妨

    • 十六进制与八进制的转换仅能通过二/十进制进行链接
    • 十六进制二进制互转同理 2 与 8 ,只是 1 位十六进制 对应 4 位二进制

    所有进制转十进制

    • 每位上的数 * 基数为底的位权次方 的总和 即为所求转换成的十进制数

    二进制数过长可转为八/十六进制再进行该方法,注意别错位

    十进制数转换成 8421BCD 码

    • 即,用 四位二进制数 来表示 一位十进制,8421 分别为每位的 权
    • 换算方法同理十六进制与二进制,但 8421 码最大仅能为 9,四位二进制表示一位十六进制,最大可为 F
    • 故,8421 码是为了用来表示十进制数,总权加起来 > 9 的 8421 码是不存在的
    • 重点:别把 BCD 跟十进制转二进制搞混了,同一个十进制数的 BCD 码不一定等于转换的二进制,要转换就乖乖按前面方法做

    BCD 码 与循环码

    • 码通常是以逻辑电路功能分析和组合逻辑设计让实现码的转换的形式出现,是跟真值表挂钩的,需要知道怎么取
    • 像 8421 这种数字开头的 BCD 码指的就是用四位二进制数来表示十进制数,对应数字即对应位置的权,跟 8421 BCD 码换算同理
    • 余 3 码:在 8421 的基础上加个 3 ,即加个 0011,所以题目问到的时候说输入,不用把十六种情况都列出来
    • 循环码:不属于 BCD 码,所以不局限于 0 ~ 9 → 任何相邻的码字中,仅有一位代码不同,其他相同
    • 虽然不知道老师在不在意循环码在真值表中书写的顺序,不过可以用卡诺图来记忆,按照正常的卡诺图来读它们每格的编号:
    • 当 AB 为竖行时:第一行从左往右,第二行从右往左,第三行从左往右这样迂回读取,就是循环码的顺序
    • 当 AB 为横行时:纵向迂回读

    下图是循环码转格雷码,

    • 格雷码: 和循环码同理记忆,没有范围约束

     已知输入与输出的部分情况,列出真值表并写出输出信号的逻辑表达式

    • 由题目条件 → 列出真值表 → 写逻辑表达式

    譬如例题“一个电路有三个输入端……,当其中两个输入端为高电平时,输出 X 为高电平”

    • 列真值表(列即 输入端:A 、B 、C ……与 输出端:X ……,填入数据为 信号 0、1):
    • 先将全部输入端信号可能存在的情况列在表格中,有 n 个输入端,便会有 2^{n} 种情况,表格就会有 2^{n}
    • 再根据题目中的条件来判断输出端的输出情况,由此填输出端那列的值

    例题中的意思便是当两个输入端为 1 1 时,输出 X 输出的就会 是 1 ,不满足有两个输入端为高电平的情况,输出 X 输出就会是 0

    •  写出逻辑表达式:
    • 第一种方法:找出真值表中所有输出为 1 的行,此类行中每行对应的输入变量作乘积(输入时为 0 的变量上加 非号),最终将所有乘积项加起来
    • 第二种方法:找出真值表中所有输出为 0 的行,此类行中每行对应的输入变量求和(输入时为 1 的变量上加 非号),最终将所有求和项作乘积
    • 两种方法后都需化简才能作为最终的逻辑表达式(不过书上习题答案没有化简,可以先放着,写完所有题回来有空化简)

    化简逻辑函数/求函数的值

    • 当然求函数的值可以直接代
    • 布尔代数基本定律也具有 结合律、交换律、分配律
    • 注意:题目中可能要求了必须用什么方法

    代数法:

    • 并项法: AB+AB^{'}=A
    • 吸收法:A+AB=A
    • 消因子法:A+A^{'}B=A+B
    • 消项法:AB+A^{'}C=AB+A^{'}C+BC(一般也倒过来用,多余项定律)
    • 配项法:A+A=A , A+A^{'}=1(注意后者是 1 ,不是 A )
    • 摩根定律(反演律):

    • 吸收律(部分已规划至前面方法中):\left ( A+B \right )\left ( A+C \right )=A+BC
    • 由于代入规则的存在,上述式子皆可扩展至多项(将 A 、B 以 AB 之类的代替)
    • AB+\bar{A}\bar{B} 没法化简,另外注意 A + A非 = A ,A · A非 才= 0

     求一个逻辑函数的对偶式

    •  与(·)→ 或(+),或(+)→ 与(·)
    • 遵守 先与后或 的运算顺序,即,先把 与 给变成 或 ,再把 或 变成 与

    卡诺图法:

    • 建议看完下面最小项再来看卡诺图
    • 最小项:输入变量总共 n 个,那么这 n 个变量相与,但每个变量出现且仅出现一次(并且是独立状态出现,即出现的状态要么是 AB ,要么是 \bar{A}\bar{B} ,决不能是 \bar{AB}

    • 看看形式就好,注意点在第三列/第三行是 11 而不是 10
    • 可以这样记:(前提是 AB 为横排)三变量的第一列 m 的下标从上往下是 0 1,之后每列对应 + 2 ,第三列与第四列交换位置;四变量的下标是 0 1 3 2,之后每列对应 + 4 ,第三列与第四列交换位置;如果忘了也没事,按每格 ABC 的取值二进制转十进制就是了

    备注:铅笔标,写完 1 跟 无关项 就擦掉,否则很影响圈

    • 将逻辑函数(一般需要将函数 → 最小项之和形式/“与或”表达式,展开为最小项方法在下面)中出现的最小项在卡诺图中标出(取值为 1 )
    • 真值表也可转为卡诺图:输出为 1 时的输入变量情况对应在卡诺图中填 1 就行
    • 此处的相邻并不受表格边缘限制,找到就圈出来(主要圈的是 1 ,无关项是帮忙辅助圈 1 的,即 它 可 0 可 1 ,看你圈东西时候的需要)
    • 两个相邻的 1 可合并,保留相同的部分(消 1 变量)
    • 四个相邻的 1 可合并,保留相同的部分(消 2 变量)
    • 八个相邻的 1 可合并,保留相同的部分(消 3 变量),此类型中,表格两端竖着的列并不能合并消变量
    • 一个方格可被包围多次,但每个包围圈必须有新的方格:在此情况下,能圈多就圈多!!!
    • 保留的相同部分,变量取的是 0 时记得对应取非,1 就是原变量,最后全部保留的加起来
    • 做题思路:逻辑函数转换为合适的形式 → 画出卡诺图 → 找 8 保 1 → 找 4 保 2 → 找 2 保 3 → 孤立的 1 圈出来 → 写出合并后的最简“与或”表达式
    • 无关项:

    将函数展开为最小项表达式:

    • 将最小项中头顶非符号的认为 0 ,不带的为 1,看做二进制编码,对应十进制的值即为最小项代表符号的下标

    譬如,\bar{A}B\bar{C} 即看做 010 ,对应十进制为 4 ,那么此最小项的符号即为 m_{4}

    • 原式一般都是一堆非符号叠加,需要使用到摩根定律
    • 一般都会有需要扩成最小项的项,注意是一个变量一个变量扩,因为 AB + \bar{AB} = 1 != AB + \bar{A}\bar{B}

    建议写完最后来合并同样的,否则容易出错

    • 最终式子化成最小项之和的模式

    比如这样,

    逻辑图、波形图、VHDL语句

    与运算(逻辑乘):

    • 与运算表达式:F = A · B
    • 与门符号(多输入的就多加个引脚):

    • VHDL语言:F <= A and B

    或运算(逻辑加):

    • 或运算表达式:F = A + B
    • 或门符号:
    • 同或相当于异或做了个非运算

    (我™心梗了,这块都写完了给我吞了,我先复习别的了,就不补了,后面有空回来补,md,反正很简单,就是把符号什么的对应的VHDL语句背了,还有考试可能会有另一种形式的门对应就行)

    逻辑图的题型:

    • 题型一:根据逻辑表达式画出真值表、卡诺图、逻辑图、波形图、VHDL语句,其中逻辑图有可能被限制使用的器件/器件个数
    • 解题思路:
    • 真值表和卡诺图前面说过
    • 逻辑图就是逻辑电路图:使用布尔代数将表达式转化成符合的情况,直接画就行
    • 波形图根据真值表输入与输出的对应情况画准就行(输入开始跳变的时候,输出就跟着跳变了,所以不会不对齐)
    • VHDL 语句记得逻辑顺序,与或适当用括号隔开
    • 题型二:给出逻辑图,补全波形图或者写出上面那些一系列的东西
    • 根据逻辑图写出输出的表达式,列真值表 → 补全波形图,跟上面差不多
    • 可以出的题型也就那些,下面也算吧

    组合逻辑

    组合逻辑分析:给出一逻辑电路图,其中有控制输入端,让列出真值表说明输出与输入的关系/说明逻辑功能

    • 题型三:
    • ① 根据控制输入端的分布将总的输出 F 拆分成几个小的输出 F_{1}F_{2} 之类(根据题意来,一般都是总输出上一级的与/或门的输出拆成小输出,最后经过逻辑运算形成总输出)
    • ② 根据电路图,写出每个小输出的表达式(式子出来的形式是输入变量和控制输入变量的逻辑运算)
    • ③ 根据电路图,写出总输出的表达式(式子出来的形式同上)
    • ④ 根据每个小输出的表达式,画出其用到的控制输入端与该小输出的关系的表格(控制输入端那里就是 0 、1 的可能取值,小输出写出的形式是将控制输入端取值代入后其表达式剩下的东西)
    • ⑤ 注意,小输出出来的结果若是两个变量总体被非之类形式,用摩根定律拆成单个变量顶非号那种
    • ⑥ 将小输出的表格根据关系进行排列组合,比如这样(这个例子是 F = F_{1}F_{2} ,不同题不同分析)

    • 题型四:给出逻辑图,让画出真值表,并说明其逻辑功能
    • 说明逻辑功能的题都是看真值表呈现出的特性来做的
    • ① 不管题目让不让画真值表,都先看逻辑图,写表达式,画真值表
    • ② 根据真值表说明取 1 的时候是什么情况
    • ③ 这里注意下,如果题目本身就是拆分成 F_{1}F_{2} 的样子,那么每个输出都单独说一遍取 1 是什么情况,找特点,最后看整体有没特点,如果一眼看不出来,先做完别的题再回来看特点,实在不行就摆上小输出分别说的也行;另外,如果小输出也实在看不出特点,就把取 1 取 0 的情况随便分类说一遍也可
    • 比如,

    • 同类题型:给出转换器件的电路图,分析输出的是什么(就是逻辑功能的分析)
    • 题型五:套娃类型的电路
    • 没必要每个都必须写出完全拆开的表达式,只需要写出它跟上一级的关系表达式就行
    • 之后根据低层画出真值表然后根据里面关系来层层填表更方便些(异或同或用来填真值表更没必要拆开了)
    • 这类题里面有可能出现控制输入端,根据题可能会根据控制信号的 0 、1 进行分类讨论

    用器件实现功能

    • ① 将题目要求实现的功能抽象 → 画真值表
    • ② 根据真值表 → 画卡诺图(不用圈):输出的所有情况写进对应格子里(小输出的 0 、1 情况,注意是输入的取值格子里对应的输出情况) + 根据题目判断出的无关项 φ 写进格子(其实我觉得有没卡诺图没区别)
    • ③ 根据真值表 → 写出每一输出的表达式,最小项表达式
    • ④ 接下来就是看给的什么器材了,如果没指定器材就拿写出来的最简表达式照常画图(题目中可能还有使能端的要求,下图是 EN 低电平有效,这种就要加上)(这个时候还是做做卡诺图)

    比如这样,

    • ⑤ 具体内容在对应每个器件下面
    • ⑥ 固定 0 为接地,1 为电源,低电平就是非变量,不固定的根据输入变量画逻辑电路图就行
    • 画图照例可拆开原变量与非变量、线可交叉

    数据选择器/多路转换器( MUX )74LS153

    • 多路输入、单路输出
    • 大体上来看就是 ① 输入数据端 / ② 输入控制端 / ③ 输出端(一个 MUX 仅一路输出)
    • 输入数据端与输入控制端存在 2^{n} 的关系:
    • 说的二选一/四选一…器件里的 二、四…指的是输入数据端的个数,那么控制端就是对应的 一、二…(双四选一是两片 MUX 并在一起,所以两片双四选一拆开看就是四片 MUX )
    • 控制端对应输入的信号就是对数据输出的下标选择,比如说四选一里的控制端是 00 ,那么输出的就是 D_{0} …以此类推
    • ⑤ 续上题,最小项表达式 → 使用逻辑函数对照法,画图时 EN 接 \bar{ ST}

    即:

    • 这张图里,X 、Y 为控制输入端,D 那些是数据输入端,而出来的 D 关于 Z 的表达式就是画图的时候要通过电路给四个数据输入端的引脚送信号的依据
    • 另外,如果出来的只是单个变量的话,可以看看真值表,直接拿 0 、1 替了得了

    个人认为,不是根据看谁长得接近控制端而提取谁,应该一般都是以高位作为地址/控制输入端

    数据分配器( DMUX )

    • 单路输入、多路输出
    • 大体上来看就是 ① 输入数据端 / ② 输入控制端 / ③ 输出端(一个 DMUX 仅一路输入,但多路输出)
    • 输出端与输入控制端存在 2^{n} 的关系:
    • 说的 1 线 - 4 线…器件里的1…指的是输入数据端的个数,4 就是输出端的个数
    • 控制端对应输入的信号就是对数据输出的下标选择,被选择到的输出端即与输入端输入数据相同,余下输出端都为 1

    译码器 74LS139(2:4)/74LS138(3:8)/74LS154(4:16)

    • 大体上看组成是 ① 使能端 / ② 输入端 / ③输出端
    •  输出端与输入端存在 2^{n} 的关系:
    • 通常说的 3:8 译码器 中 3 为输入端的个数,8 为输出端的个数,使能端为 3 个( 2:4 的使能端只是一个 G ),必须满足 G_{1}=1G_{2}=G_{2A}+G_{2B} = 0 的条件(一高电平有效,两低电平有效),不满足条件的话,不管数据输入什么,译码输出全 1
    • 输入端输入的信号就是对数据输出的下标的选择,被选择到的输出端数据为 0 ,余下输出端都为 1
    • ⑤ 数据选择器输入的是控制输入端与操作下作为数据输入的信号,而译码器输入的就是它的数据输入端,只不过出来的输出量是需要经过电路才变成最终转换出的输出
    • 而最小项表达式 → 译码器的输出与最终输出之间的电路;同理可拆分原变量和非变量,只是就是一边是译码器的连接,一边是最终输出与译码器输出的两张图了,记得中间用箭头连接
    • 另外,因为译码器被选中出来的话就是 0 ,所以译码器出来的输出是低电平有效,所以往往最小项表达式需要使用摩根定律
    • 表格里是从左到右下标依次减小的,画图的时候记得对应下

    七段数字译码器 74LS48

    • 共阳/阴极电路:不同的连接方式,7 个发光二极管共用一个阳/阴极;区别就是共阴极高电平有效,共阳极低电平有效
    • 真值表输入方其实就是 8421 BCD 码,输出端就是 BCD 对应的十进制显现出来该亮的二极管

    此类题最好先进行画图,像下面这样,

    •  这个表达式有些输出用真值表看 0 的方法做比较容易写,但是看 0 就是遇 1 输入加非

    编码器

    • 输入个数大于输出个数,输出四位,组成 BCD 码,输入十位 是十进制数码,所以是个十进制数码 → BCD 码的转换,刚好跟译码器相反
    • 大体上来看是 ① 输入端 / ② 输出端

    比较器 74LS85

    • 两组输入(八个输入端)+ 比较结果的输出(三个输出端从低到高:> = <)+ 三个级联输入(从高到低:> = <)(是用于 4 位比较器的扩展)
    • 高位的那个 74LS85 的级联 = 接高电平,其余接地,跟低位的 74LS85 对应将前者输出和后者级联连接起来就可构成 8 位数据比较器

    加法器:全加器 FA / 半加器 HA

    • 三个输入端(加数、被加数、低位进位信号)+ 输出端(两个,一个是向高位进位的信号,一个是输出结果)
    • 半加器:两个一位二进制数相加,并且能向高位进位的电路
    • 全加器:两个一位二进制数相加的同时再加上低位来的进位的逻辑电路

    奇偶校验器 74LS280

    • 偶数个 1 和数总为 0 ,奇数个 1 ,和数总为 1

    判断竞争冒险

    • 代数法:
    • 就是说如果式子里一个变量同时以原变量的形式和非变量的形式出现,那么就具有竞争力
    • 其次,将没有竞争力的变量和有竞争力的变量排列组合写出所有能出现的情况,然后表达式代入值,只留另一个变量的形式,看会不会满足上面的形式,而满足上面的形式就说它具有险象
    • 卡诺图法:化简的圆相切,且相切处无其他圈包含
    • 冒险出现在变量发生变化的时刻,可以通过卡诺图增加冗余项将两个圈交际起来

    时序逻辑

    锁存器:基本 SR 锁存器(高/低电平有效)、门控 SR 锁存器、门控 D 锁存器

    • 锁存器是时序逻辑电路的基本单元
    •   Q^{n}\bar{Q^{n}}:现态和次态,翻转前为现态,反转后为次态

    • 组成:一个固定的时序脉冲输入端(内部写的是 EN ) + 根据名字确定的输入端( SR 是 S 、R ,D 只有一个 D )+ 两个输出端(  Q^{n}\bar{Q^{n}}
    • SR 锁存器高低电平看输入端有无圆圈符号
    • 功能表:
    • ① 基本 SR :(高电平)11 不稳,00 不变;(低电平)00 不稳,01 置 1 ,10 置 0 ,11 不变
    • ② 门控 SR :EN = 0 和 00 不变,10 置 1 ,01 置 0
    • ③ 门控 D :D 和 EN 对应:01 置 0 ,10 置 1 ,EN = 0 不变
    • 状态方程:
    • ① 基本 SR :Q^{n+1}=\bar{S}+R\bar{Q^{n}}(此为高电平,低电平将 S 、R 替换成对应非变量就行)
    • ② 门控 SR :Q^{n+1}=S+\bar{R}Q^{n}
    • ③ 门控 D :Q^{n+1}=D

    触发器:SR / RS 、D 、JK 、T

    • 看见 RS 记 SR ,好对应功能表
    • 组成:一个固定的时序脉冲输入端(内部是个底边贴器件边缘的小三角) + 根据名字确定的输入端( SR 和 JK 都是两个( SR → S 、R ;同理 JK ),D 就只有一个 D,同理 T )+ 两个输出端(记得 Q 的 非变量 的输出端那里要有个小圆圈)
    • 波形图:是在时钟脉冲( CP )的边沿改变状态的,看器件符号的 CLK 那个小三角旁边有没有圆圈(非),有的话就是在 CP 的下降沿改变状态的,就叫负边沿触发器,没有就是在 CP 的上升沿改变状态的
    • 功能:(保持 → 次态 = 初态,送数/置 0/1 → 次态 =( 01 时)0 = ( 10 时)1 ,翻转 → 次态 = 初态 的 非变量,不稳 → 不确定次态)
    • ① SR :XX 和 00 都是保持,01 和 10 前者置 0 ,后者置 1,11 是不稳
    • ② D :XX 是保持,0 和 1 是送数,前者送 0 ,后者送 1 ,没有 11
    • ③ JK :XX 和 00 都是保持,01 和 10 都是送数,11 是翻转
    • ④ T :0 是 Q^{n} ,1 是 \bar{Q^{n}}
    • 状态方程:
    • ① SR :Q^{n+1}=S +\bar{R}Q^{n}
    • ② D :Q^{n+1}=D
    • ③ JK :Q^{n+1}=J\bar{Q^{n}}+\bar{K}Q^{n}
    • ④ T :T\bar{Q^{n}}+\bar{T}Q^{n}

    寄存器(边沿 D 触发器)、移位寄存器

    • 边沿 D 触发器:边沿触发,输出控制为 1 时为高阻态,为 0 且 CP 为 0 时输出不变,余下情况 D 输入是什么输出就是什么数
    • 移位寄存器:就是将触发器首尾相连

    同步计数器

    • 三个触发器可以表示三位二进制数,与移位寄存器一样都是时钟脉冲相连

    移位计数器

    • 扭环计数器:K 个触发器可计 2K 个数
    • 环型计数器:K 个触发器可计 K 个数

    题型一:给出一部分波形图,让补全输出信号的波形

    • ① 画输出波形改变的参照线(之后可以在线上改变输出形态):
    • 看题目中说的器件类型(若有逻辑电路图就看脉冲那里有没三角,没有就是电平触发,有就是边沿触发,然后根据圆圈有无判断是上升/下降还是高低) →
    • 若为触发器:
    • a .题目说明负边沿/正边沿,负边沿 → 沿 CP 下降沿画线,反之沿上升沿
    • b .有逻辑电路图 → 看器件脉冲输入端是否有圆圈符号,有 → 下降沿,反之上升沿
    • ② 画输出波形 Q :
    • 看题目中说的器件类型 → 回忆对应功能表 → 确定题目开始初态 → 看参照线画过的输入端对应输入情况 → Q 的取值跟着输入变化(就看表) → 画 Q
    • 输出波形是在参照线上变的,中间不会改变状态,也就是说不用关注输入端整体怎么变化,只用看辅助线那时刻的输入,抽象成 0 、1 ,找输出的情况进行画
    • ③ 画 Q 的非变量 的输出波形:跟 Q 波形对称就行

    题型二:给出逻辑电路图,分析时序/计数电路

    • 要的就是三个方程:激励 + 状态 + 输出
    • ① 根据逻辑电路图,写出输入信号的方程(即激励方程),老题型了,记得化简(照例同或异或不用化,根据奇偶数个 1 来判断整体取值)
    • ② 将输入信号的方程代入对应器件的次态(特征)方程中(即状态方程),如果是多片连接的话,还有输出方程
    • ③ 什么器件 → 功能表什么时候是 置 1 的 → 确定输入信号的取值 → 推出表达式里的变量的取值情况
    • 自产自销类型(输入端和输出端连一起了)

    • 意思大概是 Q^{n}\bar{Q^{n}} 可以直接替换次态方程中的输入,具体怎么替换看谁连谁
    • 原先不连的时候直接根据功能表输入的取值来找输出就行
    • 比如 J 连了 \bar{Q^{n}},那么次态方程中的 J 就可以用 \bar{Q^{n}} 代替,输出按照公式和初态来就行
    • 记得关注 CLK 边上有没圆圈
    • 如果式子里保留了 K 之类的没给出取值的东西,可以根据替换 J 的输出来确定功能表里对应的输出

    状态转移表 + 状态转移图

    • 一般这种题都得先把那三个方程写出来,然后再做表/图
    • 列:CP(脉冲顺序) + 现态 PS + 次态 NS +输出
    • 根据开头的 现态/初态 写出对应的 次态,将此 次态 作为下次脉冲到来时的 现态 以此类推
    • 如果没有明确说按时间脉冲来就照例全部情况列出来
    • 状态转移图:
    • 圆圈是状态( 0 、1 序列),→ 指向的是现态可以到达的次态
    • 判断自启动和几进制计数器

    • 画出转移图后,看谁没有在形成的圈里(有效循环),谁就是无效状态
    • 如果图里无效状态不是独立的,而是与圈连接的,那么电路可以自启动(无效状态在 CP 作用下能够进入有效循环)
    • 有效循环是几个状态构成的就是几进制

    题型:用触发器构成计数器

    • ① 列出真值表(在这里面就是状态转移方程),一般会给有效状态(计数器只用管有效状态)
    • ② 根据真值表求出状态方程,出来就是次态关于现态的表达式
    • ③ 代入对应器件的特征方程中,得到激励方程
    • ④ 根据出来的激励方程画逻辑电路图
    • 老题型了

    判断米里型还是摩尔型

    • 画状态转移图 and 表
    • 输入与输出直接相关的是米里型
    • 输入与输出不直接相关的是摩尔型
    • 不太靠谱的判断方法:图里箭头是 控制 / 输出 的是米里型,只有个 控制 的是 摩尔型

    做输入序列检测器

    • 只有一个输入端 X 和一个输出端 Z
    • 检测的序列有几位就有几个状态,比如检测 101 就有三个状态
    • 先假设个初态为 A ,当 X 为 1 时,说明序列的第一个是 1 ,记下来,然后进入 B 状态判断第二个 X 是不是 0 ;如果 X 为 0 ,则说明第一个是 0 ,保持现态,等下一个 X 进来判断
    • 以此类推
    • 检测到第三个 1 后,就出现问题了,可重叠或者不可重叠,先把前面记录的两个给报废掉,后面分情况,不可重叠呢,这个也就不记录了,输出 1 然后直接回初态重新开始检测
    • 如果可重叠,输出 1 回第二个状态继续进行
    • 画表也就是现态 + 次态 / 输出(里面分 X 取 0 / 1 )

    根据波形确定计数器有几个状态

    • 每个脉冲边沿变化的时候(要么上升沿要么下降沿)把状态抽象成序列,看不重复的序列有几个

    状态编码

    • 一对一法:每个状态分配一个触发器
    • 计数器法:分配确切数目的触发器,触发器输入的变量形成到的二进制转换为十进制数是下标
    • ① 看状态表,将等价的状态情况合并起来
    • ② 选择一对一 / 计数器 分配对应数量的触发器
    • ③ 画出状态转移表
    • ④ 根据表写出状态方程和输出方程
    • ⑤ 对式子进行对应的变化,实现电路

    设计寄存器堆

    • 使用 DMUX(数据分配器)将单端口输入的数据变成多路,存入寄存器堆中,再使用 MUX(数据选择器)将数据以单路形式读出
    • 其中采用地址输入译码器进行分时复用的选择

    阵列图

    • 一般在 ROM RAM 中出现的题型
    • 根据要实现的功能作真值表
    • 根据真值表写出输出的最小项表达式
    • 画出阵列图:
    • ① 画横线:输入的原变量 + 非变量,每个一条横线
    • ② 画竖线:一共有多少个输出变量,就画对应 2 的次方个竖线,即最小项的总数
    • ③ 标明最小项:在与输入量的横线交汇的地方,将每个最小项画对应的圆圈表示出来(在同一条竖线上的变量就是相与)
    • ③ 标明输出有的最小项:根据最小项表达式,输出里有的就在输出那条线上的交叉点画圈(在同一条横线上的最小项就是加起来)

    ROM 容量计算 + 一堆乱七八糟芯片所需片数的计算

    • 输入 n 位,输出 m 位,所以 ROM 容量为 2 的 n 次方 *( n + m )
    • 用需要构成的寄存器容量除以芯片容量就是需要的片数
    展开全文
  • 在之前的章节,我们对 MySQL 的安装、配置有了一定的了解。接下来的篇章我们将来学习一下如何操作逻辑库和数据
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    网络安全之路 踩坑篇 记录学习及演练过程中遇到的坑,便于后来居上者
    网安知识扫盲篇 三天打鱼,不深入了解原理,只会让你成为脚本小子。
    vulhub靶场漏洞复现 让漏洞复现变得简单,让安全研究者更加专注于漏洞原理本身。
    shell编程篇 不涉及linux基础,最终案例会偏向于安全加固方向。 [待完结]
    WEB漏洞攻防篇 2021年9月3日停止更新,转战先知社区等安全社区及小密圈
    渗透工具使用集锦 2021年9月3日停止更新,转战先知社区等安全社区及小密圈
    点点点工程师 测试神器 - Charles 软件测试数据包抓包分析神器
    测试神器 - Fiddler 一文学会 fiddle ,学不会倒立吃翔,稀得!
    测试神器 - Jmeter 不仅是性能测试神器,更可用于搭建轻量级接口自动化测试框架。
    RobotFrameWork Python实现的自动化测试利器,该篇章仅介绍UI自动化部分。
    Java实现UI自动化 文档写于2016年,Java实现的UI自动化,仍有借鉴意义。
    MonkeyRunner 该工具目前的应用场景已不多,文档已删,为了排版好看才留着。

    在这里插入图片描述


    在之前的章节,我们对 MySQL 的安装、配置有了一定的了解。接下来的篇章我们将来学习一下如何操作逻辑库和数据表。


    🐳 什么是 SQL 语言

    数据库呢为使用者留出了操作的接口,只要编写好 SQL 语句,数据库就能帮我们完成 增、删、改、查 等一系列操作,所以学习数据库的关键在于掌握 SQL 语言。

    SQL 语言的全称叫做 “结构化查询语言” ,它也是一种计算机语言;但是与其他的编程语言相比较来说还是有很大的差异的。

    比如说:

    • html、CSS、JavaScript 这三种计算机语言是用在 网页设计 上面的;
    • Swift 是用来发开 IOS 程序的;
    • C++、C#、VB 是用来开发桌面程序的;
    • SQL语言 只能用在数据库操作上面。

    需要值得注意的是,每种数据库的 SQL 语言并不能 100% 兼容,就比如很多 Oracle 的 SQL 语句,在 MySQL 上就执行不了。这种现象叫做 SQL 语句的方言(即 SQL 语言是一套标准,所有的数据库厂商都实现了此标准;但是各自厂商在此标准上增加了特有的语句,这部分内容我们称为方言。)。虽说 SQL 语句有几十种,但是都很简单,所以大家尽可放心的学习。


    🐬 SQL语言分类

    SQL语言一共可以分为三大类:

    • 第一种:DML(数据操作语言),对数据表的 增、删、改、查 就是这一类语言。
    • 第二种:DCL (数据控制语言),对用户的创建、权限分配、事务的管理都是属于这一类的。
    • 第三种:DDL (数据定义语言),用来管理逻辑库、数据表、视图、索引的语言。

    🐬 SQL语句注意事项

    • SQL 语句是不区分大小写的,但是字符串内容是区分大小写的(见下面的例句,可以先不用理解什么意思),比如下面这条SQL语句

      • SELECT * from mysql.USER WHere USER = 'dev';
        
        -- 该SQL语句的 SELECT 、from 、WHere 三个关键字 就是大小写不区分或混着编写的,但是并不影响它的执行与查询结果;
        -- 但是 字符串的 'dev' 就需要明确的区分大小写了,因为它是作为一个 '值' 传入到数据库进行数据比对结果查询的。
        

    • SQL 语句必须以英文的分号结尾, ";"

    • SQL 语句中的空白和换行是没有限制的,但是不能破话语句的语法结构,如下:


    🐬 SQL语句的注释

    与开发语言一样, 在 SQL 语言中同样的有注释。

    • 单行注释:使用 # 在 SQL 语句的起始位即可,这样的话,在执行 SQL 语句的时候会跳过注释的语句
    • 多行注释:使用 /* xxxx */ 进行一段文字或者多行的注释,其中 xxxx 就是需要被注释的文字

    示例如下:

    # SELECT * from mysql.USER WHERE USER = 'root';
    
    /*-------------------------------------------*/
    
    /*
    SELECT
    	* 
    FROM
    	mysql.USER 
    WHERE
    	USER = 'dev';
    */
    

    🐳 创建逻辑库

    在 MySQL中,如果想要保存数据,就必须先要有逻辑空间,也就是先要在数据目录里创建文件夹。

    • 创建逻辑空间的语句为:

      CREATE DATABASE 逻辑空间名称;		# 创建逻辑库语句(逻辑空间名称建议使用 英文 或者 英文+数字)
      
    • 查看逻辑空间的语句为:

      SHOW DATABASES;		# 显示当前所有的数据库逻辑空间
      
    • 删除逻辑空间的语句为:

      DROP DATABASE 逻辑空间名称;		# 删除书库逻辑空间语句
      


    PS:创建逻辑库属于 DDL 语句!


    🐳 创建数据表

    创建数据表 SQL 语句格式如下:

    CREATE DATABASE 数据表名称(
    	列名1 数据类型 [约束] [COMMENT 注释],
    	列名2 数据类型 [约束] [COMMENT 注释],
    	......
    )[COMMENT = 注释 ];
    
    # 这里的 "约束" 与 "注释" 是可选项,可填可不填。
    # "约束" 是对该列的一个条件约束,比如说某字段为 "姓名" 一栏,"约束" 姓名字段不能为空
    # "注释" 其实就是给人看的,直接跟上注释的内容就行了(列可以有注释,表也可以有注释。)
    

    来看一个具体的创建 数据表 的例子:(需要注意的是,在进行创建数据表的时候,需要使用 USE 命令指定逻辑库。)

    USE test;
    
    CREATE TABLE student(
    	id INT UNSIGNED PRIMARY KEY COMMENT "主键:id,呈递增状态,不可重复;UNSIGNED:无符号的整数,也就是说没有负数。",
    	nane VARCHAR(20) NOT NULL COMMENT "name 为字符串类型,非固定长度字符串,长度不得超过 20 的数量,不可为空。",
    	sex CHAR(1)NOT NULL COMMENT "sex 是固定的,要么男,要么女,所以只给一个字符串长度即可,不可为空。]",
    	birthday DATE NOT NULL COMMENT "birthday wei 日期类型,不可为空。",
    	tel CHAR(11) NOT NULL COMMENT "tel 长度为 11,不可为空",
    	remark VARCHAR(200)COMMENT "remark就是一个备注字段的信息(长度不得超过200,因为可填可不停,所以就没加上约束)。" 
    	)COMMENT "学生表";
    

    这里先尝试添加两条数据用于展示,可以通过可视化的图形界面将数据添加进去,也可以通过 INSERT 语句添加数据(后续会针对增删改查进行详细的讲解)

    • 手动图形化添加:

    • SQL语句添加:执行 SQL INSERT INTO student VALUES(2, '李四', '男', '1990-12-12', '13312345678', '测试数据');


    🐳 数据表的其他常用操作

    SHOW tables; 		 			# 显示当前数据库逻辑空间的数据表的名字
    DESC student;				    # 显示当前表的结构信息(是数据表的信息,不是数据表的内容)
    SHOW CREATE TABLE student ;		# 显示当前表创建时的SQL语句
    DROP TABLE student ;			# 删除当前表
    

    OK,到了这里估计大家也都知道了如何管理数据库的数据逻辑空间、管理数据表了,就到这里吧。

    展开全文
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  • 数字电路-时序逻辑电路

    千次阅读 2020-03-04 17:25:50
    本节将系统介绍时序逻辑电路的工作方法和分析方法、设计方法。首先,概要地讲述了时序逻辑电路在逻辑功能和电路结构上的特点,并详细介绍了分析时序逻辑电路的具体方法和步骤。然后分别介绍了移位寄存器、计数器、...
  • 数字电子技术之逻辑函数的化简及表示

    千次阅读 多人点赞 2020-05-24 23:21:40
    数字电路的作用是用来表达一个现实的逻辑命题,实现逻辑功能。但是,从 逻辑功能中简单概括得出的逻辑函数,往往不是最简表达式,根据这样的非最简式来实现电路,系统会过于复杂,成本过高,同时,电路运行的安全性...
  • 数电基础(6)--时序逻辑电路

    千次阅读 2020-05-07 21:44:25
    转态转换真值二、同步时序逻辑电路的分析三、同步时序逻辑电路的设计四、异步时序逻辑电路的分析五、若干典型的时序逻辑电路 学习完本节,要能回答以下问题: 掌握时序逻辑电路的描述方式及其相互转换 掌握时序...
  • 组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入,与电路原来的状态无关。而时序逻辑电路在逻辑功能上的特点是任意时刻的输出不仅取决于当时的输入信号,而且还取决于电路原来的状态,或者说...
  • 例题A(1) 写方程组(2) 根据方程组列出状态转移真值(3) 根据状态转移真值状态转移图(4) 根据状态转移图画时序图(5) 检查电路能否重启动(6) 画出完整的状态图(7) 判断电路功能3. 例题B(1) 写方程组(2) 列状态...
  • 实验一 组合逻辑电路的设计与测试

    万次阅读 2021-04-20 01:12:14
    2、根据实验内容要求设计出相应的组合逻辑电路,写出设计步骤,并画出逻辑电路图。 二、实验目的 1、熟悉数字电子技术综合设计实验箱的使用。 2、进一步熟悉组合逻辑电路的设计方法与设计步骤。 3、学会用真值设计...
  • 本文为明德扬原创及录用文章,转载...组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入,与电路原来的状态无关。而时序逻辑电路在逻辑功能上的特点是任意时刻的输出不仅取决于当时的输入信号...
  • 目录时序逻辑概述2、时序逻辑电路的组成3、时序电路的分类时序逻辑电路分析1、时序逻辑电路分析步骤寄存器、移位寄存器1、数码寄存器2、移位寄存器移位寄存器的应用同步计数器1、同步二进制计数器2、二进制同步加/减...
  • 文章目录A 组合逻辑电路的分析和设计方法A.a 组合逻辑电路的特点及描述A.b 组合逻辑电路的分析A.c 组合逻辑电路的门级电路设计A.d 组合逻辑电路中的竞争-冒险现象 A 组合逻辑电路的分析和设计方法 A.a 组合逻辑电路...
  • 组合逻辑电路的分析与设计

    万次阅读 多人点赞 2020-01-17 21:36:47
    1.组合逻辑电路的分析方法 首先给组合逻辑电路的一般分析方法,如图1.1所示。 图1.1 组合逻辑电路的一般分析方法 以下图的组合逻辑电路为例。 ...
  • 程序猿必备的数电知识之(逻辑代数基础前半篇)

    万次阅读 多人点赞 2020-03-16 18:04:57
    1.只有两种对立逻辑状态的逻辑关系成为二值逻辑。 2.所谓逻辑,在这里是指事物间的因果关系。当两个二进制数码表示不同的逻辑状态时,它们之间可以按照指定的某种因果关系进行推理运算。我们将这种运算成为逻辑运算...
  • 同步时序电路分析的“核心”——借助触发器的新状态(次态)表达式列出时序电路的状态转换或画出状态转换图。 同步时序逻辑电路分析的一般步骤 驱动方程代入JK触发器的特性方程。 不断循环。 电路没有输入。 ...
  • 一文搞懂时序逻辑电路

    千次阅读 2021-05-16 17:50:00
    1 时序逻辑电路 1.1 介绍 输出往往反馈到输入端,与输入变量一起决定电路的输出状态。 1.2 特点 任意时刻输出不仅取决于该时刻输入变量的状态,而且还与原来的状态有关。 1.3 锁存器 1.3.1 特点 有两个互补的输出...
  • 一、异步时序逻辑电路特点及分类 1.特点:没有统一时钟脉冲信号,电路状态的改变是外部输入信号变化直接作用的结果; 在状态转移过程中,各存储部件的状态变化发生不同步,不同状态维持时间也不一定相同; 在研究...
  • 数电基础:时序逻辑电路

    万次阅读 多人点赞 2019-08-19 08:52:21
    虽然每个数字电路系统可能包含有组合电路,但是在实际应用中绝大多数的系统还包括存储元件,我们将这样的系统描述为时序电路。... 时序逻辑电路是数字逻辑电路的重要组成部分,时序逻辑电路又称时序电路,主...

空空如也

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