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  • 10 AD运行DRC检查

    万次阅读 多人点赞 2018-04-24 14:52:28
    DRC检查是依据自行设置的规则进行的。例如自己设置的最小间距是8mil,那么实际PCB中,出现小于6mil的间距就会报错。并不是DRC有错误的板子就不能使用,例如丝印的错误不会影响电气属性。接下来简单分析几种常见的...

     

    DRC检查是依据自行设置的规则进行的。例如自己设置的最小间距是8mil,那么实际PCB中,出现小于6mil的间距就会报错。

    并不是DRC有错误的板子就不能使用,例如丝印的错误不会影响电气属性。接下来简单分析几种常见的错误。

    运行DRC以后,会弹出一个页面和message。只看Message,双击message可以快速定位错误。

    错误类型

    [Clearance Constraint Violation]

    间隙约束违规,一般是敷铜的网络会设置间隙约束,例如网络属性为VCC3.3的导线和GND的敷铜连在了一起,其实只要间隙小于规定值例如20mil,就会报错。

     

    问题 [Width Constraint Violation]

    宽度约束违规

    这根线的宽度是40mil

    但是定义的线宽最大为30mil

     

    [Short-Circuit Constraint Violation]

    短路,不同的网络被强行接在一起。

     

    Hole Size Constraint Violation]

    过孔大小不合适

     

    Hole To Hole Clearance Constraint Violation

    孔和孔接到一块了

     

    以下是网络上的一些

    1.Rule Violations Count 
    违反数 

    2.Short-Circuit Constraint (Allowed=No) (All),(All)

    短路约束=不允许)(全部),(全部) 

    3.Un-Routed Net Constraint ( (All) ) 26 
    Un-Routed净约束(所有)26岁 

    4.Clearance Constraint (Gap=9mil) (All),(All) 
    间隙约束(间隙= 9 mil)(全部),(全部) 

    5.Power Plane Connect Rule(Relief Connect )(Expansion=20mil) (Conductor Width=10mil) (Air Gap=10mil) (Entries=4) (All)

    功率平面连接规则(救济连接)(扩展= 20 mil)(导体宽= 10 mil)(气隙= 10 mil)(条目= 4)(全部)0 

    6.Width Constraint (Min=8mil) (Max=20mil) (Preferred=15mil) (All)

    宽度约束(Min = 8 mil)( Max= 20 mil)(优先15例mil)(全部)
    问题应该出在你设置和实际的冲突,你的Protel所设置的最小线宽是25mil,最大线宽也是25mil,默认线宽还是25mil,这本没错,但可能是你的某根GND线不是25mil,或者你用了覆铜,而覆铜的线条(Track Width)也不是25mil,所以才出错!建议在Design 的Rule里设置一下Width Constraint的最大和最小线宽,调整到合适范围,就不会报错了。

    7.Height Constraint (Min=0mil) (Max=1000mil) (Prefered=500mil) (All)

    高度约束(Min = 0 mil)( Max = 1000 mil)(优先= 500 mil)(全部)

    8.Hole Size Constraint (Min=1mil) (Max=150mil) (All) 
    孔尺寸约束(Min = 1 mil)( Max = 150 mil)(全部)

    修改尺寸,设计孔大于你设置的规则的值
    9.Hole To Hole Clearance (Gap=6mil) (All),(All)

    洞孔间隙(间隙= 6 mil)(全部),(全部)

    引脚安全间距问题,一般是封装的问题,如果确定封装没问题,这个错误基本你可以忽略。

    10.Minimum Solder Mask Sliver (Gap=1mil) (All),(All) 
    最低焊接面罩银(间隙= 1 mil)(全部),(全部)
    你的某个元件的焊盘间距 大于1mil,你可以选择该规则或者把封装中的焊盘间距改大一点。
    11.Silkscreen Over Component Pads (Clearance=1mil) (All),(All)

    丝网印刷在组件垫(许可= 1 mil)(全部),(全部)

    顶层丝印与元件焊盘距离近(小于1mil)
    按D、R将规则中的Silkscreen Over Component Pads 改小一些就可以了
    12.Silk to Silk (Clearance=1mil) (All),(All)

    丝印丝印(间隙= 1 mil)(全部),(全部)

    两个丝印之间的距离太近,这个错误可以忽略
    13.Net Antennae (Tolerance=0mil) (All)

    网络天线(耐受= 0 mil)(全部) 

    14.Clearance Constraint (Gap=6mil) (InComponent(U1)),(All)

    间隙约束(间隙= 6 mil)(InComponent(U1)),(所有)

     

     

     

     

     

     

     

     

     

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  • AD20-DRC检查

    千次阅读 2020-04-20 18:36:02
    红圈中是安全间距检查,勾选可以检查板子中的安全间距。之后点击左下角的运行DRC,就行了,板子中有错误的话就会报错。有错改错就行了。 其实还有文件的输出部分,那部分有需要的话上百度搜就行了。 谢谢观看! 欢迎...

    点击下图中的红圈内选项:在这里插入图片描述
    就会出现:在这里插入图片描述
    第一个红圈可不勾选(可以不创建报告文件),第二个红圈中的填的稍微大一点。

    接下来就是:
    在这里插入图片描述

    红圈中是安全间距检查,勾选可以检查板子中的安全间距。之后点击左下角的运行DRC,就行了,板子中有错误的话就会报错。有错改错就行了。
    其实还有文件的输出部分,那部分有需要的话上百度搜就行了。

    谢谢观看!
    欢迎批评指正!
    欢迎交流学习!

    完。

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  • 创建新的虚拟桌面:Win + Ctrl + D• 关闭当前虚拟桌面:Win + Ctrl + F4• 切换虚拟桌面:Win + Ctrl +左Altium Designer 6 DRC规则检查的英汉对照表Ⅰ、Error Reporting 错误报告A:Violations Associated with ...

    创建新的虚拟桌面:Win + Ctrl + D

    • 关闭当前虚拟桌面:Win + Ctrl + F4

    • 切换虚拟桌面:Win + Ctrl +左

    Altium Designer 6 DRC规则检查的英汉对照表

    Ⅰ、Error Reporting 错误报告

    A:Violations Associated with Buses 有关总线电气错误的各类型(共12项)

    ◆ bus indices out of range 总线分支索引超出范围

    ◆ Bus range syntax errors 总线范围的语法错误

    ◆ Illegal bus range values 非法的总线范围值

    ◆ Illegal bus definitions 定义的总线非法

    ◆ Mismatched bus label ordering 总线分支网络标号错误排序

    ◆ Mismatched bus/wire object on wire/bus 总线/导线错误的连接导线/总线

    ◆ Mismatched bus widths 总线宽度错误

    ◆ Mismatched bus section index ordering 总线范围值表达错误

    ◆ Mismatched electrical types on bus 总线上错误的电气类型

    ◆ Mismatched generics on bus (first index) 总线范围值的首位错误

    ◆ Mismatched generics on bus (second index) 总线范围值末位错误

    ◆ Mixed generics and numeric bus labeling 总线命名规则错误

    B:Violations Associated Components 有关元件符号电气错误(共20项)

    ◆ Component Implementations with duplicate pins usage 元件管脚在原理图中重复被使用.........

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  • AD19有时DRC检查特别慢的问题

    千次阅读 2020-06-25 21:40:05
    今天遇到好多次AD19的DRC检查特别慢的问题。 正常时, DRC检查就10秒不到。慢的时候,10分钟检查不完(PCB没啥大改动,就将DRC检查出的问题修正了1,2处)。这是AD19的bug啊。 最后总结一下,要DRC检查为正常速度的方法...

    前言

    今天遇到好多次AD19的DRC检查特别慢的问题。
    正常时, DRC检查就10秒不到。慢的时候,10分钟检查不完(PCB没啥大改动,就将DRC检查出的问题修正了1,2处)。这是AD19的bug啊。

    最后总结一下,要DRC检查为正常速度的方法:

    • 只能开一个工程, 将参考设计工程关了。
      ** 将已经打开的DRC检查结果TAB页先关了。
      ** 将工程都保存一下(包括PCB, 原理图)。
      现在运行DRC, 好像没遇到过特别慢的情况

    不是,按照上面的前置条件,进行DRC检查时,还是有很慢的情况。不知道AD在忙啥,应该是AD的bug.

    这次慢的情况,是我在DRC检查全通过的情况下,设置了usb差分信号的线宽,用来阻抗匹配。通过设置一个Net Class, 将usb信号线的网络都包进去,线宽全部设置成5.096mil, 就加了这个规则。

    然后再检查, AD就很慢了。这要不得啊.

    大概10分钟DRC才结束。在没做任何改动的情况下,再运行DRC, 这次秒结束。
    估计是规则变了的情况下,或者是PCB有改动的情况下,DRC头一次检查会很慢。

    不过不应该啊,我这块板子60mm x 80mm, 很小的一块板子。
    但是有时板子动了一些地方,DRC规则也改了,DRC检查也不慢啊。
    还是AD19有BUG, 下次不用这破玩应了,换成cadence去玩。

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  • AD中PCB检查设计错误规则设置(DRC检查配置)

    万次阅读 多人点赞 2019-11-07 09:48:26
    AD中PCB检查设计错误规则设置 遇到的问题:在设计好的PCB电路中,我们不能保证所有的线是否一次性全部布好,此时我们一般情况下需要设置电路的布线规则检查,以确保电路在布线的时候不会发生错误,下面我将向大家...
  • AD18进行DRC检查显示警告

    千次阅读 2019-07-29 11:56:49
    AD18进行DRC检查显示警告:“ Design contains shelved or modified (but not repoured) polygons…”,这是你铺铜没铺好的问题,把有问题的铜块删掉重新铺。 再次进行DRC检查,警告还在,可能是你设定的铺铜规则与...
  • AD10的DRC检查

    万次阅读 2014-04-21 19:33:01
    PCB布线完毕后文件输出到打印机之前,还有一步关键的操作要完成:完整的设计规则检查,Design Rule Check简称DRC。在菜单栏Tools\Design Rule Checker。点进去之后弹出一个设计规则检查器对话框。里面包含的检查内容...
  • PCB文件DRC检查规则

    2019-01-29 18:29:49
    Altium Designer中DRC检查规则,此规则适用于FBGA等高速电路设计
  • 之前装过一次AD软件没有报过这样的错误,卸掉后重新装了之后,在对电气规则检查检查时“软件提示...report_drc.xsl不存在”。 原因:之前装的目录默认在C盘下,所以AD软件输出的报告也是默认C盘下,卸掉软件后,...
  • 1》DRC发现未连接的线为0,但Report----板信息 中的布线信息却不为0; DRC检测未连线为0 板信息的布线信息有5个未连接的线 是否感觉很奇怪,DRC检测失效了,然而是我们错了; 2》需要在DRC检测之前要设为...
  • Altium Designer之DRC检查学习笔记

    千次阅读 2020-05-24 14:38:13
    Design Rule Check(DRC),是检查设计是否满足所设置的规则,是PCB完成前最为重要的一步。通过检查来判定是否满足设计的要求,需要检查什么,就打开相关的检查选项,该设置涉及检查PCB板内容,需要每次都重新配置...
  • AD DRC检测不能查出断连的线

    万次阅读 2017-11-22 16:47:34
    画了一版电路,打样回来发现有问题,仔细看看PCB布线图发现有一根线没有连接,我就奇了怪了,我明明做了DRC检查了啊,怎么会出现没有连接好的线呢?上网查了一下,又说在规则里面没有将Un-Routed Net使能,但是我D-R...
  • Altium未连接的网络DRC检查不出的问题 最近在Altium软件下进行硬件设计,发现明明有网络被连接,但是DRC却检查不出,给出Un-Routed Net Constraint ( (All) ):0 这样的误导性提示,导致在最近设计的一块PCB里有一根...
  • 在画完PCB后进行DRC检查的时候总是报Short Circuit Constraint错误,仔细检查PCB感觉也没有那个地方短路。我做了一个最简单的实验,仅仅将导线连接到一个焊盘上再做DRC检查同样会报 Short Circuit Constraint错误。...
  • 第六章 PCB 的 DRC 检查、拼版设计及资料输出 6.1 DRC检查及丝印的调整 进入 PCB 文件(PcbDoc)。 DRC(Design Rule Check) 检测:通过 DRC 检测,检查是否达到设计时的各项指标; · 启动 DRC:菜单栏...
  • 快捷键T+D 进入设计规则检查 然后发现 un-routed net 没有勾选上,所以没法检查没有连接的线路这个错误,勾选以后就可以了。
  • 添加缝合孔:可以选择自己添加约束区域,设置参数选择网络。 设计规则检查:运行DRC
  • 由于这一章学习了覆铜,教程从覆...然后DRC检查 根据对应错误,在规则中找到对应项来修改部分规则 比如下图silk to solder mask ,在规则中找到该名称对应的项进行修改就可以了。 再比如,有的丝印挨太近会报错,但...
  • pcb布板结束后,一定要查找下unrouted net的类似对象,避免出现无网络孤立过孔,因为drc对无网络孤立过孔不报错误和警告
  • 最近在复习AD中画PCB板时的DRC规则,在这里做一个常用规则的简单总结。(虽然有时候可以无脑将除电气规则以外的其他规则全部取消勾选,但是这样并不好) 正文 Electrical Clearance Constraint 走线的线路间隔 ...
  • 第25课 Altium Designer20(AD20)+VESC6.4实战教程:DRC规则检查及解决方法(北冥有鱼)
  • DRC就是检查设计是否满足所设置的规则。需要检查什么,其实都是和规则相对应的,在检查某个选项时,请注意对应的规则是否使能打开。 (1)执行菜单命令“工具-设计规则检查(快捷键“TD”),如图11-1所示,打开如...
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    千次阅读 2018-07-07 11:41:50
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