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  • VHDL语言实现32位二进制BCD码

    千次阅读 2019-06-09 10:51:30
    使用FPGA开发板上的数码管显示...我用除取余的方法,用VHDL写了32位二进制BCD码代码。 LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; USE IEEE.STD_LOGIC_ARITH.ALL; ENTI...

    使用FPGA开发板上的数码管显示数值,需要将数值转换成对应的BCD码,再通过七段译码器将数值显示在数码管上。我用除十取余的方法,用VHDL写了32位二进制数转BCD码代码。

    LIBRARY IEEE;
    USE IEEE.STD_LOGIC_1164.ALL;
    USE IEEE.STD_LOGIC_UNSIGNED.ALL;
    USE IEEE.STD_LOGIC_ARITH.ALL;
    
    ENTITY BIN32_TO_BCD1 IS
    	PORT(
    		BIN: IN STD_LOGIC_VECTOR(31 DOWNTO 0);
    		BCD: OUT STD_LOGIC_VECTOR(39 DOWNTO 0)
    	);
    END ENTITY BIN32_TO_BCD1;
    
    ARCHITECTURE RTL OF BIN32_TO_BCD1 IS
    BEGIN
    	PROCESS(BIN)
    		VARIABLE TEMP: INTEGER;
    		VARIABLE BIN_TEMP: INTEGER;
    		VARIABLE BCD_TEMP: STD_LOGIC_VECTOR(39 DOWNTO 0);
    	BEGIN
    	        BCD_TEMP:=X"0000000000";
    	        BIN_TEMP:=CONV_INTEGER(BIN);
    		FOR K IN 0 TO 9 LOOP
    			TEMP:=BIN_TEMP REM 10;
    			BCD_TEMP(3+4*K DOWNTO K*4):=CONV_STD_LOGIC_VECTOR(TEMP,4);
    			BIN_TEMP:=(BIN_TEMP-TEMP)/10;
    			IF BIN_TEMP=0 THEN
    				EXIT;
    			END IF;
    		END LOOP;
    		BCD<=BCD_TEMP;
    	END PROCESS;
    END RTL;

    本来想用左移加3的算法,但没有成功。上面这个除十取余的方法是将STD_LOGIC_VECTOR转换成INTEGER,然后除十取余提出逐个十进制位。限于VHDL的INTEGER为有符号整型,以上代码其实只能实现31位无符号二进制转BCD码。

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  • 编码器 || 常用中规模集成电路 || MSI || 74148 || 74147 || 数电常用的中规模集成电路(MSI)如下:编码器译码器数据选择器加法器比较器1编码器概念将信息(如数和字符等)转换成符合一定规则的二进制代码。2二进制...

    编码器 || 常用中规模集成电路 || MSI || 74148 || 74147 || 数电

    常用的中规模集成电路(MSI)如下:

    • 编码器
    • 译码器
    • 数据选择器
    • 加法器
    • 比较器

    1编码器概念

    将信息(如数和字符等)转换成符合一定规则的二进制代码。

    2二进制编码器

    二进制编码器是用n位二进制代码对N=2^n个特定信息进行编码的逻辑电路。

    (从下面的例题来看,可以这样理解:二进制编码器就是把1个十进制数转换为1个二进制数)

    主要有

    • 输入互相排斥的编码器
    • 优先编码器

    其中优先编码器可以对输入信号按轻重缓急排序,当由多个信号输入时,只对优先权高的一个信号进行编码。

    23c8b43e1710e6e534fd362e0f503a2d.png

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    2a72c2eb67e1e667e7a6a8f3bf0eb4f0.png

    3编码器集成电路

    74148,8线-3线优先编码器

    15c5cad9d52bad80957d39a485009b7f.png

    1d6d4f7c38185155323e5308d435894b.png

    66c9c2da61f5f05b7834c4ccd6b898a5.png

    58232d6dbce8f2258edd286c630b845e.png

    c88a216e21dcb4dd5f879ca7b1c03f30.png

    3.1 74148的容量扩展(难点)

    说实话也没啥男的,拿纸拿笔把下图抄一遍就行了,亲测有效。

    不想抄?那就动脑子想想。

    2456f1f11f21b188d989d5cfa04cb9c8.png

    8781a9aeee535c9da23917682b7b76f8.png

    顺便问个问题,还能接着再扩展吗?咋扩展?评论区见?不许只动嘴,show me the circuit。

    可以只用3片74148,扩展成24线-4线优先编码器吗?

    可以用4片74148,扩展成32线-4线优先编码器吗?

    3.2 10线-4线优先编码器74147

    功能是把十进制代码转换为8421BCD码。

    f367c6527ffdd0fe374d89c20b9605a1.png

    6ec12417627047e393199e8a8ea7100d.png

    d8017bf6389f8668d9c5bbd6c034e46f.png

    丢题目,第三题我错于脑瘫。

    c5c1f448c9ab09f377fc47c3a72c39d2.png

    不用看视频。

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  • 一、译码器简介译码器(decoder)是一类多输入多输出组合逻辑电路器件,其可以分为:变量译码和显示...二、译码器的分类译码器的种类很多,但它们的工作原理和分析设计方法大同小异,其中二进制译码器、二-十进制译...

    一、译码器简介

    译码器(decoder)是一类多输入多输出组合逻辑电路器件,其可以分为:变量译码和显示译码两类。变量译码器一般是一种较少输入变为较多输出的器件,常见的有n线-2^n线译码和8421BCD码译码两类;显示译码器用来将二进制数转换成对应的七段码,一般其可分为驱动LED和驱动LCD两类。

    86e5d97cb4e90f0fea10f76fbd239278.png

    二、译码器的分类

    译码器的种类很多,但它们的工作原理和分析设计方法大同小异,其中二进制译码器、二-十进制译码器和显示译码器是三种最典型,使用十分广泛的译码电路。

    二进制码译码器,也称最小项译码器,N中取一译码器,最小项译码器一般是将二进制码译为十进制码;

    代码转换译码器,是从一种编码转换为另一种编码;

    显示译码器,一般是将一种编码译成十进制码或特定的编码,并通过显示器件将译码器的状态显示出来。

    8ef5b5195f32a93815bc5df052c9279a.png

    三、译码器作用

    译码器在数字系统中有广泛的用途,不仅用于代码的转换、终端的数字显示,还用于数据分配,存贮器寻址和组合控制信号等。不同的功能可选用不同种类的译码器。

    译码是编码的逆过程,在编码时,每一种二进制代码,都赋予了特定的含义,即都表示了一个确定的信号或者对象。把代码状态的特定含义“翻译”出来的过程叫做译码,实现译码操作的电路称为译码器。或者说,译码器是可以将输入二进制代码的状态翻译成输出信号,以表示其原来含义的电路。

    四、译码器的工作原理

    般我们指的译码器是从一种数据表示形式转换为另一数据表示形式的器件。而指令的解析未必就是你说到的译码器可以解决的,而是诸如乘法器、全加法器或者更为基本的触发器或逻辑电路直接构成,并不属于译码器的子集。

    建议你把基本概念弄清楚了再来表达你的准确想法,不然旁人很难帮上你的忙。

    对你补充的回答:根据前面对译码器的解释,指令译码器也是同样的道理,你可以把它理解为普通的地址译码器,比如3-8译码器(或8-256译码器),其实就是把3(或8)条数据线上表示的信息转换为8(或256)条数据线来表示的一种形式,(即译码),然后利用该信息表示的独立性和唯一性对功能电路作出恰当的选择(比如选择当前执行的指令的部件为加法处理单元)。在这个意义上来说它就是一个普通的地址译码器,用于选中哪个功能单元来处理当下的操作数。一条指令只需一个地址,而非你说的多少种译码器,一个8位指令译码器就可以支持256条指令,一个16位指令译码器可达到最多65536条指令。

    因此,你可以通过一个典型的3-8译码器来了解译码的基本原理,常见型号是74LS138.当然,实际的指令解码电路要复杂得多,而且是基于系统设计的,你只能从等效的角度来了解。由浅入深,慢慢来。通过对74LS138的了解,你会对译码器有初步的认识,也是最重要、最基础的认识。

    把所使用的每一种二进制代码状态都赋于特定的含义,表示一个特定的信号或对象,叫编码。如用四位二进制数的0000~1001这十种状太,分别表示0~9这十个十进制数码,称为8421编码。反过来把代码的特定含义翻译出来,称为译码。

    计算机在处理各种文字符号或数码时,必须把这些信息进行二进制编码,在编码时所使用的第一种二进制代码状态都赋予了特定的含义,即表示一个确定的信号或者对象,实现这种功能的电路叫编码器,如用于键盘的BCD码,ASCII码编码器等。

    单片机外围电路用译码器较多,所以在这节课我们主要与大家一起来学习下译码器的工作原理(购买了本站产品的朋友,在我们配套的多媒体教学光盘中有相关的教学内容,建议大家观看),把代码的含义‘翻译’成相应的输出信号,以表示其原意。其功能恰恰与编码器相反。

    译码器可以将输入代码的状态翻译成相应的输出信号,以高、低电平的形式在各自的输出端口送出,以表示其意愿。译码器有多个输入端和多个输出端。假如输入的端个数为,每个输出端只能有两个状态,则输出端个数最多有2n个。常用译码器输入、输出端头数来称呼译码器,如3线-8线译码器,4线-10线译码器等。我们经常用到的74138就是一个三线-八线译码器,朋友们可以到我们网站的《芯片资料》频道下载74138的中文资料。

    编码、译码的概念我们了解下,下面我们就来重点来讲一下三-八译码器的工作原理,这在我们51单片机的接口电路中也是经常用到的。

    74138的工作原理如下图所示:

    9855315ba98a6a96fa554a7458e0e08c.png

    从上图可看出,74138有三个输入端:A0、A1、A2和八个输出端Q0~Q7。当输入端A0、A1、A2的编码为000时,译码器输出为Q0=0,而Q1~Q7=1。即Q0对应于A0、A1、A2为000状态,低电平有效。

    五、译码器的逻辑功能

    (1)下图为74LS138的功能测试电路,改变输入端A、B、C的逻辑开关状态(000—111),用0—1(灯亮为1,灯灭为0)显示并记录输出结果,并把结果记入表中。

    469be886502a53998ff3a9ce8012b0d6.png
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    (2)译码器作脉冲分配器(数据分配器)。74LS138的“使能”控制端G1加高电平,1KHZ连续脉冲信号加到G2A、G2B其中一端(另一端接地),输入端CBA作为地址码输入,由地址码决定被选通道。依次改变CBA的逻辑开关状态(000—111),观察输出端的变化,并进行具体分析。

    如下图所示电路可以分析出G2A为数据输入端,从CBA为000—111时,Y0—Y7分别得到与输入相同的数波形。

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    (3)下图为译码器和门电路构成的组合电路,改变输入端CBA的逻辑开关状态(000—111),观察并记录输出端F1和F2的逻辑状态。列真值表,指出此电路能够完成的逻辑功能。

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    从真值表上来看它的功能是全加器。

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  • 4/7进制转换的课程设计 设计思想: 设计一个4/7进制计数器,用开关切换电路使用哪种进制。 a.当电路实现四进制计数器功能时:数码管...将可逆计数器输出的二进制码通过译码器转化为十进制码,再通过数码管显示出来。
  • 二进制译码器2.1 真值表和输出逻辑表达式2.2 逻辑电路的实现采用二极管与门阵列实现CMOS门实现2.3 拓展3. 二-进制译码器4. 用译码器设计组合逻辑电路4.1 实现特定的逻辑表达式4.1.1 逻辑函数转换4.1.2 得到电路图...

    1. 简介

    • 译码器是将每个输入的二进制代码译成对应的输出高、低电平信号,和编码器逆过程。
    • 常用的译码器分为二进制译码器、二-十进制译码器和显示译码器

    2. 二进制译码器

    • 二进制译码器:即将N位二进制代码译成2N2^{N}个高低电平信号,称为N线- 2N2^{N}线译码器。如N3N=3,则可译2N82^{N} =8个高低电平信号,称为3线-8线译码器
    • 图为3线-8线译码器的框图。其中:A2A0A_{2} ~A_{0}是二进制代码输入端;Y7Y0Y_{7} ~Y_{0} 为信号输出端
      在这里插入图片描述

    2.1 真值表和输出逻辑表达式

    • 真值表
      在这里插入图片描述

    • 逻辑表达式
      Y0=A2A1A0=m0Y_{0}=A_{2}'A_{1}'A_{0}'=m_{0}
      Y1=A2A1A0=m1Y_{1}=A_{2}'A_{1}'A_{0}=m_{1}
      Y2=A2A1A0=m2Y_{2}=A_{2}'A_{1}A_{0}'=m_{2}
      Y3=A2A1A0=m3Y_{3}=A_{2}'A_{1}A_{0}=m_{3}
      Y4=A2A1A0=m4Y_{4}=A_{2}A_{1}'A_{0}'=m_{4}
      Y5=A2A1A0=m5Y_{5}=A_{2}A_{1}'A_{0}=m_{5}
      Y6=A2A1A0=m6Y_{6}=A_{2}A_{1}A_{0}'=m_{6}
      Y7=A2A1A0=m7Y_{7}=A_{2}A_{1}A_{0}=m_{7}

    • 所以也称为最小项译码器(最小项:按照普通二进制进位写下去)

    2.2 逻辑电路的实现

    采用二极管与门阵列实现

    Vcc5VVcc=5V,输入信号的高低电平为3V3V0V0V,二极管导通压降为0.7V0.7V
    在这里插入图片描述

    • 分析:二极管的正极都通过电阻与VCCV_{CC}相连,只要有一个二极管导通,则与之相连的YY就输出低电平,只有三个同时截止时,YY才输出高电平,比如A2A1A0=010A_{2}A_{1}A_{0}=010时,Y2=1Y_{2}=1
    • 特点:
      (1)优点是电路比较简单。
      (2)缺点是电路的输入电阻低输出电阻高。
      (3)另外存在输出电平移动问题。(二极管有压降)
      (4)通常用在中大规模的集成电路中

    CMOS门实现

    74HC138

    在这里插入图片描述
    附加控制端:S 1 ,S 2 和S 3 ;
    输入端:A 0 ,A 1 和A 2 ;
    输出端低电平有效

    • 真值表
      在这里插入图片描述

    S=S3S2S1S = S_{3}S_{2}S_{1}

    • 当附加控制端S1=0S_{1} =0或者S2+S3=1S_{2}'+S_{3}’=1时,译码器被禁止工作,输出端状态全部为高电平
    • S11S2S30S_{1} =1,S_{2}' + S_{3}' =0时,译码器处于工作状态

    Yi=(Smi)Y_{i}'=(Sm_{i})'

    • 此译码器也是数据分配器,当S2S_{2} 'S3S_{3}'为0,数据1由S1S_{1}输入
    • 0输出位置由A2A1A0A_{2}A_{1}A_{0}来确定

    2.3 拓展

    试用两片3线-8线译码器74HC138组成4线-16线译码器,将输出的4位二进制代码D3D2D1D0D_{3} D_{ 2} D_{ 1} D_{ 0} 译成16个独立的低电平信号Z0Z15Z_{ 0}' ~ Z_{ 15}'
    解:需要4个输入地址线,故要除了74HC138的3个输入端外,还要利用附加控制端,根据74HC138功能表,利用附加控制输入端的特点(如下图),当S1=1S_{1}=1S2+S3=0S_{2}'+S_{3}’=0,由第一片输出,当S2+S3=1S_{2}'+S_{3}’=1第二片输出
    在这里插入图片描述
    最后电路如下图
    在这里插入图片描述

    3. 二-十进制译码器

    • 二-十进制译码器就是将10个BCD代码(8421)译成10个高低电平的输出信号

    • BCD 码 以 外 的 伪 码(1010~1111),输出均无低电平信号产生 74HC42即为二-十进制的译码器

    • 其内部逻辑图如图所示
      在这里插入图片描述

    • 其输出端逻辑式为YI=mi(i=0...9)Y_{I}'=m_{i}'(i=0...9)
      在这里插入图片描述

    4. 用译码器设计组合逻辑电路

    • 基本原理:由于译码器的输出为最小项取反,而逻辑函数可以写成最小项之和的形式,故可以利用附加的门电路和译码器实现逻辑函数

    4.1 实现特定的逻辑表达式

    利用74HC138设计一个多输出的组合逻辑电路,输出逻辑函数式为
    Z1=AC+ABC+ABCZ_{1} = AC'+A'BC+AB'C
    Z2=BC+ABCZ_{2}=BC+A'B'C
    Z3=AB+ABCZ_{3}=A'B+AB'C
    Z4=ABC+BC+ABCZ_{4}=A'BC'+B'C'+ABC

    4.1.1 逻辑函数转换

    • 化成最小项之和
      Z1=AC+ABC+ABCZ_{1} = AC'+A'BC+AB'C
      =A(B+B)C+ABC+ABC=A(B+B')C'+A'BC+AB'C
      =ABC+ABC+ABC+ABC=ABC'+AB'C'+A'BC+AB'C
      =m3+m4+m5+m6=m_{3}+m_{4}+m_{5}+m_{6}
      同样的道理,得到下面的式子:
      Z2=m1+m3+m7Z_{2}=m_{1}+m_{3}+m_{7}
      Z3=m2+m3+m5Z_{3}=m_{2}+m_{3}+m_{5}
      Z4=m0+m2+m4+m7Z_{4}=m_{0}+m_{2}+m_{4}+m_{7}

    • 化成最小项的取反
      利用反演定理:
      Z1=(m3m4m5m6)Z_{1} =(m_{3}'m_{4}'m_{5}'m_{6}')'
      Z2=(m1m3m7)Z_{2}=(m_{1}'m_{3}'m_{7}')'
      Z3=(m2m3m5)Z_{3}=(m_{2}'m_{3}'m_{5}')'
      Z4=(m0m2m4m7)Z_{4}=(m_{0}'m_{2}'m_{4}'m_{7}')'

    4.1.2 得到电路图

    在这里插入图片描述

    4.2 实现全减器

    试利用74HC138及与非门实现全减器,设A为被减数,B为减数,CIC_{I} 为低位的借位,D为差,COC_{O} 为向高位的借位

    • 写出真值表
      在这里插入图片描述
    • 写出逻辑表达式并化简
      D=(m1m2m4m7)D=(m_{1}m_{2}'m_{4}'m_{7})'
      C=(m1m2m3m7)C=(m_{1}m_{2}'m_{3}'m_{7})'
    • 电路图
      在这里插入图片描述

    5. 显示译码器

    显示译码器:七段字符显示器,即用七段字符显示0~9个十进制数码,常用的七段字符显示器有半导体数码管和液晶显示器两种

    5.1 半导体数码管(LED七段显示器)

    (1)半导体数码管每段都是一个发光二极管(LED),材料不同,LED发出光线的波长不同,其发光的颜色也不一样
    (2)半导体数码管分共阴极和共阳极两类,S201A属于共阴极类型,因为从内部电路上看,其各发光二极管的阴极是接在一起的。当外加高电平时,发光二极管亮,故高电平有效。而共阳极则阳极连在一起,故低电平有效。
    在这里插入图片描述
    在这里插入图片描述

    (3)导体数码管的优点是工作电压低,体积小、寿命长、可靠性高、响应时间短、亮度高等。缺点为工作电流大(10mA)

    5.2 液晶显示器(LCD显示器)

    (1)液晶是一种既有液体的流动性又具有光学特性的有机化合物。它的透明度和呈现的颜色是受外加电场的影响,利用这一点做成七段字符显示器
    (2)工作原理:七段液晶电极也排列成8字形,当没有外加电场时,由于液晶分子整齐地排列,呈透明状态,射入的光线大部分被返回,显示器呈白色;当有外加电场,并且选择不同的电极组合并加以电压,由于液晶分子的整齐排列被破坏,呈浑浊状态,射入的光线大部分被吸收,故呈暗灰色,可以显示出各种字符来
    (3)液晶显示器的最大优点是功耗极低,工作电压也低,但亮度很差,另外它的响应速度较低。一般应用在小型仪器仪表中
    【就是我们之前用的计算器,是利用入射光线,太暗看不到】

    5.3 BCD-七段译码器

    七段数码管需要驱动电路,使其点亮。驱动电路可以是TTL电路或者CMOS电路,其作用是将BCD代码转换成数码管所需要的驱动信号,共阳极数码管需要低电平驱动;共阴极数码管需要高电平驱动
    以共阴极为例子,需要高电平驱动:
    在这里插入图片描述
    在这里插入图片描述

    真值表

    在这里插入图片描述
    例如当要显示4(输入0100)时,需要电量bcfg四根二极管,所以对应的输出为高电平

    化简得逻辑表达式

    利用卡诺图圈零取反
    在这里插入图片描述
    得到逻辑表达式:
    在这里插入图片描述

    电路图

    按照逻辑添加一些控制输入端得到下面的电路:
    在这里插入图片描述

    • 灯测试输入端LT’:当LT’=0 时,Ya ~ Yg全部置为1,使得数码管显示“8”
    • 灭零输入RBI’:当A3A2A1A00000A_{ 3} A _{2} A_{ 1} A_{ 0} =0000时,若RBI’=0,Ya~Yg全部置为0,灭灯
    • 灭灯输入/灭零输出RI’/RBO’:当做为输入端时,若RI’/RBO’=0,无论输入A3A2A1A0A_{ 3} A _{2} A_{ 1} A_{ 0}为何种状态,数码管熄灭,称灭灯输入控制端; 当做为输出端时,
      只有当A3A2A1A00000A_{ 3} A _{2} A_{ 1} A_{ 0} =0000,且灭零输入信号RBI’=0时,RI’/RBO’=0,输入称灭零输出端:因此RI’/RBO’=0表示译码器将本来应该显示的零熄灭了

    【这一部分本人有点模糊,需要再修改】

    工作电路

    在这里插入图片描述

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  • BCD码转换

    2020-11-05 17:47:37
    进制转BCD的方法是通过左移,然后每四位判断是否大于4,满足则加3。 这里我们采用一种移位加3的算法来实现这个二进制到BCD转换的功能。(当然如果数据范围比较...//二进制数到BCD译码器模块 module BIN2BCD(CLK, EN
  • 1、计算机硬件 计算机硬件组成:控制、运算、存储器、输入设备和输出设备。 (1)运算(ALU):对数据进行算数运算和逻辑运算 (2)控制:分析和执行...2、十进制转二进制,除二取余后倒叙 3、原码、反...
  • 数据,地址,指令均由二进制代码表示,把程序和数据存入存储器,给出程序的第一条指令地址,控制从中按顺序不断读取指令,译码并执行直到全部操作完成。 进制转换 十进制转换为r进制 由于十进制可以表示成 ...
  • 计价.pdsprj

    2019-12-15 11:26:01
    2.74LS90: 是异步二—五—十进制加法计数器,它既可以作二进制加法计数器,又可以作五进制和十进制加法计数器。 通过不同的连接方式,74LS90可以实现四种不同的逻辑功能;而且还可借助R0(1)、R0(2)对计数器清零,...
  • 数字显示电压表将被测模拟量转换为...本系统是 位数字电压表, 位是指十进制数0000~1999。所谓3位是指个位、十位、百位,其数字范围均为0~9,而所谓半位是指千位数,它不能从0变化到9,而只能由0变到l,即值状态,
  • 74196 TTL 十进制/二-十进制可预置计数锁存 74197 TTL 二进制可预置锁存/计数器 7420 TTL 4输入端双与非门 7421 TTL 4输入端双与门 7422 TTL 开路输出4输入端双与非门 74221 TTL 双/单稳态多谐振荡 74240 TTL ...
  • 74ls45 bcd-十进制译码器/驱动器 74ls46 bcd-七段译码器/驱动器 74ls47 bcd-七段译码器/驱动器 74ls48 bcd-七段译码器/驱动器 74ls49 bcd-七段译码器/驱动器(oc) 74ls50 双路2-2输入与或非门(一门可扩展) 74...
  • 74系列IC带管脚图

    2009-07-26 12:25:41
    74196 TTL 十进制/二-十进制可预置计数锁存 74197 TTL 二进制可预置锁存/计数器 7420 TTL 4输入端双与非门 7421 TTL 4输入端双与门 7422 TTL 开路输出4输入端双与非门 74221 TTL 双/单稳态多谐振荡 74240 TTL ...
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  • ID卡数据格式

    千次阅读 2019-03-29 23:33:20
    由于各个厂家的读卡器译码格式不尽相同,在读卡输出时,读出的二进制或十六进制(Hex)结果应该是唯一的,但是又可以通过以下几种主要换算办法,输出不同结果的十进制卡号(Dec),因此,请您一定在购买卡片或卡片喷号时...
  • 2-44 -十进制译码器74LS42 2-45 七段显示译码器74LS48 2-46 双4选1数据选择器74LS153 2-47 采用CMOS传输门结构的数据选择器4539 2-48 8选1数据选择器74LS152 2-49 半加器 2-50 双全加器74LS183 2-51 4位...
  • 2. 有一数码10010011,作为自然二进制数时,它相当于十进制数 147 ,作为8421BCD码时,它相当于十进制数 93 。 3. 已知某函数,该函数的反函数= 4. 如果对键盘上108个符号进行二进制编码,则至少要 7 位二进制数码...
  • 数字逻辑实验指导书

    2018-11-27 21:45:47
    (六) 思考题:用可编程逻辑器件的开发工具MAX+plus II对ACEX编程,设计实现四位的二进制并行加法。 (七) 思考题:用可编程逻辑器件的开发工具MAX+plus II对ACEX编程,设计实现四位二进制减法。 实验五 编码...
  • 用到的器件74LS00(输入与非门)、74LS10(四输入与非门)、74LS47(七段译码器)、74LS90(-五-十进制计数器)、七段数码显示管 6.灯控电路的设计 用两个开关A和B控制四盏灯L1、L2、L3和L4。要求AB=00时灯全灭...
  • 2.2.1 译码器 2.2.2 多路开关(多路选择器) 2.2.3 加法器 2.2.4 带有快速进位生成的加法器 2.2.5 乘法器 2.3 组合电路的竞争与冒险 2.3.1 竞争与冒险的产生 2.3.2 竞争与冒险的识别 2.3.3 竞争与冒险的消除 习题 第三...
  • 2-44 -十进制译码器74LS42 2-45 七段显示译码器74LS48 2-46 双4选1数据选择器74LS153 2-47 采用CMOS传输门结构的数据选择器4539 2-48 8选1数据选择器74LS152 2-49 半加器 2-50 双全加器74LS183 2-51 4位超前进位...
  • 元件库(一)Proteus VSM 高级外设模型()Proteus VSM 元件库元件名称 中文名 说 明7407 驱动门1N914 二极管74Ls00 与非门74LS04 非门74LS08 与门74LS390 TTL 双十进制计数器7SEG 4 针BCD-LED 输出从0-9 对应于4 根线...
  • 综合实验1——编码器扩展实验、综合实验2——译码器扩展实验、综合实验3——有符号比较器实验、综合实验5————十进制码转换电路、综合实验6——利用状态机实现一个简单自动售货机控制电路、综合实验8——跑马灯...
  • 3.用3线-8线译码器(74LS138)和逻辑门设计实现函数F,仿真验证其功能,并下载到实验板测试。要求用拨码开关设定输入信号,发光二极管显示输出信号。 4.用VHDL语言设计实现一个3位二进制数值比较器,仿真验证其功能...
  • 异步二进制计数器.ms9 异步二-十进制计数器.ms9 异步二-十进制计数器.ms9 (Security copy) 微分积分电路.ms10 恒流源式差分放大电路.ms10 戴维南等效电路.ms9 批量复制文件名.bat 数据选择74LS153.ms9 数据选择...
  • │ │ 2-44 -十进制译码器74LS42.ms9 │ │ 2-45 七段显示译码器74LS48.ms9 │ │ 2-46 双4选1数据选择器74LS153.ms9 │ │ 2-47 采用CMOS传输门结构的数据选择器4539.ms9 │ │ 2-48 8选1数据选择器74LS152.ms9 ...
  • 171219 八位二进制转三位十进制.ms13 171230 序列脉冲控制电子锁.ms10 171230 序列脉冲控制电子锁.ms11 171231 出租车自动计费.ms10 171231 出租车计费.ms10 180101 出租车计费X【修正等候时间在★9分转换到...

空空如也

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十进制转二进制译码器