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凌力尔特推出符合 HDMI 要求的双向总线缓冲器 LTC4307-1
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LocalBUS总线读写寄存器的Verilog代码实现(二)-inout型双向总线Testbench的编写
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Testbench 注意事项
在本例中,testbench 的难点在于如何对双向信号进行仿真,通过查找资料,我找到用下方法来实现inout型信号的仿真。
reg [7:0]BMD$inout$reg; wire [7:0]BMD = BMD$inout$reg;
Teshbench 源码
写总线的时候通过
BMD$inout$reg = 8’ha5;
来赋值。
读总线的时候只需要给地址赋值即可。`timescale 1ns/1ns `define clock_period 20 module regs_tb; reg clk; reg rst_n; reg [7:0]BMA; reg nBOE; reg nBWE; reg nBCS1; reg [7:0]BMD$inout$reg = 8'b0000_0000; wire [7:0]BMD = BMD$inout$reg; wire HDDog_close; //8'h60, F500_180 ADDR[9:2] write 5a // wire SFTDog_close; //8'h71, F500_01C4 read close soft dog // wire SFTDog_open; //8'h71, F500_01C4 write a5 open soft dog wire SFTDog_en; wire SFTDog_clr; //8'h72, F500_01C8 write aa wire SFTDog_close_view; //8'h71, F500_01C4 read close soft dog wire SFTDog_open_view; //8'h71, F500_01C4 write a5 open soft dog assign SFTDog_close_view = regs0.SFTDog_close; assign SFTDog_open_view = regs0.SFTDog_open; regs regs0( .Clk(clk), .Rst_n(rst_n), .BMA(BMA), .BMD(BMD), .nBOE(nBOE), .nBWE(nBWE), .nBCS1(nBCS1), .HDDog_close(HDDog_close), .SFTDog_en(SFTDog_en), .SFTDog_clr(SFTDog_clr) ); initial clk = 1; always #(`clock_period/2) clk = ~clk; initial begin rst_n = 1'b0; #(`clock_period *100); rst_n = 1'b1; #(`clock_period *100); nBCS1 = 1; nBOE = 1; nBWE = 1; BMA = 8'hff; BMD$inout$reg = 8'hzz; #(`clock_period *100); //read BMA = 8'h61; nBCS1 = 0; #(`clock_period *2); nBOE = 0; nBWE = 1; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; #(`clock_period *10); //write BMA = 8'h61; BMD$inout$reg = 8'ha5; nBCS1 = 0; #(`clock_period *2); nBOE = 1; nBWE = 0; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; BMD$inout$reg = 8'hzz; #(`clock_period *10); //read BMA = 8'h61; nBCS1 = 0; #(`clock_period *2); nBOE = 0; nBWE = 1; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; #(`clock_period *10); //write HDDog_close BMA = 8'h60; BMD$inout$reg = 8'h5a; nBCS1 = 0; #(`clock_period *2); nBOE = 1; nBWE = 0; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; BMD$inout$reg = 8'hzz; #(`clock_period *10); //read SFTDog_close BMA = 8'h71; nBCS1 = 0; #(`clock_period *2); nBOE = 0; nBWE = 1; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; #(`clock_period *10); //write SFTDog_open BMA = 8'h71; BMD$inout$reg = 8'ha5; nBCS1 = 0; #(`clock_period *2); nBOE = 1; nBWE = 0; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; BMD$inout$reg = 8'hzz; #(`clock_period *30); //read SFTDog_close BMA = 8'h71; nBCS1 = 0; #(`clock_period *2); nBOE = 0; nBWE = 1; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; #(`clock_period *30); //write SFTDog_open BMA = 8'h71; BMD$inout$reg = 8'ha5; nBCS1 = 0; #(`clock_period *2); nBOE = 1; nBWE = 0; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; BMD$inout$reg = 8'hzz; #(`clock_period *30); //write SFTDog_clr BMA = 8'h72; BMD$inout$reg = 8'haa; nBCS1 = 0; #(`clock_period *2); nBOE = 1; nBWE = 0; #(`clock_period *3); nBOE = 1; nBWE = 1; #(`clock_period *2); nBCS1 = 1; BMA = 8'hff; BMD$inout$reg = 8'hzz; #(`clock_period *10); $stop; end endmodule
仿真波形
待测试寄存器上电默认值为0x3c,执行一次写操作(写入0xa5),再次读寄存器,返回值为0xa5。操作成功。
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I2C总线3.3V与5V双向电平转换电路
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电路功能:
实现I2C双向总线系统中3.3V与5V电平的双向转换,且不需要方向选择信号,而且还能将掉电的总线部分和剩下的总线系统隔离开来,保护低压器件防止高压器件的高电压毛刺。
整个电路工作过程:
从电路中可以看出,SDA和SCL的电平转换电路结构是一样的,每个总线上都串有一个分立的MOSFET,和相应的上拉电阻。
分析这个电路时要分清楚的电路的工作状态:
状态1:总线上没有数据传输时(空闲状态):
总线上没有数据传输时,I2C器件的SDA和SCL引脚保持高阻态,经上拉电阻R1和R2上拉到3.3V,也就是SDA和SCL在空闲状态都保持高电平。
这样Q1和Q2两个N-MOS的VGS都为0V,两个MOSFET(Q1,Q2)不能导通。那么高电压部分的I2C总线,通过上拉电阻R3和R4上拉到5V。这样MOSFET的两端总线空闲时都为高电平,满足I2C总线的电气特性。
状态2:3.3V的I2C器件下拉总线低电平:
此时,N-MOS管的S极变为低电平,而门极G保持为3.3V的高电平。Vgs高于阀值,N-MOS管开始导通。
然后高电压5V部分的总线线路通过导通的N-MOS管被低电压端的I2C器件下拉到低电平,此时两部分的总线线路都是低电平而且电压电平相同。符合I2C总线要求。
状态3:5V的I2C器件下拉总线线路到低电平
当有一个5V的器件下拉总线线路到低电平时,通过N-MOS管的体二极管作用,将N-MOS的S极拉低,使Vgs的电压高于导通阀值,N-MOS导通进一步的拉低S极电压,也就是将3.3V系统总线电平进一步下拉到低电平。此时两部分的总线线路都是低电平而且电压电平相同。从上面分析可以看出这三种状态显示了逻辑电平在总线系统的两个方向上传输,与驱动的部分无关。
上述的3个状态,第一个状态实现了电平转换功能。而第二个和第三个状态的逻辑都是线“与”的功能,只要有一端为低电平,也会使另外一端为低电平。注意:
可以看出本例中MOS管的GS间最大电压为3.3V,所以选择的MOS管的开启阀值电压要低于3.3V,否则不能使MOS管打开,电平转换就无法工作了。
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三态总线与双向三态总线
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module TRISTATE(E, A, Y);//三态总线 input E, A; output Y; assign Y = E?A:1'bz; endmodule
module TRISTATE(E, A, Y)//三态总线 input E, A; output reg Y; always @(E , A) begin if(E) Y = A; else Y = 1'bz; end endmodule
双向三态总线可以输入输出,输出带高阻
module BIDIR (E,A, Y, B);//双向总线buffer input E, A; inout Y; output B; tri Y; assign B = Y; assign Y = E?A:1'bz; endmodule
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首先我们分析一下为什么响应包是这样呢?这是因为服务器端对客户端的证书做了校验,我们的burpsuite是没有带客户端证书,所以服务器端验证没有通过,也就出现了这种状况。
这里我们得明白单向认证和双向认证是什么(想具体了解的可以百度一下)。
1、单向认证简单来说就是客户端对服务器端的证书的做了校验;
2、双向认证就是客户端对服务器端的证书做了验证,同时服务器端也对了客户端的证书做了校验;
单向认证绕过:
如果你发现请求的时候,连包都抓不到,这可能就是做了单向认证;
我们可以下一个Xposed,然后再安装一个JustTrueMe模块,JustTrueMe可以禁用ssl证书验证,启动一下就可以绕过客户端校验了(这里别在真实手机里装,可能会出问题的,最好在手机模拟机里弄)。
双向认证绕过:
如果你发现单向认证绕过之后,又出现刚开始我们说的那种状况。这个时候,我们要想的是什么,服务器端既然校验客户端证书,那我们就发给他一个呗,burpsuite也有这个功能,我们只要找到客户端的证书,安装到burpsuite里一切也就解决了。
那么现在的问题就是寻找客户端的证书呗。
客户端的证书肯定在apk中,我们解压一下apk,在assets目录下搜下.p12或者.pfx(这里还有个问题,如果app加壳怎么办,那技术好点,我们就脱壳呗,差点的话,我们就找它低版本的app,低版本的也许没加壳呢)。
这种证书安装的时候,会需要密码,所以我们还得反编译去找安装密码,这里就是最难的地方。
这里给大家举个例子(就用soul),没有反编译能力的我,也是看着别人文章一步步摸索的,希望大家看了有点用(懂反编译的老哥看个笑话就行)。
1、用jeb打开apk,右键解析一下
2、搜索我们前面找到的证书名字,它肯定是需要打开证书的(或者关键字PKCS12,这是通常读取证书需要用到的关键字)
3、右键解析
4、往下找到这些
5、追踪v1,v1也就是证书密码(双击v1就可以追踪)
6、追踪a
7、追踪getStorePassword
8、发现native,调用了一个别的接口文件,往上翻看调用的那个
9、soul-netsdk就是调用的libsoul-netsdk.so文件,我们在解压的apk中搜一下
10、用IDA打开这个文件
11、搜一下getStorePassword
12、双击,然后F5生成伪代码
13、到这我们也就找到安装证书的密码,然后把证书安装到burpsuite里就行了(密码如果错的话,是安装不成功的)
14、抓个包试一下,看是否成功
Perfect,成功!
感觉有点乱,争取下次会好点,最后用到的所有工具打包一下,有兴趣可以回复20200719获取,亲自做做还是可以学到点东西的。
声明:本文章仅为了技术交流,切勿进行非法破坏,否则后果自负!
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