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  • 7.3 过程赋值语句Verilog HDL 提供两种过程赋值语句 initial 和 always 语句,用这两种语句来实现行为的建模。这两种语句之间的执行是并行的,即语句的执行与位置顺序无关。这两种语句通常与语句块(begin ....end...
  • 一、变量的定义 mysql变量定义用declare来定义一局部变量,该变量的使用范围只能begin…end 块使用,变量必须定义复合语句的开头,并且是其它语句之前,也可以同时申明多个变量,如果需要,可以使用default...
  • SQL Server推荐使用 SET 而不是 SELECT 对变量进行赋值。当表达式返回一个值并对一个变量进行赋值时,推荐使用 SET 方法。下表列出 SET 与 SELECT 的区别。请特别注意红色部分。   set select 同时对多个变量...
  • 连续赋值过程赋值

    千次阅读 2019-09-08 17:50:08
    3)连续赋值语句不能出现在过程(initial/always); 4)连续赋值语句主要用来对组合逻辑进行建模以及线网数据间进行描述; 5)连续赋值语句产生作用后,赋值表达式信号的任何变化都将立即被反映到赋值线网型...

    连续赋值:
    1)语法上,有关键词“assign”来标识;
    2)左侧被赋值的数据类型必须是线网型数据(wire);
    3)连续赋值语句不能出现在过程快中(initial/always);
    4)连续赋值语句主要用来对组合逻辑进行建模以及线网数据间进行描述;
    5)连续赋值语句产生作用后,赋值表达式中信号的任何变化都将立即被反映到赋值线网型数据的取值上;
    过程赋值:
    1)语法上,没有关键词“assign”;
    2)左侧被赋值的数据类型必须是寄存器类型的变量(reg);
    3)过程性连续赋值语句只能出现在过程块中;
    4)过程性连续赋值语句主要用来对时序逻辑电路进行行为描述;
    5)在过程赋值语句的情况下,只有在过程赋值语句被执行时才执行赋值操作,语句执行完后被赋值变量的取值不再受到赋值表达式的影响;

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  • 串行语句,阻塞性赋值语句按照先后的顺序进行,并行语句,阻塞性赋值语句没有先后顺序,一同执行(即并行执行) ②阻塞性赋值语句的执行顺序是:先将等号右边的值赋给等号左边,与仿真的时间没有关系...

    1.阻塞性赋值语句

    阻塞性赋值语句操作符号为“=”
    语法格式为:变量=表达式;
    例如:b=a;
    阻塞性赋值语句特点如下:
    ①在串行语句块中,阻塞性赋值语句按照先后的顺序进行,在并行语句块中,阻塞性赋值语句没有先后顺序,一同执行(即并行执行)
    ②阻塞性赋值语句的执行顺序是:先将等号右边的值赋给等号左边,与仿真的时间没有关系。
    对于赋值的顺序举个例子:
    b=a;
    c=b;
    赋值的前后顺序就是:先将a的值赋给b,然后在将b的值赋给c。

    2.非阻塞性赋值语句

    非阻塞性赋值语句操作符号位:<=;
    语法格式为:变量<=表达式;
    例如:a<=b;
    非阻塞性赋值语句特点如下:
    ①在串行语句快中,非阻塞性赋值语句的赋值顺序并没有先后之分,即使某条语句排在另外一条语句的前边,这两条语句也是同时进行赋值操作。
    ②执行非阻塞性赋值语句的顺序是:先计算出等号左边语句的值,等到延迟时间结束之后,将等号左边的计算值赋给等号右边的变量。

    3.阻塞性与非阻塞性赋值语句的区别

    举一个具体的例子来说明:
    1.阻塞性赋值语句程序:
    module block (din,clk,out1,out2);
    input din,clk;
    output out1,out2;
    reg out1,out2;
    always@(posedge clk)
    begin
    out1=din;
    out2=out1;
    end
    endmodule
    由于用的是阻塞性赋值语句,因此这段程序表达的意思为:当时钟信号上升沿到来的时候,语句就已经开始执行,直白一点的说就是,当out1把值赋给out2时候,din已经完成了对out1的赋值操作。因此形成的电路形式就是:用一个上升沿触发的D触发器先来寄存din赋给out1的值,然后out1在传给out2.
    此段程序对应的电路图如下:

    在这里插入图片描述

    可以对阻塞性赋值语句做如下总结:
    ①赋值语句在执行完成之后,整个语句块才结束。
    ②被赋值的变量在完成此条语句之后值就立刻发生变化。
    ③拿捏不准,可能会出现不可预测的结果,在进行综合的时候并不常用
    2.非阻塞性赋值语句程序:
    module non_block1(din,clk,out1,out2);
    input din,clk;
    output out1,out2;
    reg out1,out2;
    always@(posedge clk);
    begin
    out1<=din;
    out2<=out1;
    end
    endmodule
    由于是非阻塞性赋值语句,此段程序表达的意思为:当时钟上升沿信号到达时,两条赋值语句同时进行赋值操作,等语句块结束之后,两条赋值语句同时完成赋值操作。在语句块没结束时,等号左边的变量依然是赋值之前的值。此段程序对应的电路如下:

    在这里插入图片描述
    注:就上图而言,非阻塞性赋值语句的不同体现在,在语句块没有执行完的时候,out1的值还是上一个din的值,out2的值也同样为上一个out1的值,在语句块执行结束后才out1与out2才获得新的值。
    对非阻塞性赋值语句有如下总结:
    ①语句块运行结束后语句块内的赋值语句才完成赋值操作;
    ②等号左边变量的值并不是马上就改变的,而是等到语句块结束之后才变化;
    ③非阻塞性赋值方法在编写模块综合的时候非常常用。

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  • 过程赋值语句的基本形式: 寄存器变量 = 表达式 考虑赋值过程的定时控制时,根据定时控制在过程赋值语句中的不同位置,存在两类

    过程赋值语句的基本形式:
    寄存器变量 = 表达式
    考虑赋值过程的定时控制时,根据定时控制在过程赋值语句中的不同位置,存在两类定时模式:
    (一)外部定时模式
    表达式:
    <定时控制><寄存器变量>=<表达式>
    该延时的模型:经“定时控制”所确定的延时后,计算出右端表达式的值,把结果赋值给左端的“寄存器变量”。其中的“定时控制”分为两种类型:延时控制和事件控制。
    1 延时控制就是直接给出所需延时的时间,如:#delay a=b;
    这条语句表面,经过delay确定的延时时间后,过程赋值语句右端表达式才被求值并被赋给左端的寄存器变量。
    2 事件控制
    事件控制以符号“@”开头,后面紧跟的是事件控制敏感表,有以下几种形式:
    (1)@(信号名)
    信号名所指定的信号通常是一位标量,也可以是多位的矢量。该形式的含义:只要被检验的信号发生变化(一般是值上升沿或下降沿)时,后面的赋值语句就被执行。如:
    @(clock) reg_a = reg_b;
    当clock发生跳变(上升沿或下降沿),reg_b的值就赋给reg_a。
    (2)@(posedge 信号名)
    信号发生上升沿跳变,如:@(posedge clock) reg_a = reg_b;
    只要检测到clock信号出现上升沿,reg_b的值就赋给reg_a。
    (3)@(negedge 信号名)
    信号发生下降沿跳变,如:@(negedge clock) reg_a = reg_b;
    只要检测到clock信号的下降沿,reg_b的值就赋给reg_a。
    (4)@(事件1 or 事件2 or 事件3…)
    表达式中的事件是指上面1、2、3三类事件中的任何一种事件,or表示逻辑或的意思,即只要所列举的任何一种情况出现,都将激活这里的事件控制。
    注意:Verilog只提供“或”方式来处理多重触发情况,没有再定义诸如“与”等其他方式。
    (二)内部定时模式
    <寄存器变量> = <定时控制> <表达式>;
    在内部模式中,有关“定时控制”的表现形式与上面对外部模式中的说明完全一致。两者之间的差别在于,在外部模式中,定时控制位于过程赋值语句之前,直接体现为对过程赋值语句执行事件的延期上,只有当延时事件被满足,或其他类型的激发条件被满足后,过程赋值语句才能被计算和赋值。
    在内部模式中,定时控制位于赋值语句内部,与外部模式相同的是,两者都是在延时时间到期后再执行过程赋值操作,不同的是右端表达式的求值过程是在不同的事件段进行的。在外部模式中,直到延时到后,再对表达式求值,并执行赋值过程。而在内部模式中,先完成对表达式的求值,待延时到后,条件满足时,再把前面求得结果赋给左边的寄存器变量。
    下表说明了两者之间的关系:**
    在这里插入图片描述

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  • 最基本的语句——赋值语句

    万次阅读 多人点赞 2019-06-27 14:46:47
    C程序最常用的语句是:赋值语句和输入输出语句。 一、赋值运算符 赋值符号=就是赋值运算符,它的作用是将一个数据赋给一个变量。执行过程称为:赋值操作或赋值运算。 将一个常量赋给一个变量 例如:int a = ...

    最基本的语句——赋值语句

    【知识点】

    1. 赋值运算符;
    2. 复合的赋值运算符;
    3. 赋值表达式;
    4. *赋值过程中的类型转换;
    5. 赋值表达式和赋值语句;
    6. 变量赋初值;

    【内容】

    在C程序中最常用的语句是:赋值语句和输入输出语句。

    一、赋值运算符

    赋值符号=就是赋值运算符,它的作用是将一个数据赋给一个变量。执行过程称为:赋值操作或赋值运算。

    1. 将一个常量赋给一个变量
      1. 例如:int a = 23;//将常量23赋给变量a
    2. 将一个表达式的值赋给一个变量

    二、复合的赋值运算符

    在赋值符=前加上其他运算符,可以构成复合的运算符。有以下复合运算符:

    • +=
    • -=
    • *=
    • /=
    • %=

    a += b;// a = a + b;

    注意:若b是包含若干项的表达式,则相当于它有括号。(推荐:在b包含若干项表达式时,使用括号将b括起来)例如:

    三、赋值表达式

    定义:由赋值运算符将一个变量和一个表达式连接起来的式子称为“赋值表达式”。

    形式:变量 赋值运算符(=) 表达式

    作用:将一个表达式的值赋给一个变量。(计算、赋值功能)

    概念:左值(left value,lvalue)、右值(right value,rvalue)

    左值:

    1. 出现在赋值运算符的左侧;
    2. 其值可以改变;

    注意:变量可以作为左值,算术表达式a+b不能作为左值,常量的值不能改变也不能作为左值。

    右值:出现在赋值运算符的右侧。左值也可以出现在赋值运算符右侧,因此左值也可以作为右值。

    *四、赋值过程中的类型转换

    如果赋值运算符两侧的类型一致,则直接进行赋值。

    如果赋值运算符两侧的类型不一致,但都是算术类型时,在赋值时要进行类型转换。类型转换是由系统自动进行的,转换的规则是:

    1. 将浮点型数据(包括单、双精度)赋给整型变量时,先对浮点数取整,即舍弃小数部分,然后赋予整型变量。
    2. 将整型数据赋给单、双精度变量时,数值不变,但以浮点数形式存储到变量中。
    3. 将一个double型数据赋给float变量时,先将双精度数转换为单精度,即只取6-7位有效数字,存储到float变量的4个字节中。注意:双精度数值的大小不能超出float型变量的数值范围。
    4. 将一个float型数据赋给double变量时,数值不变,在内存中以8个字节存储,有效位数扩展到15位。
    5. 字符型数据赋给整型变量时,将字符的ASCII码值赋给整型变量。
    6. *将一个占字节多的整型数据赋给一个占字节少的整型变量或字符变量时,只将其低字节原封不动地送到被赋值的变量。例如:

    本质:

    1. 整型数据之间的赋值,是按存储单元中的存储形式直接传送。
    2. 实型数据之间以及整型与实型之间的赋值,是先转换(类型)后赋值。

    总结:

    1. 赋值运算符两侧类型不一致,系统先转换后赋值;
    2. 算术运算符两侧类型不一致,系统先转换后运算;

    五、赋值表达式和赋值语句

    六、变量赋初值

    注意:如果对几个变量赋予同一个初值,应写成:

    int a = 3, b = 3, c = 3;

    不能写成:

    int a = b = c = 3;

    一般变量初始化不是在编译阶段完成的(只有在静态存储变量和外部变量的初始化是在编译阶段完成的),而是在程序运行时执行本函数时赋予初值的,相当于执行一个赋值语句。

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    万次阅读 2017-12-31 18:01:38
    几种不同的赋值语句之间的差异与使用规范
  • if语句里面如果是赋值语句

    万次阅读 多人点赞 2018-10-09 21:39:23
    我们习惯了向if里面传递布尔值,如果为true就进入if语句;或者传入一个判断语句(表达式a==表达式b);或者传入数值,0为false,其他都为true。等等 初学者很容易传入判断语句的时候将==写成=,而导致代码失误...
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    千次阅读 2019-08-24 19:46:14
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  • Verilog 的几种赋值语句

    千次阅读 2020-05-05 14:26:33
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    千次阅读 2018-06-24 10:56:05
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    千次阅读 2019-10-16 12:14:01
    今天学习了C程序赋值语句,...if语句中的a=b不是赋值语句,而是赋值表达式。值得注意的是赋值表达式的末尾没有分号,而赋值语句的末尾必须有分号。一个表达式可以包含一个或多个赋值表达式,但绝不能包...
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  • 摘自关于Verilog的几种赋值语句 1. 连续赋值语句(Continuous Assignments) 连续赋值语句是Verilog数据流建模的基本语句,用于对线网进行赋值,等价于门级描述,是从更高的抽象角度来对电路进行描述。连续赋值...
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空空如也

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在过程语句赋值方式中