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  • 数值比较器

    2020-04-05 22:42:11
    【 1. 一位数值比较器】 【 2. 多位数值比较器 】 原理: 必须自高而低地逐位比较,而且只有在高位相等时,才需要比较低位。 四位数值比较器 74HC85 ...

    【 1. 一位数值比较器】

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    【 2. 多位数值比较器 】

    • 原理:
      必须自高而低地逐位比较,而且只有在高位相等时,才需要比较低位。
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    • 四位数值比较器 74HC85
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  • 数值比较器实验

    2020-12-09 14:56:37
    实验原理 数值比较器的用途是比较两个二进制数的大小 对于两个一位二进制数A和B比较,可用表7-1所列真值表来描述。 表7-1 比较器真值表 输入 输出 A (甲数) B (乙数) L (大于) E (等于) S (小于) 0 0 1 1 0 1 0 1 0...
  • Verilog HDL 之 多位数值比较器 原理  在数值系统中,特别是在计算机中都具有运算功能,种简单的运算就是比较它们的大小。数值比较器就是对两数A、B进行比较,以判断其大小的逻辑电路。  表1.1 多位...

    Verilog HDL 之 多位数值比较器

    一、原理

      在数值系统中,特别是在计算机中都具有运算功能,一种简单的运算就是比较它们的大小。数值比较器就是对两数A、B进行比较,以判断其大小的逻辑电路。

                      表1.1 多位比较器真值表

    二、实现

    在设计文件中输入Verilog代码

    复制代码
     1   `timescale 1 ns / 1 ps
     2 
     3 module compare3 ( Y ,A ,B );
     4 
     5 input [3:0] A ;
     6 wire [3:0] A ;
     7 input [3:0] B ;
     8 wire [3:0] B ;
     9 
    10 output [2:0] Y ;
    11 reg [2:0] Y ;
    12 
    13 always @ ( A or B )
    14     begin 
    15         if ( A > B ) 
    16             Y <= 3'b001;
    17         else if ( A == B)
    18             Y <= 3'b010;
    19         else 
    20             Y <= 3'b100;
    21       end
    22 endmodule
    复制代码
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  • Verilog HDL 之 多位数值比较器 原理  在数值系统中,特别是在计算机中都具有运算功能,种简单的运算就是比较它们的大小。数值比较器就是对两数A、B进行比较,以判断其大小的逻辑电路。  表1.1 多位...

    【连载】 FPGA Verilog HDL 系列实例  

    Verilog HDL 之 多位数值比较器

     一、原理

      在数值系统中,特别是在计算机中都具有运算功能,一种简单的运算就是比较它们的大小。数值比较器就是对两数A、B进行比较,以判断其大小的逻辑电路。

                      表1.1 多位比较器真值表

    二、实现

    在设计文件中输入Verilog代码

     1   `timescale 1 ns / 1 ps
    2
    3 module compare3 ( Y ,A ,B );
    4
    5 input [3:0] A ;
    6 wire [3:0] A ;
    7 input [3:0] B ;
    8 wire [3:0] B ;
    9
    10 output [2:0] Y ;
    11 reg [2:0] Y ;
    12
    13 always @ ( A or B )
    14 begin
    15 if ( A > B )
    16 Y <= 3'b001;
    17 else if ( A == B)
    18 Y <= 3'b010;
    19 else
    20 Y <= 3'b100;
    21 end
    22 endmodule

     

     

    转载于:https://www.cnblogs.com/kongtiao/archive/2011/08/27/2151636.html

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  • 数值比较器是什么东西想必不用赘述了,4位数值比较器的原理图如下: 相信没有人会想直接在quatrus里面照着这个玩意画电路图吧?没关系,让我们用一点更简单的方法。 首先我们需要了解quatrus的个功能:为...

            学校数电实验要求用quatrus做这个玩意,百度了一圈找不到,最后还是翻了会书给自己做出来了。

            数值比较器是什么东西想必不用赘述了,4位数值比较器的原理图如下:

    (图片来自百度百科)

            相信没有人会想直接在quatrus里面照着这个玩意画电路图吧?没关系,让我们用一点更简单的方法。

            首先我们需要了解quatrus的一个功能:为当前文件创建符号文件(Create Symbol Files for Current File)

    创建符号文件

            这能够将你当前打开(不需要设置为顶层实体之类的,鼠标点一下就行)的bdf文件生成为一个新的组件。创建完成后,在bdf文件中添加组件时就可以看到这个组件了(左上角的Libraries选框中找到Project)

    选择组件

            顺带一提,生成的组件对应的输入输出端就是之前用于生成这个组件的bdf文件的输入和输出,请保证每个输入端都接上一个input,不需要的输出端可以直接删除。此外,生成的组件中,输入输出端的显示顺序和之前bdf文件中输入输出端的顺序相同。

            有了这种操作,我们就可以很方便地把位数较少的器件级联成位数较多的器件了。

            让我们看看二位数值比较器的逻辑电路图:(输入输出看不清的看上一张图就行了)

    二位比较器bdf

            原理百度百科都有,这里就不讲了。其中,数字A1A0和B1B0将进行比较,A1、B1为高位。En为控制信号端,En为高电平时电路正常工作,En为低电平时输出全部为低电平。aSmaller为1时代表 A1A0 比 B1B0 小,其他两个输出端同理。

            将这个bdf文件生成为符号文件后,我们就得到了一个2位比较器。

            按照如图所示的方法将即可这个二位比较器级联为四位比较器:

    4位

            此后如果有需求的话还可以把这个bdf文件再生成一个新的组件。

            其他版本的quatrus操作大同小异,用9.0版本是学校要求(

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