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  • 2021-07-26 08:32:32

    大家好,我是时间财富网智能客服时间君,上述问题将由我为大家进行解答。

    计算机关闭后存储的数据不会丢失的内存储器是只读存储器(ROM),因为它是固化在芯片内部的。

    内存(Memory)是计算机中重要的部件之一,由内存芯片、电路板、金手指等部分组成,它是与CPU进行沟通的桥梁。内存也被称为内存储器,其作用是用于暂时存放CPU中的运算数据,以及与硬盘等外部存储器交换的数据。计算机中所有程序的运行都是在内存中进行的,内存的运行决定了计算机的稳定运行,因此内存的性能对计算机的影响非常大。在计算机的组成结构中,有一个很重要的部分,就是存储器。存储器是用来存储程序和数据的部件,对于计算机来说,有了存储器,才有记忆功能,才能保证正常工作。存储器的种类很多,按其用途可分为主存储器和辅助存储器,主存储器又称内存储器(简称内存,港台称之为记忆体)。内存又称主存,是CPU能直接寻址的存储空间,由半导体器件制成。内存的特点是存取速率快。内存是电脑中的主要部件,它是相对于外存而言的。我们平常使用的程序,如Windows操作系统、打字软件、游戏软件等,一般都是安装在硬盘等外存上的,但仅此是不能使用其功能的,必须把它们调入内存中运行,才能真正使用其功能,我们平时输入一段文字,或玩一个游戏,其实都是在内存中进行的。

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    存储器按存储介质特性来说,可以分为两类,一类就是易失性存储器,一类是非易失性存储器。从计算机角度上看,易失性存储器可以理解为内存,而非易性存储器可以理解为硬盘。 易失性存储器的特点:掉电丢失数据,但...

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    常用存储器,你知道有哪些吗?

    存储器按存储介质特性来说,可以分为两类,一类就是易失性存储器,一类是非易失性存储器。从计算机角度上看,易失性存储器可以理解为内存,而非易性存储器可以理解为硬盘。
    在这里插入图片描述

    易失性存储器的特点:掉电丢失数据,但存取数据速度很快。
    而非易性存储器最大的特性:掉电不丢失数据,可用于长期存储数据。

    易失性存储器

    易失性存储器的代表就是RAM(Random Access Memory),即随机存储器。RAM通常作为操作系统或者系统正在运行中的程序的临时数据存储介质。按照存储结构,RAM又分为两种,一种为DRAM(Dynamic RAM)即动态随机存储器,另一种为SRAM(Static RAM)即静态随机存储器。

    SRAM

    SRAM存储单元以锁存器来存储数据,不用周期性刷新,速率很快,但成本比较高。在正点原子的战舰开发板中就有一个SRAM芯片(XM8A51216),容量为8Mb,庐山真面目如下:

    DRAM

    DRAM存储单元以电容的电荷来表示数据,电容存在充放电现象,所以需要规律性定时刷新。而DRAM又可以分为SDRAM、DDR SDRAM、DDRII SDRAM、DDRIII SDRAM和DDRIV SRAM。
    SDRAM(SynchronousDRAM)同步动态随机存储器,即数据的读写需要时钟来同步,这里只用到时钟的一个边沿。SDRAM相比SRAM来说,容量更大,但是读写速度不如SRAM。在正点原子的阿波罗F429开发板中就有一个SDRAM芯片,容量为32MB,庐山真面目如下:
    在这里插入图片描述

    DDR SRAM相比SDRAM,速度上更快,时钟的双边沿都用来表示数据。而DDRII SRAM、DDRIII SRAM和DDRIV SRAM则在时钟频率上进行提升。现在电脑内存条普遍是DDR3或DDR4了。

    非易失性存储器

    非易失性存储器种类比较多,分别是ROM、FLASH以及外部大容量存储器。

    ROM

    ROM(Read Only Memory)只读存储器,又分为MASKROM(掩模ROM)、OTPROM(一次可编程ROM)、EPROM(电可擦写ROM)和EEPROM(电可擦写可编程ROM)。
    MASKROM:真正意义上的只读存储器,一次性由厂家用特殊工艺固化,用户无法修改。
    OTPROM:由用户用专门设备来一次性写入数据,只能写入一次。
    EPROM:可重复擦写,解决只能一次写入的问题,但需要用专门的设备去操作,已被EEPROM取代。
    EEPROM:可实现重复擦写,直接用电路控制,不需要专门的设备来进行擦写。且操作单位为字节,并不需要操作整个芯片。EEPROM现在已是主流。正点原子所有开发板都有使用到EEPROM,用来存储一些配置信息。

    FLASH

    FLASH跟ROM相比,容量更大,但是操作的单位为多字节并不是一个字节。FLASH分为NOR FLASH和NAND FLASH,这两者在嵌入式开发中都是很常用的存储器。
    NOR FLASH得益于地址线和数据线分开,可以以“字节”读写数据,所以允许程序直接在上面运行。在正点原子的北极星板子上,就是用NOR FLASH存储核心代码。

    NAND FLASH对比NOR FLASH在成本上有很大的优势,但是存在坏块问题(NAND通常是以块为单位进行擦除,块内有一位失效整个块就会失效)。

    外部大容量存储器

    外部大容量存储器就有磁盘存储器(硬盘和软盘)、光盘存储器和SD卡。
    磁盘存储器,容量大,使用寿命长但价格贵,主要是用在个人PC中,较少用在嵌入式开发中。
    光盘存储器:用光学方式读取/写入信息的圆盘,一般用于多媒体信息载体,较少出现在嵌入式领域中。
    SD卡:体积小,安全性也高。简单设计一下外围电路即可支持嵌入式开发,是常见的外部存储器。

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  • CPU缓存是位于CPU与内存之间的临时数据交换器,它的容量比内存小的多但是交换速度却比内存要快得多。CPU缓存一般直接跟CPU芯片集成或位于主板总线互连的独立芯片上 。 为了简化与内存之间的通信,高速缓存控制器是...

    一、什么是CPU缓存

    1. CPU缓存的来历

    众所周知,CPU是计算机的大脑,它负责执行程序的指令,而内存负责存数据, 包括程序自身的数据。在很多年前,CPU的频率与内存总线的频率在同一层面上。内存的访问速度仅比寄存器慢一些。但是,这一局面在上世纪90年代被打破了。CPU的频率大大提升,但内存总线的频率与内存芯片的性能却没有得到成比例的提升。并不是因为造不出更快的内存,只是因为太贵了。内存如果要达到目前CPU那样的速度,那么它的造价恐怕要贵上好几个数量级。所以,CPU的运算速度要比内存读写速度快很多,这样会使CPU花费很长的时间等待数据的到来或把数据写入到内存中。所以,为了解决CPU运算速度与内存读写速度不匹配的矛盾,就出现了CPU缓存。

    2. CPU缓存的概念

    CPU缓存是位于CPU与内存之间的临时数据交换器,它的容量比内存小的多但是交换速度却比内存要快得多。CPU缓存一般直接跟CPU芯片集成或位于主板总线互连的独立芯片上

    为了简化与内存之间的通信,高速缓存控制器是针对数据块,而不是字节进行操作的。高速缓存其实就是一组称之为缓存行(Cache Line)的固定大小的数据块组成的,典型的一行是64字节。

    3. CPU缓存的意义

    CPU往往需要重复处理相同的数据、重复执行相同的指令,如果这部分数据、指令CPU能在CPU缓存中找到,CPU就不需要从内存或硬盘中再读取数据、指令,从而减少了整机的响应时间。所以,缓存的意义满足以下两种局部性原理

    • 时间局部性(Temporal Locality):如果一个信息项正在被访问,那么在近期它很可能还会被再次访问。
    • 空间局部性(Spatial Locality):如果一个存储器的位置被引用,那么将来他附近的位置也会被引用。

    二、CPU的三级缓存

    1. CPU的三级缓存

    随着多核CPU的发展,CPU缓存通常分成了三个级别:L1L2L3。级别越小越接近CPU,所以速度也更快,同时也代表着容量越小。L1 是最接近CPU的, 它容量最小(例如:32K),速度最快,每个核上都有一个 L1 缓存,L1 缓存每个核上其实有两个 L1 缓存, 一个用于存数据的 L1d Cache(Data Cache),一个用于存指令的 L1i Cache(Instruction Cache)。L2 缓存 更大一些(例如:256K),速度要慢一些, 一般情况下每个核上都有一个独立的L2 缓存; L3 缓存是三级缓存中最大的一级(例如3MB),同时也是最慢的一级, 在同一个CPU插槽之间的核共享一个 L3 缓存。

    下面是三级缓存的处理速度参考表:

    从CPU到大约需要的CPU周期大约需要的时间(单位ns)
    寄存器1 cycle 
    L1 Cache~3-4 cycles~0.5-1 ns
    L2 Cache~10-20 cycles~3-7 ns
    L3 Cache~40-45 cycles~15 ns
    跨槽传输 ~20 ns
    内存~120-240 cycles~60-120ns

    下图是Intel Core i5-4285U的CPU三级缓存示意图:

     

    CPU三级缓存
    CPU三级缓存

     

    就像数据库缓存一样,获取数据时首先会在最快的缓存中找数据,如果缓存没有命中(Cache miss) 则往下一级找, 直到三级缓存都找不到时,那只有向内存要数据了。一次次地未命中,代表取数据消耗的时间越长。

    2. 带有高速缓存CPU执行计算的流程

    1. 程序以及数据被加载到主内存
    2. 指令和数据被加载到CPU的高速缓存
    3. CPU执行指令,把结果写到高速缓存
    4. 高速缓存中的数据写回主内存

    目前流行的多级缓存结构如下图:

     

    多级缓存结构
    多级缓存结构

     

    三、CPU缓存一致性协议(MESI)

    MESIModified Exclusive Shared Or Invalid)(也称为伊利诺斯协议,是因为该协议由伊利诺斯州立大学提出的)是一种广泛使用的支持写回策略的缓存一致性协议。为了保证多个CPU缓存中共享数据的一致性,定义了缓存行(Cache Line)的四种状态,而CPU对缓存行的四种操作可能会产生不一致的状态,因此缓存控制器监听到本地操作和远程操作的时候,需要对地址一致的缓存行的状态进行一致性修改,从而保证数据在多个缓存之间保持一致性。

    1. MESI协议中的状态

    CPU中每个缓存行(Caceh line)使用4种状态进行标记,使用2bit来表示:

    状态描述监听任务状态转换
    M 修改 (Modified)该Cache line有效,数据被修改了,和内存中的数据不一致,数据只存在于本Cache中。缓存行必须时刻监听所有试图读该缓存行相对就主存的操作,这种操作必须在缓存将该缓存行写回主存并将状态变成S(共享)状态之前被延迟执行。当被写回主存之后,该缓存行的状态会变成独享(exclusive)状态。
    E 独享、互斥 (Exclusive)该Cache line有效,数据和内存中的数据一致,数据只存在于本Cache中。缓存行也必须监听其它缓存读主存中该缓存行的操作,一旦有这种操作,该缓存行需要变成S(共享)状态。当CPU修改该缓存行中内容时,该状态可以变成Modified状态
    S 共享 (Shared)该Cache line有效,数据和内存中的数据一致,数据存在于很多Cache中。缓存行也必须监听其它缓存使该缓存行无效或者独享该缓存行的请求,并将该缓存行变成无效(Invalid)。当有一个CPU修改该缓存行时,其它CPU中该缓存行可以被作废(变成无效状态 Invalid)。
    I 无效 (Invalid)该Cache line无效。

    注意
    对于M和E状态而言总是精确的,他们在和该缓存行的真正状态是一致的,而S状态可能是非一致的。如果一个缓存将处于S状态的缓存行作废了,而另一个缓存实际上可能已经独享了该缓存行,但是该缓存却不会将该缓存行升迁为E状态,这是因为其它缓存不会广播他们作废掉该缓存行的通知,同样由于缓存并没有保存该缓存行的copy的数量,因此(即使有这种通知)也没有办法确定自己是否已经独享了该缓存行。

    从上面的意义看来E状态是一种投机性的优化:如果一个CPU想修改一个处于S状态的缓存行,总线事务需要将所有该缓存行的copy变成invalid状态,而修改E状态的缓存不需要使用总线事务。

    MESI状态转换图:

     

    MESI状态转换图
    MESI状态转换图

     

    下图表示了当一个缓存行(Cache line)的调整的状态的时候,另外一个缓存行(Cache line)需要调整的状态。

    状态MESI
    M×××
    E×××
    S××
    I

    举个示例:

    假设cache 1 中有一个变量x = 0的 Cache line 处于S状态(共享)。
    那么其他拥有x变量的 cache 2、cache 3 等x的 Cache line调整为S状态(共享)或者调整为I状态(无效)。

    2. 多核缓存协同操作

    (1) 内存变量

    假设有三个CPU A、B、C,对应三个缓存分别是cache a、b、c。在主内存中定义了x的引用值为0。

     

    内存变量
    内存变量

     

    (2) 单核读取

    执行流程是:

    • CPU A发出了一条指令,从主内存中读取x
    • 从主内存通过 bus 读取到 CPU A 的缓存中(远端读取 Remote read),这时该 Cache line 修改为 E 状态(独享)。

     

    单核读取
    单核读取

     

    (3) 双核读取

    执行流程是:

    • CPU A发出了一条指令,从主内存中读取x
    • CPU A从主内存通过bus读取到 cache a 中并将该 Cache line 设置为E状态。
    • CPU B发出了一条指令,从主内存中读取x
    • CPU B试图从主内存中读取x时,CPU A检测到了地址冲突。这时CPU A对相关数据做出响应。此时x存储于 cache a 和 cache b 中,x在 chche a 和 cache b 中都被设置为S状态(共享)。

     

    双核读取
    双核读取

     

    (4) 修改数据

    执行流程是:

    • CPU A 计算完成后发指令需要修改x.
    • CPU A 将x设置为M状态(修改)并通知缓存了x的 CPU B, CPU B 将本地 cache b 中的x设置为I状态(无效)
    • CPU A 对x进行赋值。

     

    修改数据
    修改数据

     

    (5) 同步数据

    那么执行流程是:

    • CPU B 发出了要读取x的指令。
    • CPU B 通知CPU A,CPU A将修改后的数据同步到主内存时cache a 修改为E(独享)
    • CPU A同步CPU B的x,将cache a和同步后cache b中的x设置为S状态(共享)。

     

    同步数据
    同步数据

     

    3. CPU 存储模型简介

    MESI协议为了保证多个 CPU cache 中共享数据的一致性,定义了 Cache line 的四种状态,而 CPU 对 cache 的4种操作可能会产生不一致状态,因此 cache 控制器监听到本地操作和远程操作的时候,需要对地址一致的 Cache line 状态做出一定的修改,从而保证数据在多个cache之间流转的一致性。

    但是,缓存的一致性消息传递是要时间的,这就使得状态切换会有更多的延迟。某些状态的切换需要特殊的处理,可能会阻塞处理器。这些都将会导致各种各样的稳定性和性能问题。比如你需要修改本地缓存中的一条信息,那么你必须将I(无效)状态通知到其他拥有该缓存数据的CPU缓存中,并且等待确认。等待确认的过程会阻塞处理器,这会降低处理器的性能。因为这个等待远远比一个指令的执行时间长的多。所以,为了为了避免这种阻塞导致时间的浪费,引入了存储缓存(Store Buffer)和无效队列(Invalidate Queue)。

    (1) 存储缓存

    在没有存储缓存时,CPU 要写入一个量,有以下情况:

    • 量不在该 CPU 缓存中,则需要发送 Read Invalidate 信号,再等待此信号返回,之后再写入量到缓存中。
    • 量在该 CPU 缓存中,如果该量的状态是 Exclusive 则直接更改。而如果是 Shared 则需要发送 Invalidate 消息让其它 CPU 感知到这一更改后再更改。

    这些情况中,很有可能会触发该 CPU 与其它 CPU 进行通讯,接着需要等待它们回复。这会浪费大量的时钟周期!为了提高效率,可以使用异步的方式去处理:先将值写入到一个 Buffer 中,再发送通讯的信号,等到信号被响应,再应用到 cache 中。并且此 Buffer 能够接受该 CPU 读值。这个 Buffer 就是 Store Buffer。而不须要等待对某个量的赋值指令的完成才继续执行下一条指令,直接去 Store Buffer 中读该量的值,这种优化叫Store Forwarding

    (2) 无效队列

    同理,解决了主动发送信号端的效率问题,那么,接受端 CPU 接受到 Invalidate 信号后如果立即采取相应行动(去其它 CPU 同步值),再返回响应信号,则时钟周期也太长了,此处也可优化。接受端 CPU 接受到信号后不是立即采取行动,而是将 Invalidate 信号插入到一个队列 Queue 中,立即作出响应。等到合适的时机,再去处理这个 Queue 中的 Invalidate 信号,并作相应处理。这个 Queue 就是Invalidate Queue

    四、乱序执行

    乱序执行(out-of-orderexecution:是指CPU允许将多条指令不按程序规定的顺序分开发送给各相应电路单元处理的技术。这样将根据各电路单元的状态和各指令能否提前执行的具体情况分析后,将能提前执行的指令立即发送给相应电路。

    这好比请A、B、C三个名人为晚会题写横幅“春节联欢晚会”六个大字,每人各写两个字。如果这时在一张大纸上按顺序由A写好”春节”后再交给B写”联欢”,然后再由C写”晚会”,那么这样在A写的时候,B和C必须等待,而在B写的时候C仍然要等待而A已经没事了。

    但如果采用三个人分别用三张纸同时写的做法, 那么B和C都不必须等待就可以同时各写各的了,甚至C和B还可以比A先写好也没关系(就象乱序执行),但当他们都写完后就必须重新在横幅上(自然可以由别人做,就象CPU中乱序执行后的重新排列单元)按”春节联欢晚会”的顺序排好才能挂出去。

    所以,CPU 为什么会有乱序执行优化?本质原因是CPU为了效率,将长费时的操作“异步”执行,排在后面的指令不等前面的指令执行完毕就开始执行后面的指令。而且允许排在前面的长费时指令后于排在后面的指令执行完。

    CPU 执行乱序主要有以下几种:

    • 写写乱序(store store)a=1;b=2; -> b=2;a=1;
    • 写读乱序(store load)a=1;load(b); -> load(b);a=1;
    • 读读乱序(load load)load(a);load(b); -> load(b);load(a);
    • 读写乱序(load store)load(a);b=2; -> b=2;load(a);

    总而言之,CPU的乱序执行优化指的是处理器为提高运算速度而做出违背代码原有顺序的优化

    转载于:https://www.cnblogs.com/xuanbjut/p/11610842.html

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    按照存储介质的不同,将存储器分为光学存储、半导体存储和磁性存储三大类。
    (1)光学存储:CD、DVD;
    (2)磁性存储:磁带、软盘、机械硬盘;
    (3)半导体存储
    在这里插入图片描述

    5.1 ROM

    ROM(Read-Only Memory):只读存储器。通常掉电后数据不会消失的半导体存储器都泛称为 ROM 了。比如手机参数里所说的 ROM 通常就是指 NAND FLASH 类存储器。但这些 ROM 基本上都是不支持执行代码的。
    一般:
    1G以下(小容量),用nandflash ;1G以上(大容量),用emmc 。

    5.1.1 NOR FLASH

    内存类接口,其最大的特点是norflash里面的程序可以直接运行,不必再把代码读到系统的RAM中,所以norflash能够直接用来做boot。
      2440开发板是2M的norflash,有自己的地址线和数据线,能够采用类似于memory的随机訪问方式,但不能向内存直接写,需单独设置操作。
      传输速度高、写入和擦除速度低,擦除前需要置零,读取比nand快,适合做代码存储并片上执行,norflash的读取速度比nandflash稍快,但擦写速度比nandflash慢非常多。

    5.1.2 NAND FLASH

    I/O类接口:存储密度大,擦除简单,擦除和写入比nor快很多,但需要特殊的系统接口单元。类似电脑的硬盘,CPU从里面读取数据的速度很慢,他里面的代码也不能直接运行,要想运行需要把nandflash里面的数据读到内存里面,然后CPU才能执行,但是他的集成度很高,成本很低。属于IO设备,数据、地址、控制线都是共用的,须要软件区控制读取时序,所以不能像nor flash、内存一样随机訪问,不能EIP(片上执行)。因此不能直接作为boot。适合用来作大量数据存储的。

    5.1.3 UFS/eMMC

    eMMC(embedded Multi Media Card:嵌入式多媒体存储卡):nandflash+主控ic+mmc卡
       在这里插入图片描述
      eMMC内部主要可以分为Flash Memory、Flash Controller以及Host Interface三大部分。
    绝大部分的EMMC内部用的是Nand Flash,NAND Flash直接接入Host时,Host端通常需要有NAND Flash Translation Layer,即NFTL或者NAND Flash文件系统来做坏块管理、ECC等的功能。

    eMMC则在其内部集成了Flash Controller,用于完成擦写均衡、坏块管理、ECC校验等功能。相比直接将NAND Flash接入到Host端,eMMC屏蔽了NAND Flash的物理特性,可以减少Host端软件的复杂度,让Host端专注于上层业务,省去对NAND Flash进行特殊的处理

    UFS(Universal Flash Storage:通用闪存存储)不论是数据传输技术,还是工作模式,UFS都全面领先于eMMC,5G时代的到来,旗舰手机的ROM都至少是UFS3.0以上了。

    注:UFS/eMMC是一种内嵌式存储器的标准规格(基于闪存介质的基础上集成主控芯片,而且拥有标准接口),而不是指具体的存储器,也不是指接口。

    5.2 RAM

    随机存储内存,断电数据丢失,存储短时间使用程序。是用来存储当前数据的,比如手机程序运行时需要占用内存,是为机器运行软件提供内存的芯片

    5.2.1 SRAM

    静态随机存取存储器(Static RAM,SRAM)是随机存取存储器中的一种。所谓的“静态”,是指这种存储器只要保持通电,里面储存的数据就可以恒常保持,掉电还是会消失的。

    这是性能十分优秀的 RAM,但价格较高,一般用在 CPU 内部做高速缓存(cache),或是(stepping stone)垫脚石。如三星的 S3C2440 内部就有 16Kb 的指令缓存、16Kb 的数据缓存和 4Kb 的内部 RAM(垫脚石)。当把Bootloader烧到nand flash上启动,由于在2440里有一个内置的SRAM。系统启动加电后,会把nandflash上的起始4KB的内容复制到SRAM里运行(硬件自动实现),这样就实现了从nandflash启动。

    5.2.2 DRAM

    动态随机存取存储器(Dynamic RAM),是如今最为常见的系统内存 RAM(无论是个人电脑还是智能手机)。它相对于SRAM,在通电的情况下,也只能将数据保持很短的时间,为了保持数据稳定,所以必须隔一段时间就要对存储单元刷新(refresh)一次,如果存储单元没有被刷新,那么存储的数据就会丢失。
    (1)SDRAM  
      同步动态随机存储器(Synchronous DRAM),它比 DRAM 多了一个同步。同步是指内存工作需要同步时钟,内部的命令的发送与数据的传输都以它为基准;动态是指存储阵列需要不断的刷新来保证数据不丢失;随机是指数据不是线性依次存储,而是自由指定地址进行数据读写。在JZ2440开发板中,S3C2440的外部接了两个32MB的SDRAM,这就是内存。

    (2)DDR SDRAM(Double Data Rate SDRAM):双倍速率同步动态随机存储器,目前主流的内存类型。

    5.3 CPU缓存

    CPU缓存(Cache Memory)位于CPU与内存之间的临时存储器,它的容量比内存小但交换速度快。在缓存中的数据是内存中的一小部分,但这一小部分是短时间内CPU即将访问的,当CPU调用大量数据时,就可避开内存直接从缓存中调用,从而加快读取速度。由此可见,在CPU中加入缓存是一种高效的解决方案,这样整个内存储器(缓存+内存)就变成了既有缓存的高速度,又有内存的大容量的存储系统了。

    L1和L2都是计算机中缓存(cache memory)的等级。如果计算机的处理器可以在缓存中找到他下个运算所需的数据,它将省去了到随机存储器(RAM)中寻找这个数据的时间。

    L1是一级缓存,通常内建于微处理芯片(Chip)中。比如,IntelMMX微处理器(microprocessor)本身是带有一个有32Kb的一级缓存。L2(就是二级)缓存是在独立芯片(有可能是在一个扩展卡上),它的访问速度能比大的主存要快得多。通常一个二级缓存的大小为1024Kb(1Mb)。

    CPU读取数据的顺序是先缓存后内存。

    CPU产品中,一级缓存的容量基本在4KB到64KB之间,二级缓存的容量则分为128KB、256KB、512KB、1MB、2MB等。一级缓存容量各产品之间相差不大,而二级缓存容量则是提高CPU性能的关键。二级缓存容量的提升是由CPU制造工艺所决定的,容量增大必然导致CPU内部晶体管数的增加,要在有限的CPU面积上集成更大的缓存,对制造工艺的要求也就越高。

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    什么是存储器?  存储器(Memory)是计算机系统中的记忆设备,用来存放程序和数据。计算机中的全部信息,包括输入的原始数据、计算机程序、中间运行结果和最终运行结果都保存在存储器中。它根据控制器指定的位置...
  • 常见存储器分类

    千次阅读 2020-07-15 13:47:20
    存储器的主要功能是存储程序和各种数据,并能在计算机运行过程...它可以随时读写,而且速度很快,通常作为操作系统或其他正在运行中的程序的临时数据存储媒介。当电源关闭时RAM不能保留数据。如果需要保存数据,就必须
  • 随机存储器是什么

    千次阅读 2021-07-27 04:27:21
    随机存储器一般指随机存取存储器(RAM,通常被称之为内存或运行内存),是与CPU直接交换数据的内部存储器。它可以随时读写,而且速度很快,通常作为操作系统或其他正在运行中的程序的临时数据存储介质。随机存储器一般...
  • 存储器的层次体系

    2021-10-29 21:09:47
    计算机存储器的设计目标可归纳为三个问题:多大的容量?多快的速度?多贵的价格? “多大的容量”问题从某种意义上来说是无止境的,存储器有多大的容量,就可能开发出应用程序来使用它的容量。“多快的速度”问题相对...
  • 存储器

    2019-01-04 09:14:25
    可以随时读写,且速度极快,通常作为程序的临时数据存储媒介。其存取的速度与数据存放的位置无关,掉电丢失。 根据存储单元的工作原理又分为:静态和动态随机存储器。(Static RAM和Dynamic RAM) 特点:随机存取...
  • 存储器与寄存器的区别

    千次阅读 2021-07-26 02:49:04
    目录1.主要功能2.访问速度3.结构4.优势什么是寄存器?寄存器就是CPU内部用来存放数据的...而存储器是计算机系统中的记忆设备,用来存放程序和数据。既然都是用来存放数据的东西,那么这两者有什么区别呢?下面一起看看...
  • 存储器(存储器的分类有哪些)

    千次阅读 2021-06-17 00:48:03
    存储器 微型计算机的内存储器是由半导体器件构成的。从使用功能上分,有随机存储器 (Random Access Memory,简称 RAM),又称知读写存储器;只读存储器(.内存和硬盘A、RAM和C磁盘 B、ROM C、ROM和RAM D、硬盘和控制...
  • 存储器——概述

    2020-03-25 18:58:14
    存储器——概述 存数器的分类 按照存储介质进行分类 存储信号 存储介质 主要类型 断电是否容易失去 电信号 (高低电位) 半导体存储器 TTL和MOS 断电易失去 磁信号 (南北极) 磁表面存储器 磁头和磁载体 ...
  • 存储器是记忆信息的实体,是数字计算机具备存储数据和信息能力,能够自动连续执行程序,进行广泛的信息处理的重要基础。1存储器的概念(1) 存储器存储器是计算机硬件系统的记忆设备,用来存放程序(软件)和各种数据...
  • 非易失性存储器技术是在关闭计算机或者突然性、意外性关闭计算机的时候数据不会丢失的技术。非易失性存储器技术得到了快速发展,非易失性存储器主要分为块寻址和字节寻址两类。在很多的存储系统的写操作程序中,内存...
  • PLC存储器的三种分类

    2021-07-25 05:32:43
    PLC存储器的三种分类2018年08月14日 10:40:44来源:电子发烧友网作者: 姚远香关键词:PLC存储器什么是存储器存储器(Memory)是计算机体系中的回忆设备,用来寄存程序和数据。计算机中的全部信息,包括输入的原始...
  • 存储器管理

    2020-11-29 18:07:09
    存储器是计算机系统中的一个主要部件,用于保存进程运行时的程序和数据,CPU的控制部件只能从主存储器中取得指令和数据,数据能够从主存储器中读取并将他们装入到寄存器中,或者从寄存器存入到主存储器,CPU与外围...
  • ROM是只读存储器(Read-Only Memory)的简称,以非破坏性读出方式工作,只能读出无法写入信息。信息一旦写入后就固定下来,即使切断电源,信息也不会丢失,所以又称为固定存储器。ROM所存数据通常是装入整机前写入的...
  • 存储器分类及各自特点有哪些

    千次阅读 2021-06-27 10:43:20
    存储器(Memory)是现代信息技术中用于保存信息的记忆设备。其概念很广,有很多层次,在数字系统中,只要能保存二进制数据的都可以是存储器;在集成电路中,一个没有实物形式的具有存储功能的电路也叫存储器,如RAM、...
  • 6.1概述从逻辑上来说,存储器的存储单元是按照线列排列的, 存储器单元的地址从0开始编址, 直到处理器可以寻址的最大容器.6.2 存储器的类型计算机系统都使用两种基本类型的存储器:随机存储器(random access memory,RAM...
  • 寄存器和存储器

    2020-06-05 23:49:56
    内存 内存既专业名上的内存储器,它不是个什么神秘的东西,它也只是存储器中的沧海一粟,它包涵的范围也很大,一般分为只读存储器(ROM)和随机存储器(RAM),以及最强悍的高速缓冲存储器(CACHE),只读存储器...

空空如也

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临时存储器