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  • 两个4位二进制相减的VHDL程序 前言 本次实验所用软件为Quartus||9.0,所用板载为EPF10K20T144-4。 注意事项 (1)创建VHDL工程时选择板载系列一定要按照板载芯片上的系列选中。 (2)目前使用的Quartus || 9.0不支持...

    两个4位二进制相减的VHDL程序

    前言
    本次实验所用软件为Quartus||9.0,所用板载为EPF10K20T144-4

    注意事项
    (1)创建VHDL工程时选择板载系列一定要按照板载芯片上的系列选中。
    (2)目前使用的Quartus || 9.0不支持输入汉字的功能,只支持显示汉字的功能,所以想要在上面显示汉字,得先在记事本中写好自己要写的汉字内容,然后再复制粘贴到Quartus || 9.0上的文件中。
    (3)安装驱动程序前一定要记得禁止驱动程序签名。
    (4)配置完引脚以后一定要记得要再编译一次。

    实验题目
    1、试编写两个4位二进制相减的VHDL程序。

    代码实现
    1、实现思路如下:设置两个输入一个输出,然后将被减数和减数加一位"0",然后求出减数的补码以后,相加即可。(注:代码如下)

    library ieee; 
    use ieee.std_logic_1164.all; 
    use ieee.std_logic_unsigned.all; 
    
    entity subtraction is 
    port( A: in std_logic_vector(3 downto 0); 
          B: in std_logic_vector(3 downto 0); 
          D: out std_logic_vector(3 downto 0)); 
    end subtraction; 
    
    architecture rt of subtraction is 
    signal aa,bb,ss: std_logic_vector(4 downto 0); 
    signal v:std_logic; 
    begin  
          aa<='0' & A; 
          bb<='0' & not B; 
          SS<=aa + bb + '1'; 
          v<=ss(4); 
          D(3 downto 0)<= ss(3 downto 0); 
    end rt; 
    

    时序仿真实现

    烧入板载实现

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    1、二进制减法:

    0-0=0,10-1=1(向高位借位)1-0=1,1-1=0(模二加运算或异或运算)。

    2、二进制的加法:

    0+0=0,0+1=1,1+0=1,1+1=10(向高位进位)。

    3、二进制的乘法:

    0*0=0 0*1=0,1*0=0,1*1=1。

    4、二进制的除法:

    0÷0=0,0÷1=0,1÷0=0(无意义),1÷1=1。

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    扩展资料

    计算机采用二进制原因

    二进位计数制仅用两个数码。0和1,所以,任何具有二个不同稳定状态的元件都可用来表示数的某一位。而在实际上具有两种明显稳定状态的元件很多。

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    利用这些截然不同的状态来代表数字,是很容易实现的。不仅如此,更重要的是两种截然不同的状态不单有量上的差别,而且是有质上的不同。这样就能大大提高机器的抗干扰能力,提高可靠性。而要找出一个能表示多于二种状态而且简单可靠的器件,就困难得多了。

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