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  • 2020-12-29 09:08:10

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    摘要 .................................................................................................................................................. 1

    1 多功能双向移位寄存器 ............................................................................................................... 2

    1.1 基本工作原理 .................................................................................................................... 2

    1.2 基本实现方案 .................................................................................................................... 2

    2 电路图设计................................................................................................................................... 4

    2.1 电路结构............................................................................................................................ 4

    2.2 真值表................................................................................................................................ 4

    3 Verilog描述8位双向移位寄存器 ............................................................................................... 6

    4 程序仿真....................................................................................................................................... 8

    5 总结 ............................................................................................................................................ 10

    参考文献......................................................................................................................................... 11

    双向移位寄存器 8位双向移位寄存器电路设计

    武汉理工大学《能力拓展训练》说明书

    摘要

    移位寄存器是基本的同步时序电路,基本的移位寄存器可以实现数据的串行/并行或并行/串行的转换、数值运算以及其他数据处理功能。[wwW.nIUBB.NET)在本设计中,使用硬件描述语言Verilog,在EDA工具QuartussII中,设计8位双向移位寄存器硬件电路,根据设计语言进行功能时序仿真,验证设计的正确性与可行性。

    关键字:Verilog QuartusII

    移位寄存器 1

    双向移位寄存器 8位双向移位寄存器电路设计

    武汉理工大学《能力拓展训练》说明书

    8位双向移位寄存器电路设计

    1 多功能双向移位寄存器

    1.1 基本工作原理

    移位寄存器是基本的同步时序电路,基本的移位寄存器可以实现数据的串行/并行或并行/串行的转换、数值运算以及其他数据处理功能。[wWw.niUbb.nEt)在本设计中定义移位寄存器中的数据从低位触发器移向高位为右移,移向低位为左移。

    为了扩展逻辑功能和增加使用的灵活性,某些双向移位寄存器集成电路产品又附加了并行输入、并行输出等功能。如图1所示是上述几种工作模式的简化示意图。

    双向移位寄存器 8位双向移位寄存器电路设计

    右移串行输入(DIR左移串行输出(DOL并行输入 03右移串行输出(DOR) DIL) 12并行输出

    图1 多功能移位寄存器工作模式简图

    1.2 基本实现方案

    图2所示是实现数据保持、右移、左移、并行置入和并行输出的一种电路方案。图中的D触发器FFm是N为移位寄存器中的第m位触发器,在其数据输入端插入了一个4选1数据选择器MUXm,用2位编码输入S1、S0控制MUXm,来选择触发器输入信号Dm的来源。当S1?S0?0时,选择该触发器本身输出的Qm,

    n?1n次态为Qm,使触发器保持状态不变;当S1?0,S0?1时,触发器FFm?1?Dm?Qm

    的输出Qm?1被选中,故CP脉冲上升沿到来时,FFm存入FFm?1此前的逻辑值,即n?1nn?1n而Qm从而实现右移功能;类似地,当S1?1,S0?0时,MUXmQm?Qm?1,+1?Qm,

    选择Qm?1,实现左移功能;而当S1?S0?1时,则选中并行输入数据DIm,其次

    n?1态Qm?DIm,从而完成并行数据的置入功能。上述四种操作概述于表1,此外,

    2

    双向移位寄存器 8位双向移位寄存器电路设计

    武汉理工大学《能力拓展训练》说明书

    在各触发器的输入端QN?1~Q0,可以得到N位并行数据的输出。(wwW.NiUBB.nEt)

    双向移位寄存器 8位双向移位寄存器电路设计

    图2 实现多功能双向移位寄存器的一种方案

    如表1所示,为图2多功能双向移位寄存器的功能表:

    表1 图2的功能表

    双向移位寄存器 8位双向移位寄存器电路设计

    3

    双向移位寄存器 8位双向移位寄存器电路设计

    2.2 真值表

    2.1 电路结构

    2 电路图设计

    存器,完整电路图如图3所示。[Www.nIubB.nET]

    武汉理工大学《能力拓展训练》说明书

    有效位对应的数据选择器和最高有效位对应的数据选择器。

    双向移位寄存器 8位双向移位寄存器电路设计

    图3 8位双向移位寄存器

    数据选择器编码端S1S0分别对应地接在一起,同时选择D触发器的信号数据来

    行输入。Dsr是右移串行数据输入端,Dsl是左移串行数据输入端,分别接最低

    此电路由8个4选1数据选择器、8个带异步清零的D触发器组成。所有的

    D触发器的同步,和并行输出数据的清零。另,每个D触发器的输出对应一位并

    源。D触发器时钟端CP接一起,清零端CR也同样接在一起,这样可以保证级联

    根据上一节的移位寄存器的一种基本实现方案,可以设计出8位双向移位寄

    分析电路图,可得此8位双向移位寄存器的真值表,如表2所示:

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    移位寄存器

    所谓“移位”,就是将移位寄存器所存各位数据,在每个移位脉冲的作用下,向左或向右移动一位。根据移位方向,常把它分成左移寄存器 、右移寄存器 和双向移位寄存器三种。
    输入-输出方式:
    串行输入-串行输出 (serial in/serial out)
    串行输入-并行输出(serial in/parallel out)
    并行输入-串行输出(parallel in /serial out)
    并行输入-并行输出(parallel in /parallel out)
    在这里插入图片描述

    单向寄存器

    由D触发器组成的电路,输出Q跟随D状态。
    在这里插入图片描述
    在这里插入图片描述
    在这里插入图片描述
    那它移位的过程具体是如何实现的呢?
    当CLK上升沿到来时,信号传到输出端需要一定的传输延迟时间,我们将这个传输延迟时间叫做tpd。此时FF0输出端无变化,后边其余触发器将按照原始状态跟随。然后,D1的代码存入FF0。总效果相当于移位寄存器的代码向右移了1位。

    由表也可看出经过4个CLK信号后,串行输入代码存入寄存器中并转为并行输出;
    那么其实同理,如果将4位并行数据置入移位寄存器4个触发器中,然后连续加入4个移位脉冲,则移位寄存器中的4位代码将从串行输出端串行输出。
    在这里插入图片描述
    仔细看Q0Q1Q2Q3时序图,会有移位的效果。

    小结

    在这里插入图片描述

    双向移位寄存器

    由SR触发器组成的双向移位寄存器。
    在这里插入图片描述
    我们以第二个FF1为例子进行分析。可以发现,通过控制S1S0就可以控制194的工作状态。
    在这里插入图片描述
    S1=S0=1,Q1被选中;
    S1=S0=1,D1被选中,处于并行输入状态;
    S1=0,S0=1,Q0被选中,处于右移状态;
    S1=1,S0=0,Q2被选中,处于左移状态;
    RD‘=0,触发器将被同时置0,处于复位状态。
    在这里插入图片描述
    那如果我们现在想接多位双向寄存器呢?

    74HC194A接多位双向寄存器

    在这里插入图片描述
    双向移位寄存器194中,4个触发器的位置是按Q0Q1Q2Q3的顺序,Q0在最左边,Q3在最右边。实现右移时,来一个移位脉冲CLK后,DIR端的数据移至Q0,Q0移至Q1,…,依次类推。不难理解,当2片194接成8位双向移位寄存器时,右边194的DIR应该接左边194的Q3,而左边194的DIL应该接右边194的Q0。

    移位器和加法器组成的电路

    在这里插入图片描述

    寄存器的应用

    延时

    在这里插入图片描述

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    在这里插入图片描述

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    在这里插入图片描述

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    在数字电路系统工作过程中,把正在处理的二进制数据或代码暂时存储起来的操作叫做寄存,寄存器电路就是实现寄存功能的电路,是数字逻辑电路的基础模块。[1]中文名寄存器电路外文名register circuit拼音jì cún qì ...

    在数字电路系统工作过程中,把正在处理的二进制数据或代码暂时存储起来的操作叫做寄存,寄存器电路就是实现寄存功能的电路,是数字逻辑电路的基础模块。[1]

    中文名

    寄存器电路

    外文名

    register circuit

    拼    音

    jì cún qì diàn lù定    义

    实现寄存功能的电路

    属    性

    数字逻辑电路的基础模块

    应用学科

    计算机

    寄存器电路概述

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    语音

    任何现代的数字电路系统,特别是一些大型的数字处理系统,往往不可能一次性地把所有的数据都处理好,因此在处理的过程中都必须把需要处理的某些数据、代码先寄存起来,以便在需要的时候随时取用。

    在数字电路系统工作过程中,把正在处理的二进制数据或代码暂时存储起来的操作叫做寄存,实现寄存功能的电路称为寄存器。寄存器是一种最基本的时序逻辑电路,在各种数字电路系统中几乎是无所不在,使用非常广泛。常用的集成电路寄存器按能够寄存数据的位数来命名,如4位寄存器、8位寄存器、16位寄存器等。

    寄存器按它具备的功能可分为两大类:数码寄存器和移位寄存器。若按照寄存器内部组成电路所使用的晶体管不同种类来区分,可以分成如晶体管一晶体管逻辑(TTL)、互补场效应晶体管逻辑(CMOS)等许多种类,目前使用最多的就是TTL寄存器和CMOS寄存器,它们都是中、小规模的集成电路器件。[1]

    14d966bbde9c93cc5939c6005482e576.png

    图1寄存器电路是数字逻辑电路的基础模块。寄存器用于寄存一组二值代码,它被广泛地用于各类数字系统和数字计算机中。由于一个触发器能够存储一位二值代码,所以用N个触发器能够存储N位二值代码。对于寄存器中的触发器,只要求它们具有置高电平1、置低电平0的功能就可以了,因此,无论是用同步R-S结构触发器,还是用主从结构或边沿触发结构的触发器,都可以组成寄存器电路。

    在计算机 CPU 中,为配合全加器的算术运算, N 个触发器串联可组成移位寄存器。例如,由四位D触发器组成的向有数据移位的移位寄存器以及移位波形图如图1所示。[2]

    寄存器电路基本寄存器电路

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    语音

    寄存器电路定义

    65b094887da72797b56375bc2c9b39f4.png

    图2基本寄存器是由触发器组成的,一个触发器就是一个寄存器,它可以储存一位二进制数码。需要存储四位二进制数码时,只要把四个触发器并联起来,就可以组成一个四位二进制寄存器,它能接受和存储四位二进制数码。图2是由4个D触发器构成的基本寄存器逻辑电路,每个触发器的cP端并联起来作为控制端。需要存储的数码加到触发器的D输入端。四个触发器的CP端接在一起,成为寄存器的控制端,需要存储的数码加到触发器的D输入端。

    寄存器电路特点

    根据D触发器的性质,上述的寄存器有以下基本特点。

    (1)CP=0

    当CP=0时,触发器保持原状态不变,即:bc08d0108a0b8dedf07cc5252edb1d3c.svg

    (2)CP=1

    当CP=1(上升沿)时,触发器的状态为D输入端的状态,即:8ab2222fe0ce5c2dfd305e7fd0228c05.svg

    由此可见,D触发器只在CP=1(上升沿)时,才会接收和存储数码。

    另外,由于4个触发器的9bff704fe8d75e5fab25e1eb058fc1f1.svg端也并联在一起。因此,如果在瓦D端加上负脉冲,就可将全部触发器均置为0态,通常将这一过程称为清零,也叫置0端。

    寄存器电路工作原理

    如果要存储二进制数1001,它们被分别加到触发器的D输入端。当时钟脉冲CP到来时,由于D触发器的特性是在CP=1时,62ba0a7193563c4d690930c9e3e4d8a2.svg,所以在CP脉冲的上升沿时,4个触发器的状态从高位到低位被分别置为1001,只要不出现清零脉冲或新的接收脉冲和数码,寄存器将一直保持这个状态不变,即输入的二进制码1001被存储在该寄存器中。 如果想从寄存器中取出1001数码,则只要从寄存器的各个Q输出端就可以获得。[3]

    寄存器电路移动寄存器电路

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    语音

    寄存器电路定义

    移位寄存器电路和锁存器电路一样,都是暂时存放数据的部件。数字电路中常要进行加减乘除运算,加法和减法运算通常是用加法器和减法器来完成,而乘除运算则是用移位以后再加减的方法完成的。数字信号在传送时,将数码一位一位按顺序传送的方式叫串行传送,将几位数码同时传送的叫并行传送。因此,对于寄存器电路除要求它能接收、存储和传送数码外,有时还要求它把数码进行移位,这种寄存器电路被称为移位寄存器电路。

    寄存器电路适用场合

    移位寄存器是数字系统中的一个重要部件,应用很广泛。例如在串行运算中,需要用移位寄存器把二进制的数据—位一位依次送入,再用全加器进行运算。运算的结果又一位一位依次存入移位寄存器中。在有些数字装置中,要将并行传送的数据转换成串行传送,或者将串行传送的数据转换成并行传送,要完成这些转换也霈要使用移位寄存器。

    寄存器电路电路特征

    从逻辑结构上看,移位寄存器电路有以下2个显著特征。

    (1)由相同寄存单元组成

    移位寄存器是由相同的寄存单元组成的。一般来说,寄存单元的个数就是移位寄存器的位数。为了完成不同的移位功能,每个寄存单元的输出与其相邻的下一个寄存单元输入之间的连接方式也不同。

    (2)公用时钟

    所有寄存单元公用一个时钟,在公共时钟作用下,各个寄存单元的工作是同步的。每输入一个时钟脉冲,7寄存器的数据就顺序伺左或向右移动一位。寄存单元一般是主从结构的触发器。

    寄存器电路移位寄存器类型

    CMOS移位寄存器属子中规模集成电路,通常可按数据传输方式的不同进行分类,从数据输入方式看,移位寄存器有串行输入和并行输入之分。串行输入就是在时钟脉冲作用下,把要输入的数据从一个输入端依次一位一位地送入寄存器。并行输入就是把要输入的数据从几个输入端同时送入寄存器。

    在CMOS移位寄存器中,有的品种只具有1种输入方式,例如只具有串行输入方式,但也有些品种同时兼有并行和串行2种方式。串行输入的数据加到第一个寄存单元的输入端,在时钟脉冲的作用下输入;数据传送速度较慢。并行输入的数据一般由寄存单元的R、S端送入,传送速度较快。[3]

    寄存器电路寄存器电路建模

    编辑

    语音

    寄存器和组合逻辑是数字逻辑电路的两大基本要素。寄存器一般和同步时序逻辑关联,其特点为仅当时钟的沿(上升沿或下降沿)到达时,才有可能发生输出的改变。根据实现目标不同,寄存器的建模结构略有不同,需要注意如下要点:

    ①寄存器信号声明:寄存器定义是reg型。但是请注意,这个命题的反命题不一定成立。某些信号虽然被定义为reg型,但是最终综合实现结果并不是寄存器,如“cnt—out—plus”虽然被指定为reg型,但是实现时是纯组合逻辑。只有定义为reg型,且always的敏感表为posedge或negedge沿敏感操作时,该信号才是寄存器。

    ②时钟输入:在每个时钟的正沿或负沿对数据进行处理。数据的正沿或负沿起作用,是在always的敏感表中通过posedge和negedge指定的。

    ③异步复位/置位:绝大多数目标器件的寄存器模型都包含异步复位/置位端。异步复位/置位是指无论时钟沿是否有效,当复位/置位信号有效沿到达时,复位/置位立即发挥功能。指定异步复位/置位时,只需在always的敏感表中加入复位/置位信号的有效沿即可。下例描述的异步复位电路是最常用的寄存器复位形式之一。

    ④同步复位/置位:任何寄存器都可实现同步复位/置位功能。指定同步复位/置位时,always的敏感表中仅有时钟沿信号,当同步复位/置位信号变化时,同步复位/置位并不立即发生,仅仅当时钟沿采到同步复位/置位的有效电平时,才会在时钟沿到达时刻进行复位/置位操作。

    ⑤同时使用时钟上升和下降沿的问题:有时因为数据采样或调整数据相位等需求,设计者会在一个always的敏感表中同时使用时钟的posedge和negedge,或者在两个always的敏感表中分别使用时钟的posedge和negedge对某些寄存器电路操作。在这两种描述下,当时钟上沿或下沿到达时,该寄存器电路都会做相应的操作。这个双沿电路往往可以等同于使用了原时钟的倍频时钟的单沿操作电路。对于实现在PLD的设计而言,同时使用时钟的上、下沿往往是不推荐的,因为PLD内嵌的PLL/DLL和一些时钟电路往往只能对时钟的一个沿保证非常好的指标,而另一个沿的抖动、偏斜、斜率等指标不见得非常优化,有时同时使用时钟的正负沿会因时钟的抖动、偏斜、占空比、斜率等问题造成一定的性能恶化。因此推荐的做法是:将原时钟通过PLL/DLL倍频,然后使用倍频时钟的单沿(如上升沿)进行操作。但是电路设计不可一概而论,如果必须使用时钟的双沿对同一个寄存器操作时,请设计者明确此时相当于使用了倍频时钟。[4]

    词条图册

    更多图册

    参考资料

    1.

    穆克.电子电路识读一本通:化学工业出版社,2011-03:120

    2.

    孙一林.微型机系统与接口技术:清华大学出版社,2015-09:18

    3.

    孙余凯.电子电路分析与实践:人民邮电出版社,2010-08

    4.

    EDA先锋工作室.轻松成为设计高手:VERILOG HDL实用精解:北京航空航天大学出版社,2012-06

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    在这里插入图片描述
    现在将输入端的3个比特位分别设置成110,并且开关是断开,则寄存器状态如图2
    在这里插入图片描述
    接下来将开关合并,此时3个CP均由0变成1,产生上升沿,所以每个D触发器的Q都会=D,这时状态如图3
    在这里插入图片描述

    最后,将开关断开,无论输入变成何值,都不影响红色虚线中保存的内容
    在这里插入图片描述
    上述就是寄存器的实现原理,寄存器的电子简化图如下
    在这里插入图片描述

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空空如也

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寄存器电路图

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