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  • 以太网物理

    千次阅读 2019-04-14 12:59:58
    IEEE802.3标准给出了以太网的物理结构,如下图所示红色框内标注: 物理大致可以分为: GMII介质无关接口、 PCS物理编码子,PMA物理介质连接,PMD物理介质相关、MDI接口 、MEDIUM物理介质。 1、物理介质...

    网费不够了,不弄了,下次整理
    物理层结构
    IEEE802.3标准给出了以太网的物理层结构,如下图所示红色框内标注:
    在这里插入图片描述
    物理层大致可以分为: GMII介质无关接口、 PCS物理编码子层,PMA物理介质连接层,PMD物理介质相关层、MDI接口 、MEDIUM物理介质。
    1、物理介质层
    这里所谓的物理介质,我们最常见的就是我们的网线,这就是一种以太网传输的物理介质。常见的物理介质还有同轴电缆、光纤等。
    看下表,其中10-100-1000表示以太网的速度10M-100M-1000M。而BASE后的字母数字,则表示了当前介质的类型。
    关于这些推荐大家看一本书《图解网络硬件》

    PHY芯片的主要作用是关注具体的接口和介质类型,执行以太网的物理层通信功能,
    使MAC层芯片专注于实现以太网协议。
    PCS - PHYSICAL CODING SUBLAYER

    PCS子层的功能是编码/解码。
    在发送方向,PCS子层将来自MAC层的数据进行编码,8B/10B或64B/66B。接收方向将来自线路上的数据进行解码后送给MAC层。
    编码的作用是:转换密度、DC补偿、检错等。
    FEC - FORWARD ERROR CORRECTION

    FEC(Forward Error Correction)前向纠错,其原理是:发送方将要发送的数据附加上一定的冗余纠错码,接收方则根据纠错码对数据进行差错检测,如发现差错,可选择由接收方进行纠正。
    RS-FEC Reed-Solomn 里德所罗门FEC编码。
    FEC有两种模式,检测错误但不修复、检测且修改。两者在时延上有差别,当要求低时延使用检测不修复时,要求链路标准更高BER of 10–12 or better,否则要求BER of 10–5 or better,才能达到通讯质量要求。
    PMA - PHYSICAL MEDIUM ATTACHMENT

    PMA子层的功能是链路监测和时钟合成/恢复。
    PMA从PCS接收串行bit流,然后发送到PMD层。PMA使用数字锁相环PLL,在发送端根据标准时钟接口发送bit流,在接收端PLL同步串行数据流并从中提取时钟。
    端口时钟通过端口基频加锁相环倍频得到,每根lane的时钟再由端口时钟经过osr分频得到。
    PMD - PHYSICAL MEDIUM DEPENDENT

    PMD子层的功能是扰码和均衡。
    均衡器(Equalizer),是一种可以分别调节各种频率放大量的电子设备,通过对各种不同频率的电信号的调节来补偿扬声器和声场的缺陷。在通信系统中,在系带系统中插入均衡器能够减小码间干扰的影响。
    如果接收端中判决的结果经过反馈用于均衡器的参数调整,则为非线性均衡器,包括判决反馈均衡器(DFE: Decision Feedback Equalization)、最大似然(ML)符号检测器和最大似然序列估计等。
    DEF是接收端通过固件自动调节以适配最好CDR时钟恢复效果,在高速时,需固件不断调整适配。
    CL72 trainning调整的是发送端的均衡器的预加重值。
    DEF/Trainning都位于PMD层,分别控制接收和发送端能力。
    FEC是独立层,位于PCS之下,PMA之上,在发送端编码,用于接收端纠错。
    AN - AUTO NEGOTATION

    AN子层用于两端交互支持能力,并选取同时支持的最大能力。
    CL28 AN内容包括速率/双工/流控。
    CL73 AN包括对称流控+接口类型(100GCR4、100GKR4、40GKR4…)+FEC ability+FEC requested。

    部分内容参考 https://www.cnblogs.com/yousun/p/8639919.html

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  • 车载以太网物理SerDes

    千次阅读 2020-01-04 09:07:20
    车载以太网物理SerDes

    1 基本概念
    SerDes:sir-deez,加串 + 解串;SerDes的lock是指CDR时钟的锁定;Cadence Sierra SerDes IP
    PHY loopback测试是在PCS子层,不是在SerDes层

    2 分类
    2.1 CML
    - CML:Current Mode Logic
    - 速度高于2.5Gbps的串行接口电路一般都用CML
    - 恒流源16mA
    - 使用总线:PCIe、USB SS(1000mV peak-to-peak)和千兆以太网(PHYless)
    - USB SS TX+/-上加AC耦合电容,是为了隔离RX+/-端的直流偏置对发送端的影响
    - USB SS眼图调试就是调整SerDes寄存器(QCOM)
    - CML通过外接电阻做电平转换后兼容LVDS
    - 百兆以太网4b/5b编码,千兆以太网8b/10b编码,万兆以太网64b/66b编码
    - SGMII和SerDes:包含7根线,分别是TDP/TDN、RDP/RDN、TCLKP/TCLKN和ALOS(Analog Loss of Signal),SGMII分为4-pin和6-pin模式;SGMII模式下GMII的控制信号(TX_EN、TX_ER、RX_ER和RX_DV) 被K-code代替;SGMII和SerDes的pin脚是一样的,唯一的区别是SGMII支持10/100/1000 Mbps Auto-Negotiation(AN),而SerDes不支持速率自协商,固定为1000 Mbps

    2.2 HCSL
    HCSL:High speed Current Steering Logic

    2.3 LVDS
    - 速度低于2.5Gbps的串行接口电路一般选用LVDS
    - 通过驱动3.5mA的稳定电流电源,可在100欧姆终端时,以350mV这样非常低振幅的差动信号来高速传输数据

    3 JESD204B
    3.1 IC
    AD9680 - 双路14位1GSPS模数转换器

    3.2 通信系统中确定ADC的位宽
    对于100G PAM-4的应用来说,接收端ADC的采样率需要达到100Gs/s,否则,采样时就会产生Alias,对信号产生畸变;采样有效位宽同样非常重要,对于PAM-4应用,并不是说2位的有效位数就能够满足数字信号处理的需求,而是至少需要4位以上的有效位宽。

    4 Abbreviations
    comma:K码,0xBC,K28.5
    Gsps:Giga samples per second
    JESD204B:JEDEC Standard No. 204B
    LatticeECP: EConomy Plus, integrate Ethernet SerDes
    Msps:Mega-Sample per second
    SR ADC:Successive Approximation ADC

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  • 以太网MAC协议

    万次阅读 2018-08-07 17:31:11
     主机接口是运行以太网的上层协议(如TCP/IP协议)与MAC控制器的接口。通过该接口,上层协议可以设置MAC的工作模式并读取MAC的状态信息。该接口还可用于上层协议与MAC之间的数据交换。  主机接口模块内有一组...

    MAC发送模块

      MAC发送模块可将上层协议提供的数据封装之后通过MII接口发送给PHY。发送模块可接收主机接口模块的数据帧开始和数据帧结束标志,并通过 主机接口从外部存储器中读取要发送的数据,然后对数据进行封装,然后通过PHY提供的载波侦听和冲突检测信号,在信道空闲时通过MII接口将数据以4位的 宽度发送给PHY,最后由PHY将数据发送到网络上。
      发送模块由CRC生成模块(crc_gen)、随机数生成模块(random_gen)、发送计数模块(tx_cnt) 和发送状态机(tx_statem_模块等四个子模块组成。

    CRC生成模块(crc_gen)

      该模块用于计算发送数据的CRC值,并将CRC值添加到数据帧的帧校验序列字段(FCS)内。为了提高效率,并考虑到MAC与PHY的数据通道 为4位,设计时可采用4位并行CRC计算方法,算法中可使用一个次态函数,并通过循环迭代来模拟移位操作。这样,发送模块就可以在边发送数据到PHY的同 时,一边计算CRC,这样当数据发送完时,CRC值也计算完成了。

    随机数生成模块(random_gen)

      如在发送过程中检测到冲突,发送模块就先发送拥塞码(jam),随后停止发送。在下次重新发送之前,发送模块会先执行一个后退 (backoff)操作,即发送模块等待一个半随机(生成的随机数有范围限制)的时间之后再开始发送。该随机数就是由随机数生成模块产生的,它采用经典的 截断二元指数后退算法,后退的时间是一个与发生冲突次数有关的随机数,随着冲突的次数增多,用于生成该随机数的范同也将逐渐增大,以减少冲突的概率。

    发送计数模块(tx_cnt)

      发送计数模块由半字节计数器(nibcnt)、字节计数器和重试次数计数器(retrycnt)三个计数器组成。其中重试次数计数器 (retrycnt)可对发送某个帧时产生冲突次数进行计数。当计数器的值达到最大重试次数时,它将放弃重试,并丢弃发送缓冲器内的数据。同时,重试计数 器的值还被随机数生成模块用于计算下次重试之前需要后退(backoff)的时隙的个数。
      半字节计数器和字节计数器分别用于对发送过程中的半字节(bibble)和字节进行计数。
      信道忙时,发送模块会一直等待,半字节计算器一直计数。当计数到额定等待时间时(最大帧长度的两倍,即3036字节时间),系统会根据设置放弃 发送或是一直等待(可选功能)。一旦信道空闲再进入帧间间隙周期(≥96个比特时间),南半字节计数器从零开始计数。帧间间隙分为两个部分,在前2/3个 周期中,如果检测到信道忙信号,则半字节计数器复位,发送模块重新开始等待;在后l/3周期中,即使检测到信道忙信号,半字节计数器也不会复位,而是继续 计数,以保证每个站点公平的竞争信道。而当半字节计数器的值达到帧问间隙周期时,此时如果有数据等待发送,发送模块就开始发送数据。此外,半字节计算器还 用于前序码的生成和短帧的判断,在数据帧的长度小于最小帧时,发送模块必须根据系统设置进行填充或不填充。
      字节计算器还可用于滞后冲突(late collision)和超长帧的判断。当滞后冲突发生时,正在发送的数据将被丢弃。超长帧的判断则是从对帧内容(包括FCS)进行字节计数,如果字节计数 器的值大于最大有效帧的长度(1518个字节),发送模块就根据系统设置(是否支持超长帧)丢弃或发送。

    发送状态机模块(tx_statem)

      发送状态机模块是整个发送模块的核心,主要用于控制整个发送过程。发送状态机由I-die_State、Preamble_State、 Data0_State、 Da-tal_State、 PAD_State、 FCS_State、 IPG_State、Jam_State、BackOff_State、Defer_State等十个状态组成。
      系统复位后,发送模块即进入Defer_State状态,并一直检测载波侦听(CarrierSense)信号。当载波侦听信号变成无效(表示 信道空闲)时,状态机进人IPG_State状态。尔后,在等待一个帧间间隙之后,状态机则进入Idle_State状态。如果在帧间间隙的前2/3个周 期检测到信道忙信号,状态机将重新回到Defer_State状态。
      状态机进入Idle_State状态之后,发送模块将检测载波侦听信号和主机接口的发送请求。若主机模块请求发送,状态机将进入 Preamble_State状态,发送模块即通知PHY发送开始,同时开始发送前序码(7个0x5),然后发送帧起始定界符(SFD,0xd)。状态机 进入Data0_State后,发送模块将发送一个数据字节的低4位(LSB nibble),将当其进入Data1_State状态后,发送模块则发送数据字节的高4位(MSB nibble)。随后,状态机一直在data0和data1之间循环,直到数据发送完毕。当还剩一个字节时,主机模块将通过发送帧结束信号来通知发送模 块。如果数据帧的长度大于最小帧并且小于最大帧,状态机就进入FCS_State状态,此时发送模块则将CRC生成模块生成的CRC值添加到帧的FCS字 段中并发送给PHY。帧发送完之后,状态机进入Defer_State状态,之后是IPG_State和Idle_State状态。此后状态机又回到初始 状态,以重新等待新的发送请求。
      如果数据帧的长度小于最短帧,状态机就进入PAD_State状态,发送模块根据系统设置是否在数据之后来添加填充码。然后,状态机进入 FCS_State状态。如果数据帧的长度大于最大帧,而系统设置又支持发送超长帧,那么,状态机就进入FCS_State状态;如果不支持发送超长帧, 发送模块将放弃发送,状态机直接进入Defer状态,然后是IPG状态,最后回到Idle状态。
      在发送数据的过程中,发送模块会一直检查冲突检测信号(collision detected)。如果发现冲突且状态机正处于Preamble_State,状态机将在发送完前序码和SFD之后进入Jam_State,并发送拥塞 码,然后进入BackOff状态,以等待重试。之后,状态机经过Defer和IPG回到Idle状态。如果此时重试次数计数器的值没有达到额定值,发送模 块将重新开始发送刚才的帧,并将重试次数计数器的值加1;如果发现冲突且状态机处于data0、da-tal或FCS状态,而且没有超过冲突时间窗,那么 状态机将马上进入Jam状态发送拥塞码,之后经过BackOff、Defer、IPG、回到Idle,并根据重试计数器的值决定是否重新发送刚才的数据 帧;如果检测到发生冲突的时间超过了冲突时间窗,状态机将进入Defer状态,然后经过IPG到IDLE状态,并放弃重试。
      在全双工模式中发送帧时,不会进行延迟(defer),发送的过程中也不会产生冲突。此时,发送模块将忽略PHY的载波侦听和冲突检测信号。当 然,帧与帧之间仍然需遵守帧间间隙的规则。因此,全双工模式下的发送状态机没有Jam_State、。BackOff_State、 Defer_State三个状态。

    MAC接收模块

      MAC接收模块负责数据帧的接收。当外部PHY将通信信道的串行数据转换为半字节长的并行数据并发送给接收模块后,接收模块会将这些半字节数据 转换为字节数据,然后经过地址识别、CRC校验、长度判断等操作后,再通过主机接口写入外部存储器,并在主机接口模块的接收队列中记录帧的相关信息。此 外,接收模块还负责前序码和CRC的移除。
      接收模块由CRC校验模块、地址识别模块、接收计数器模块和接收状态机模块等四部分组成。
      接收模块中的CRC校验模块可通过检查输入帧的CRC值来验证帧的正确性。其算法与CRC生成模块相同。
      地址识别模块用于决定是否接收收到的帧,接收模块首先接收输入帧而不管目的地址,随后由地址识别模块检查帧中的目的地址。若MAC被设置为混杂模式(Promiscuous mode)且目的地址为广播地址,同时允许接收广播帧,帧则被接收。否则,帧被丢弃。
      接收计数器模块由字节计数器(Bytecnt)和帧间间隙计数器(IFGcnt)组成。字节计数器在接收帧过程中将对字节进行计数,以用于识别 帧中的各个字段(前序码、目的地址字段、数据、FCS等)以及判断超长帧。帧间间隙计数器则对两帧之间的间隔时间进行计数,以用于判断下一帧数据的开始。 IEEE 802.3规定,两帧之间的间隔至少必须为96个比特时间(10 Mbps中为9 600ns,100 Mbps中为960 ns)。如果两帧之间的间隔小于要求,帧将被丢弃。
      接收状态机为接收模块的核心,用于控制整个接收过程。接收状态机由Idle_State、Drop_State、Preamble_State、 SFD_State、 Da-ta0_State、Data1_State等六个状态组成。
      系统复位后,状态机处于Drop_State。如果此时MII的数据有效信号(MRxDV)无效,状态机马上进入Idle_State状态,并一直处于Idle等待接收输入帧。
      当接收模块检测到数据有效信号之后,状态机将进入Preamble_State,并开始接收前序码。此后再状态机进入SFD_State,接收 一个字节的帧起始定界符,之后,根据IFGcnt计数器的值进入不同的状态。如果,IFGcnt所确定的时间大于96个比特时间,状态机将进入Data0 状态以接收字节的低4位,然后是Data1状态,并接收字节的高4位,之后又回到Data0状态。状态机就一直在这两个状态之间循环,直到数据接收完毕 (PHY清除MRxDV信号)后进入Idle,以重新等待接收新的数据;如果接收到帧起始定界符时,IFGcnt计数器所确定的时间小于96个比特时间, 那么状态机将进入Drop_State状态,并一直维持该状态直到数据有效信号结束(PHY清除MRxDV信号)。之后,状态机再同到Idle等待接收新 的数据。
      如果在接收前序码、帧起始定界符和数据期间,数据有效信号被清除,那么,状态机将回到Idle。

    MII管理模块

      MII管理模块用于控制MAC与外部PHY之间的接口,以用于对PHY进行配置并读取其状态信息。该接口由时钟信号MDC和双向数据信号MDIO组成。MII管理模块则由时钟生成模块、移位寄存器模块和输出控制模块三部分组成。
      时钟生成模块可以根据系统时钟和系统设置中的分频系数来产生MII管理模块的时钟信号MDC(10 Mbps速率时为2.5 MHz,100 Mbps速率时为25 MHz)。
      移位寄存器模块既可用于对PHY的控制数据进行写入操作,也可用于对PHY的状态信息进行读出操作。写控制数据时,移位寄存器根据其他模块的控 制信号将并行控制数据转换为串行数据;而在读状态信息时,移位寄存器则将PHY的串行数据转换为并行数据,MAC中的其他模块可将该并行数据写入适当的寄 存器。
      由于MDIO是双向信号,因此,输出控制模块就用来决定MDIO是处于输入状态还是输出状态。当MDIO处于输出状态时,移位寄存器输出的串行控制数据在经过时钟同步后发送到PHY;当MDIO处于输入状态时,移位寄存器将数据线上的串行数据转换为并行数据。

    主机接口模块

      主机接口是运行以太网的上层协议(如TCP/IP协议)与MAC控制器的接口。通过该接口,上层协议可以设置MAC的工作模式并读取MAC的状态信息。该接口还可用于上层协议与MAC之间的数据交换。
      主机接口模块内有一组寄存器,可用于存储上层协议对MAC设置的参数以及MAC的状态信息。上层协议对MAC设置的参数包括接收超短帧的使能、 添加填充码使能、持发送超长帧的使能、添加CRC校验值使能、全双工模式或半双工模式、持超长延迟(Defer)使能、混杂模式 (Promiscuous)、接收广播帧使能、发送和接收使能、中断源和中断使能、帧间间隙的长度、最大帧和最小帧的长度、重试限制和冲突时间窗、MII 地址和MII控制命令、接收和发送队列的长度以及本机MAC地址等。
      上层协议通过MAC发送和接收数据的操作主要由主机接口模块内的两个队列来进行管理,这两个队列用于对等待发送的多个帧和接收到的多个帧进行排队。
      发送队列主要记录等待发送的帧的相关信息、发送该帧时对MAC的设置以及该帧发送完之后产生的状态信息。帧的相关信息包括帧的长度、帧在外部存 储器中的地址、该帧是否准备好发送以及队列中是否还有其它帧等待发送;对MAC的设置则包括中断使能、填充使能、CRC使能;产生的状态信息包括成功发送 之前的重试次数、由于达到重试限制而放弃发送、发送时产生的滞后冲突以及成功发送之前发生过的延迟。
      接收队列主要对接收到的数据帧进行排队并记录每个接收到的帧信息。这些信息包括帧的长度、是控制帧还是普通数据帧、帧中包含无效符号、接收到的 帧太长或太短、发生CRC错误、接收的过程中发生滞后冲突、帧是否接收完、队列中是否还有其它已接收到的帧以及帧存储在外部存储器中的地址等。该位同时队 列中还有针对每个帧的设置位,用来设置是否在接收到帧时产生中断。
      发送队列和接收队列的长度都可以在控制寄存器中进行设置。

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  • 随着汽车互联网时代的来临,消费者对驾驶连接性的... 目前,市场对汽车以太网节点的开发需求不断增长,相应的测试需求也呈上升趋势,以下与大家共同分享“关于汽车以太网物理测试领域的方式方法及其内容”。 ...

      随着汽车互联网时代的来临,消费者对驾驶连接性的体验度日益关注,导致了人们对汽车通讯数据传输速度的要求不断提高,因此各种新车载通讯技术也应运而生。其中,汽车以太网因成熟的设计开发技术以及网联智能化等优势,正在被越来越多的OEM所关注,且逐步应用于各类最新车型中。

     

    (BroadR-Reach: 单对绞线车载以太网)

     

           目前,市场对汽车以太网节点的开发需求不断增长,相应的测试需求也呈上升趋势,以下与大家共同分享“关于汽车以太网物理层测试领域的方式方法及其内容”。

           物理层是OSI七层模型的最底层,也是汽车以太网与传统以太网区别最大的地方。汽车以太网的物理层采用了单线对以太网联盟(One-pair Ethernet Alliance,OPEN)的标准化BroadR-Reach技术,使用非屏蔽双绞线,实现了100Mbit/s的数据传输速率。

     

           单线对以太网联盟(One-pair Ethernet Alliance,OPEN)制定了汽车以太网控制器测试规范TC8,该规范对汽车以太网各层测试给出了建议性的测试项与测试要求,其中物理层的测试相关内容主要可分为IOP(Interoperability Tests)测试和PMA(Physical Medium Attachment)测试。

     

    IOP测试

     

    1)Link-up time连接时间测试

    ➢测试目的:测试DUT与连接伙伴建立连接的时间,判断该时间是否在给定的时间范围内。

    ➢测试项目:

    • Power on Link Partner连接伙伴上电后建立连接

    • Power on DUT被测件上电后建立连接

    • Wake up DUT被测件被唤醒建立连接

    ➢测试方法:

     

    (表中的图片来自于TC8)

     

    2)Signal Quality信号质量测试

    ➢测试目的:测试DUT的信号质量指标值是否与真实信号质量相一致。

    ➢测试项目:

    • Decreasing quality降低信号质量

    • Increasing quality提高信号质量

    ➢测试方法:

    (表中的图片来自于TC8)

     

    3)Cable diagnostics线缆诊断测试

    ➢测试目的:验证DUT能否准确地检测到线缆的开路或短路故障。

    ➢测试项目:

    • Cable diagnostics for open线缆开路故障诊断

    • Cable diagnostics for short线缆短路故障诊断

    ➢测试方法:

    (表中的图片来自于TC8)

     

    PMA测试

     

     

    Transmitter Electrical Specifications测试收发器电气规范

    ➢测试目的:从DUT层面评估收发器物理层接口是否满足要求。

    ➢测试项目:

    • Check the Transmitter output droop信号电压衰减测试

    • Check the Transmitter Timing Jitter in MASTER Mode信号抖动测试

    • Check the Transmit Clock Frequency传输时钟频率测试

    • Transmitter Power Spectral Density信号功率谱测试

    • Check MDI return Loss回波损耗测试

    • Check MDI Mode conversion模式转换测试

    • Check MDI Common Mode emission共模辐射测试

    • Check the Transmitter Distortion干扰测试

    ➢测试方法:

    (表中的图片来自于TC8)

     

    由于篇幅有限,本次分享只描述了汽车以太网物理层测试的大概内容与方法,需要了解更深入信息的可查阅TC8测试规范,欢迎大家踊跃留言交流。

    参考文献:OPEN Alliance Automotive Ethernet ECU Test Specification,version  2.0, 2017

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    千次阅读 2019-05-20 22:25:00
    以太网中的MAC帧的格式与各字段的作用为:前导码(7字节):使接收器建立比特同步起始定界符SFD(1字节):指示一帧的开始目的地址DA(6字节):指出要接收该帧的工作站源地址SA(6字节):指示发送该帧的工作站地址...
  • 以太网链路帧格式分析实验 一.实验名称  以太网链路帧格式分析实验 二.环境  Windows7操作系统的电脑两台,IP地址分别为172.22.10.33和172.22.10.30。 三.实验目的  了解EthernetV2 标准规定的MAC帧结构,...
  • 1) 物理各子功能 Reconciliation Sublayer (RS):  协调子。汇聚功能,使不同介质类型对MAC子透明 Medium Independent Interface (MII):  介质无关接口。提供公共接口,屏蔽这些物理的不同细节...
  • 网络(IP协议,ICMP) 数据链路以太网协议)
  • 关于以太网数据链路长度大小 以太网一包数据:总长度为1518,带Vlan的为1522,4个字节Vlan Tag在类型之前 带Vlan
  • 这样说其实不太准确,因为以太网协议是一个规定数据链路及物理的协议,不能说它是数据链路的一个协议。 以太网以太网帧就是将网络交付的数据添加报头信息后,此时的数据以帧的形式传递。以太网帧的格式...
  • 以太网数据链路协议分析

    千次阅读 2015-07-30 21:09:29
    其他局域网,比如令牌环网、F D D I和R S-2 3 2串行线路采用的是不一样的技术,因此数据链路的协议也不一致。比如PPP和SLIP就是适用于串行线路的。另外PPPOE是在以太网的基础上封装了PPP协议,方便运营商计费和...
  • 层以太网端口类型

    千次阅读 2018-12-11 10:07:24
    在华为交换机中主要包括:Access(访问)、Trunk(干道)和Hybrid(混合)、QinQ这四种二层以太网端口。在本节介绍的基于端口VLAN划分方式中可以把前三种二交换机以太网端口加入到特定的VLAN中,但是其它所有VLAN...

空空如也

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