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    单片机复位电路的作用是:使单片机的状态处于初始化状态,让单片机的程序从头开始执行,运行时钟处于稳定状态、各种寄存器、端口处于初始化状态等等。目的是让单片机能够稳定、正确的从头开始执行程序。

    单片机有两种复位方式:一是高电平复位,二是低电平复位。基本上所有单片机都有一个复位端口(随着单片机技术的发展,现在有些单片机内部集成了复位电路,这样它的复位端口有可能和I/O端口等复用)。简单讲就是给单片机的复位端口施加一定时间的高电平(或者低电平),单片机就能完成初始化过程,从头开始执行程序。这个时间就称为复位时间,一般单片机的复位时间都很短,不过每种单片机的复位时间都不等,这个就需要查阅相应单片机的数据手册来获得该种单片机的复位时间。需要注意的是,单片机复位后,一定要给单片机的复位端口施加单片机正常工作时的电平,例如对于低电平的复位电路,复位后,复位端口应当处于高电平状态。

    小诀窍:对于单片机是高电平还是低电平复位,我们可以通过观察单片机的引脚图进行一个直观的判断,当单片机引脚图中复位端口的名称上面有一个“-”时,该单片机就是低电平复位,没有“-”时,该单片机就是高电平复位,例如单片机端口名称是RST,那它是高电平复位,是/RST(/是上划线)时,它是低电平复位

    刚才我们已经说过,现在已经有很多单片机内部集成了复位电路。那么我们在进行这种单片机电路设计的时候,就不用再单独设计复位电路了。

    下面来介绍几种常用复位电路。

    1、上电复位电路

    单片机的复位有高电平复位和低电平复位的区别,那就自然有高电平复位电路和低电平复位电路两种。

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    图1 上电复位电路

    图1左边的电路是高电平复位电路。

    这个电路是利用电容的充电来实现复位的,当电源接通的瞬间,单片机复位端的电位与VCC相同,随着充电电流的减少,复位端的电位逐渐下降。直至电容充满电,复位端的电压变为低电平。

    电路中R和C的值可以根据下面的式子计算,其中T是复位时间。

    T=(1/9)*R1*C1

    图1右边的电路是低电平复位电路

    该电路的复位原理跟高电平复位电路的原理相反,这里就不多说了。

    同样的,低电平复位电路中R和C的值可以根据下面的式子计算得出,其中T是复位时间。

    T=9*RC

    2、按键复位电路

    前面介绍的上电复位电路只能在单片机电路上电后,自动完成高电平复位或低电平复位,但是如果在单片机运行过程中,强制让单片机复位该怎么做呢?最简单的方法是通过按键实现:按下按键,单片机立马停止当前正在执行的操作,进入复位状态,然后从头开始运行。

    图2左边是高电平按键复位电路,右边是低电平按键复位电路。

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    图2 按键复位电路

    对于高电平复位电路,当按下复位按键时,复位端被直接拉到高电平,使单片机复位。而对于低电平复位电路,按下复位键后,复位端被直接拉到地端,使单片机复位。

    3、改进后的按键复位电路

    上面的按键复位电路有一个缺点:当电源因某种干扰瞬间断电时,由于C不能迅速将电荷放掉,待电源恢复时,单片机不能上电自动复位,导致程序运行失控。电源瞬间断电干扰会导致程序停止正常运行,形成程序“乱飞”或进入“死循环”。

    所以有了下面这个增加了二极管的复位电路。如图3所示。

    24d5ddfd4548a51850d246c34a3d7cb4.png

    图3 改进后的按键复位电路

    如果有了这个二极管就可以快速将电容上的电压释放,保证复位信号正确无误。也能快速为下次复位做好准备。

    4、专用复位芯片

    随着单片机系统越来越复杂,应用环境越来越多样化,单纯的RC复位电路已经不能确保单片机的正确复位,复位芯片也就应运而生。下图是一种复位芯片的应用电路。可以看出,复位芯片使用起来非常简单。

    50c540779b8f4046f242a4a6cc21c7a7.png

    图4 复位芯片应用电路

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    图5 复位芯片应用电路

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  • TMS320F28335的时钟介绍

    千次阅读 2011-06-22 00:04:00
    TMS320F28335的时钟介绍  TMS320F28335上有一个基于PLL电路的片上时钟模块,为CPU及外设提供时钟有两种方式:一种是用外部的时钟源,将其连接到X1引脚上或者XCLKIN引脚上,X2接地;另一种是使用振荡器产生时钟,用...

    TMS320F28335的时钟介绍

     

    TMS320F28335上有一个基于PLL电路的片上时钟模块,为CPU及外设提供时钟有两种方式:一种是用外部的时钟源,将其连接到X1引脚上或者XCLKIN引脚上,X2接地;另一种是使用振荡器产生时钟,用30MHz的晶体和两个20PF的电容组成的电路分别连接到X1X2引脚上,XCLKIN引脚接地。我们常用第二种来产生时钟。此时钟将通过一个内部PLL锁相环电路,进行倍频。由于F28335的最大工作频率是150M,所以倍频值最大5。其中倍频值由PLLCR的低四位和PLLSTS的第78位来决定。其详细的倍频值可以参照TMS320F28335Datasheet。下面是F28335的时钟设置:

     

    void InitPll(Uint16 val, Uint16 divsel)

    {

     

    // Make sure the PLL is not running in limp mode

       if (SysCtrlRegs.PLLSTS.bit.MCLKSTS != 0)

       {

          // Missing external clock has been detected

          // Replace this line with a call to an appropriate

          // SystemShutdown(); function.

          asm("        ESTOP0");

       }

     

       // DIVSEL MUST be 0 before PLLCR can be changed from

       // 0x0000. It is set to 0 by an external reset XRSn

       // This puts us in 1/4

       if (SysCtrlRegs.PLLSTS.bit.DIVSEL != 0)

       {

           EALLOW;

           SysCtrlRegs.PLLSTS.bit.DIVSEL = 0;

           EDIS;

       }

     

       // Change the PLLCR

       if (SysCtrlRegs.PLLCR.bit.DIV != val)

       {

     

          EALLOW;

          // Before setting PLLCR turn off missing clock detect logic

          SysCtrlRegs.PLLSTS.bit.MCLKOFF = 1;

          SysCtrlRegs.PLLCR.bit.DIV = val;

          EDIS;

     

          // Optional: Wait for PLL to lock.

          // During this time the CPU will switch to OSCCLK/2 until

          // the PLL is stable.  Once the PLL is stable the CPU will

          // switch to the new PLL value.

          //

          // This time-to-lock is monitored by a PLL lock counter.

          //

          // Code is not required to sit and wait for the PLL to lock.

          // However, if the code does anything that is timing critical,

          // and requires the correct clock be locked, then it is best to

          // wait until this switching has completed.

     

          // Wait for the PLL lock bit to be set.

     

          // The watchdog should be disabled before this loop, or fed within

          // the loop via ServiceDog().

     

       // Uncomment to disable the watchdog

          DisableDog();

     

          while(SysCtrlRegs.PLLSTS.bit.PLLLOCKS != 1)

          {

           // Uncomment to service the watchdog

              // ServiceDog();

          }

     

          EALLOW;

          SysCtrlRegs.PLLSTS.bit.MCLKOFF = 0;

          EDIS;

        }

     

        // If switching to 1/2

    if((divsel == 1)||(divsel == 2))

    {

      EALLOW;

         SysCtrlRegs.PLLSTS.bit.DIVSEL = divsel;

         EDIS;

    }

     

    // If switching to 1/1

    // * First go to 1/2 and let the power settle

    //   The time required will depend on the system, this is only an example

    // * Then switch to 1/1

    if(divsel == 3)

    {

      EALLOW;

         SysCtrlRegs.PLLSTS.bit.DIVSEL = 2;

         DELAY_US(50L);

         SysCtrlRegs.PLLSTS.bit.DIVSEL = 3;

         EDIS;

        }

    }

     

    如果我们希望DSP工作在某一个频率下,我们就可以对Uint16 val, Uint16 divsel两个参数进行设定。

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  • SPI是单片机外设电路常用的通讯方式,适用于近距离通信,通常用于芯片间的通讯,四根线。在SPI通讯中总线时钟和总线相位也个比较重要的概念,一般在使用SPI通信时都使用默认设置,所以容易把这个参数...
    0a88244af6d90cf98ccc88cfcb365ccf.png本文为“玩转嵌入式”原创文章,如果您想转载,可以联系我获取白名单授权,感谢支持。SPI是单片机外设电路中常用的一种通讯方式,适用于近距离通信,通常用于芯片间的通讯,有四根线。在SPI通讯中总线时钟和总线相位也两个比较重要的概念,一般在使用SPI通信时都使用默认设置,所以容易把这两个参数忽略。和大家分享一下SPI通讯、时钟极性以及时钟相位的基础知识。什么是SPI通讯总线SPI总线的英文全称为S“Serial Periphral Interface”,意思是串行外设接口,由于通讯距离比较短,适用于芯片级别的短距离通讯。SPI的通讯分为主机和从机,属于高速全双工的总线通讯方式,SPI有四根线,分别为:
    • MISO:主设备输入与从设备输出线;
    • MOSI:主设备输出与从设备输入线;
    • SCK:串行同步时钟信号线;
    • SS:从机片选信号线,也用CS来表示。
    SPI总线的主机和从机的系统连接图如下图所示。

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    SPI总线时钟的极性含义解释SPI的时钟极性用CPOL来表示。SPI总线通讯的时基基准是时钟信号线SCK,SCK既有高电平,又有低电平,SPI的时钟极性用来表示时钟信号在空闲时是高电平还是低电平。情况说明如下:
    • 当CPOL=0:SCK信号线在空闲时为低电平
    • 当CPOL=1:SCK信号线在空闲时为高电平
    SPI总线时钟的相位含义解释时钟的相位用CPHA来表示,用来决定何时进行信号采样,在第一个跳变沿还是第二个跳变沿,至于是上升沿还是下降沿则由CPOL相位极性来表示。下面分两种情况来介绍。如下图所示。

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    上图表示CPHA=1时的情形,即在SCK时钟的第二个边沿进行数据的采样,至于是上升沿采样还是下降沿采样取决于时钟极性CPOL的值。如果CPHA=1,CPOL=1,则在SCK时钟的第二个边沿上升沿时进行数据采样。如果CPHA=1,CPOL=0,则在SCK时钟的第二个边沿下降沿时进行数据采样。CPHA=0时的情形如下图所示。

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    上图表示CPHA=0时的情形,即在SCK时钟的第一个边沿进行数据的采样,至于是上升沿采样还是下降沿采样取决于时钟极性CPOL的值。如果CPHA=0,CPOL=1,则在SCK时钟的第一个边沿下降沿时进行数据采样。如果CPHA=0,CPOL=0,则在SCK时钟的第一个边沿上升沿时进行数据采样。总结一下,SPI的时钟极性决定了SCK在空闲时是低电平还是高电平;而相位极性则决定了在第一个边沿还是第二个边沿进行数据采样。SPI的时钟极性CPOL和相位极性CPHA是相互影响相互决定的,以上概念可能很绕口难以理解,但是对SPI进行一次编程之后,所有的内容都好理解了。相关文章推荐:

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    CPOL   脉冲传输前和完成后保持的状态  0:低电平 1:高电平
    CPHA   0:第一边沿采样数据,第二边沿输出数据
                 1:第一边沿输出数据,第二边沿采样数据

    //SPI模拟读写   
    //CPOL : 0  
    //CPHA : 0
    u8 SPI_ReadWrite(u8 Wdat)
    {
      u8 i=0;
      u8 dat = 0;
      for(i=0;i<8;i++)
      {
        if(Wdat&0x80){SIO = 1;}else{SIO = 0;}
    	SCK = 1;         //第一边沿(采样数据)
        Wdat<<= 1;
        dat <<= 1;
    	if(SIO == 1){
    		dat++;
    	}
    	SCK = 0;         //第二边沿(输出数据)   
      }
      return dat;
    }

    SPI是单片机外设电路中常用的一种通讯方式,适用于近距离通信,通常用于芯片间的通讯,有四根线。在SPI通讯中总线时钟和总线相位也两个比较重要的概念,一般在使用SPI通信时都使用默认设置,所以容易把这两个参数忽略。和大家分享一下SPI通讯、时钟极性以及时钟相位的基础知识。

    什么是SPI通讯总线

    SPI总线的英文全称为S“Serial Periphral Interface”,意思是串行外设接口,由于通讯距离比较短,适用于芯片级别的短距离通讯。SPI的通讯分为主机和从机,属于高速全双工的总线通讯方式,SPI有四根线,分别为:

    • MISO:主设备输入与从设备输出线;

    • MOSI:主设备输出与从设备输入线;

    • SCK:串行同步时钟信号线;

    • SS:从机片选信号线,也用CS来表示。

    SPI总线的主机和从机的系统连接图如下图所示。

    SPI总线时钟的极性含义解释

    SPI的时钟极性用CPOL来表示。SPI总线通讯的时基基准是时钟信号线SCK,SCK既有高电平,又有低电平,SPI的时钟极性用来表示时钟信号在空闲时是高电平还是低电平。情况说明如下:

    • 当CPOL=0:SCK信号线在空闲时为低电平;

    • 当CPOL=1:SCK信号线在空闲时为高电平;

     

    SPI总线时钟的相位含义解释

     

    时钟的相位用CPHA来表示,用来决定何时进行信号采样,在第一个跳变沿还是第二个跳变沿,至于是上升沿还是下降沿则由CPOL相位极性来表示。下面分两种情况来介绍。如下图所示。

    上图表示CPHA=1时的情形,即在SCK时钟的第二个边沿进行数据的采样,至于是上升沿采样还是下降沿采样取决于时钟极性CPOL的值。如果CPHA=1,CPOL=1,则在SCK时钟的第二个边沿为上升沿时进行数据采样。如果CPHA=1,CPOL=0,则在SCK时钟的第二个边沿为下降沿时进行数据采样。

    CPHA=0时的情形如下图所示。

    上图表示CPHA=0时的情形,即在SCK时钟的第一个边沿进行数据的采样,至于是上升沿采样还是下降沿采样取决于时钟极性CPOL的值。如果CPHA=0,CPOL=1,则在SCK时钟的第一个边沿为下降沿时进行数据采样。如果CPHA=0,CPOL=0,则在SCK时钟的第一个边沿为上升沿时进行数据采样。

    总结一下,SPI的时钟极性决定了SCK在空闲时是低电平还是高电平;而相位极性则决定了在第一个边沿还是第二个边沿进行数据采样。SPI的时钟极性CPOL和相位极性CPHA是相互影响相互决定的,以上概念可能很绕口难以理解,但是对SPI进行一次编程之后,所有的内容都好理解了。

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