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  • 导读:数字系统中可对二进制数据进行存储的是存储器,FIFO、RAM等位于集成电路中可完成存储功能的是存储器,TF条、内存条存储设备也是存储器。存储器已广泛存在于我们的生活中且为我们的生活提供诸多便利,接下来...

    导读:数字系统中可对二进制数据进行存储的是存储器,FIFO、RAM等位于集成电路中可完成存储功能的是存储器,TF条、内存条等存储设备也是存储器。存储器已广泛存在于我们的生活中且为我们的生活提供诸多便利,接下来我们就一起来了解一下其工作原理到底是什么样子的吧~本文引用地址:http://www.eepw.com.cn/article/276330.htm

    一、存储器原理- -简介

    存储器,英文名称为Memory,顾名思义,是一种用于存储信息的仪器,常用于计算机中的数据储存,计算机工作所需的所有数据都被存储在存储器中,包含原始数据、计算过程中所产生数据、计算所需程序、计算最终结果数据等等。存储器的存在才使得计算机有了超强的记忆能力。

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    二、存储器原理- -分类

    存储器根据不同的分类条件具有多种分类方式,其根据用途的不同可以分为内存(主存储器)和外存(辅助存储器);其根据存储介质的不同可分为磁表面存储器和半导体存储器;其根据存储方式的不同可分为顺序存储器和随机存储器;其根据读写功能的不同可分为RAM(随机读写存储器)和ROM(只读存储器);其根据数据保存时间长短可分为永久记忆性存储器和非永久记忆性存储器。

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    三、存储器原理- -结构

    存储器的基本单位为存储元,可完成对二进制代码的存储;若干存储元构成存储单元,存储单元中有一个存储元用于存储地址,其它存储元用于存放字节数据;若干存储单元构成存储器,完成对任意数据的存储。

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    四、存储器原理

    接下来我们以DRAM(动态存储器)为例来讲解存储器的工作原理。

    对动态存储器进行写入操作时,行地址首先将RAS锁存于芯片中,然后列地址将CAS锁存于芯片中,WE有效,写入数据,则写入的数据被存储于指定的单元中。

    对动态存储器进行读出操作时,CPU首先输出RAS锁存信号,获得数据存储单元的行地址,然后输出CAS锁存信号,获得数据存储单元的列地址,保持WE=1,便可将已知行列地址的存储单元中数据读取出来。

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    主存存取原理

    目前计算机使用的主存基本都是随机读写存储器(RAM),现代RAM的结构和存取原理比较复杂,这里本文抛却具体差别,抽象出一个十分简单的存取模型来说明RAM的工作原理。

    图5

    从抽象角度看,主存是一系列的存储单元组成的矩阵,每个存储单元存储固定大小的数据。每个存储单元有唯一的地址,现代主存的编址规则比较复杂,这里将其简化成一个二维地址:通过一个行地址和一个列地址可以唯一定位到一个存储单元。图5展示了一个4 x 4的主存模型。

    主存的存取过程如下:

    当系统需要读取主存时,则将地址信号放到地址总线上传给主存,主存读到地址信号后,解析信号并定位到指定存储单元,然后将此存储单元数据放到数据总线上,供其它部件读取。

    写主存的过程类似,系统将要写入单元地址和数据分别放在地址总线和数据总线上,主存读取两个总线的内容,做相应的写操作。

    这里可以看出,主存存取的时间仅与存取次数呈线性关系,因为不存在机械操作,两次存取的数据的“距离”不会对时间有任何影响,例如,先取A0再取A1和先取A0再取D3的时间消耗是一样的。

    磁盘存取原理

    上文说过,索引一般以文件形式存储在磁盘上,索引检索需要磁盘I/O操作。与主存不同,磁盘I/O存在机械运动耗费,因此磁盘I/O的时间消耗是巨大的。

    图6是磁盘的整体结构示意图。


    图6

    一个磁盘由大小相同且同轴的圆形盘片组成,磁盘可以转动(各个磁盘必须同步转动)。在磁盘的一侧有磁头支架,磁头支架固定了一组磁头,每个磁头负责存取一个磁盘的内容。磁头不能转动,但是可以沿磁盘半径方向运动(实际是斜切向运动),每个磁头同一时刻也必须是同轴的,即从正上方向下看,所有磁头任何 时候都是重叠的(不过目前已经有多磁头独立技术,可不受此限制)。

    图7是磁盘结构的示意图。


    图7

    盘片被划分成一系列同心环,圆心是盘片中心,每个同心环叫做一个磁道,所有半径相同的磁道组成一个柱面。磁道被沿半径线划分成一个个小的段,每个段叫做一个扇区,每个扇区是磁盘的最小存储单元。为了简单起见,我们下面假设磁盘只有一个盘片和一个磁头。

    当需要从磁盘读取数据时,系统会将数据逻辑地址传给磁盘,磁盘的控制电路按照寻址逻辑将逻辑地址翻译成物理地址,即确定要读的数据在哪个磁道,哪个扇区。为了读取这个扇区的数据,需要将磁头放到这个扇区上方,为了实现这一点,磁头需要移动对准相应磁道,这个过程叫做寻道,所耗费时间叫做寻道时间,然 后磁盘旋转将目标扇区旋转到磁头下,这个过程耗费的时间叫做旋转时间。

    局部性原理与磁盘预读

    由于存储介质的特性,磁盘本身存取就比主存慢很多,再加上机械运动耗费,磁盘的存取速度往往是主存的几百分分之一,因此为了提高效率,要尽量减少磁盘I/O。为了达到这个目的,磁盘往往不是严格按需读取,而是每次都会预读,即使只需要一个字节,磁盘也会从这个位置开始,顺序向后读取一定长度的数据放入内存。这样做的理论依据是计算机科学中著名的局部性原理:

    当一个数据被用到时,其附近的数据也通常会马上被使用。

    程序运行期间所需要的数据通常比较集中。

    由于磁盘顺序读取的效率很高(不需要寻道时间,只需很少的旋转时间),因此对于具有局部性的程序来说,预读可以提高I/O效率。

    预读的长度一般为页(page)的整倍数。页是计算机管理存储器的逻辑块,硬件及操作系统往往将主存和磁盘存储区分割为连续的大小相等的块,每个存 储块称为一页(在许多操作系统中,页得大小通常为4k),主存和磁盘以页为单位交换数据。当程序要读取的数据不在主存中时,会触发一个缺页异常,此时系统 会向磁盘发出读盘信号,磁盘会找到数据的起始位置并向后连续读取一页或几页载入内存中,然后异常返回,程序继续运行。

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          内存屏障是一个很晦涩的概念,今天为了让大家彻底了解在高级并发里面的这个高级主题,我们从系统层面向大家讲解内存屏障的原理、种类、应用, 下面的内容可能牵涉的东西比较多并且比较长,但是如果你耐心的看完,并且完全的吸纳,那么你就会真正的了解内存屏障!

     

    1 速度不对等

     Cpu的速度比cpu之间的互联性能及cpu试图要访问的内存性能,都要快上几个数量级

    上面展示的图显示现代处理器基本都是多核,并且每个cpu都有自己独立的cache,不同cpu共享主内存,然后不同cpu通过总线互联,cpu -> cache -> memory 访问速度成大数量级递减,cpu最快,cache慢一点,memory更慢。

     

    MESI协议

    cpu从内存中加载数据到自己的cache,当不同的cpu都加载了同样的内存数据的时候,并且对数据进行操作的时候,需要维护数据在不同的cache 中的一致性视图就需要MESI协议,cache里面的缓存行有四种状态分别是Modified,Exclusive,Shared,Invalid。协议在每一个缓存行中维护 一个两位的状态“tag”这个“tag”附着在缓存行的物理地址或者数据后 ,标识着缓存行的状态

    Modified  修改的

    Exclusive  独占

    Shared  共享

    Invalid   无效

        Modified: 处于“modified”状态的缓存行是由于相应的 CPU 最近进行了内存存储。并 且相应的内存确保没有在其他 CPU 的缓存中出现。因此,“modified”状态的缓 存行可以被认为被 CPU 所“owned”由于缓存保存了最新的数据,因此缓存最 终有责任将数据写回到内存,并且也应当为其他缓存提供数据,必须在当前缓存 缓存其他数据之前完成这些事情。

        Exclusive: 状态非常类似于“modified”状态,唯一的例外是缓存行还没 有被相应的 CPU 修改,这表示缓存行中的数据及内存中的数据都是最新的。但 是,由于 CPU 能够在任何时刻将数据保存到该行,而不考虑其他 CPU处于 exclusive 状态也可以认为被相应的 CPU 所“owned”也就是说,由于内存 中的值是最新的,该行可以直接丢弃而不用回写到内存,也可以为其他缓存提供 数据。

        Shared:  处于“shared”状态的缓存行可能被复制到至少一个其他 CPU 缓存中,这样 在没有得到其他 CPU 的许可时,不能向缓存行存储数据。由于“exclusive”状 态下,内存中的值是最新的,因此可以不用向内存回写值而直接丢弃缓存中的值, 或者向其他 CPU 提供值。

        Invalid:  处于“invalid”状态的行是空的,换句话说,它没有保存任何有效数据。当 新数据进入缓存时,它替换一个处于“invalid”状态的缓存行。这个方法是比较 好的,因为替换其他状态的缓存行将引起大量的 cache miss

     

    如果上面的文字你都认真看完了,可能有点绕,不过没关系,我们只需要了解这四种状态仅仅是标识出当前在cache里面的缓存行的数据是处于一个什么样的状态,并且下面会简单的介绍通过发送MESI消息来改变这种缓存行的状态

        缓存一致性消息:

        由于所有 CPUs 必须维护缓存行中的数据一致性视图,因此缓存一致性协议 提供消息以调整系统缓存行的运行。

    MESI 协议消息 :

    Read:“read消息包含缓存行需要读的物理地址。

    Read Response:“read response”消息包含较早前的“read”消息的数据。 这个“read response”消息可能由内存或者其他缓存提供。例如,如果 一个缓存请求一个处于“modified”状态的数据,则缓存必须提供“read response”消息。

    Invalidate“invalidate消息包含要使无效的缓存行的物理地址。其他的 缓存必须从它们的缓存中移除相应的数据并且响应此消息。

    Invalidate Acknowledge:一个接收到“invalidate”消息的 CPU 必须在移 除指定数据后响应一个“invalidate acknowledge”消息。

    Read Invalidate:“read invalidate”消息包含要缓存行读取的物理地址。 同时指示其他缓存移除数据。因此,它包含一个“read”和一个 “invalidate”。“read invalidate”也需要“read response”以及“invalidate acknowledge”消息集。

    Writeback:“writeback消息包含要回写到内存的地址和数据。(并且也 许会“snooped”其他 CPUs 的缓存)。这个消息允许缓存在必要时换出 “modified”状态的数据以腾出空间。

        ok,我们不用太纠结这些消息,毕竟它看上去实在太枯燥了,我们只需要了解它大概的用途,说了这么多,下面内存屏障要出马了

    未完!

    在上面的理论储备下,第一个存在的问题 存储导致的停顿

     

    在这个动作中,为了解决这种停顿的性能损耗我们cpu的设计引入了一种机制叫做 存储缓冲    

    避免这种不必要的写延迟的方法之一,就是在每个 CPU 和它的缓存之间, 增加“store buffers”。通过增加这些存储缓冲区,CPU0 可能简单的将 要保存的数据放到存储缓冲区中,并且继续执行。当缓存行最后从 cpu1 转到 CPU0 时,数据将从存储缓冲区转到缓存行中。    

     

    在引入了存储缓冲区之后又会带来新的问题,我们看以下代码验证失败的情况

     

    //变量a,b初始化为0,
    void foo(void)               
    { 
      a = 1; 
      b = 1; 
    }
    
    void bar(void)               
    { 
      while (b == 0) continue; 
      assert(a == 1); 
    }
    
    
    
    

     

    验证失败

    CPU 0 执行 a = 1。缓存行不在 CPU0 的缓存中,因此 CPU0 将“a”的新值 放到存储缓冲区,并发送一个“read invalidate”消息。 
    CPU 1 执行 while (b == 0) continue,但是包含“b”的缓存行不在缓存中, 它发送一个“read”消息。 
    CPU 0 执行 b = 1,它已经在缓存行中有“b”的值了 (换句话说,缓存行已 经处于“modified”或者“exclusive”状态),因此它存储新的“b”值在它的缓 存行中。 
    CPU 0 接收到“read”消息,并且发送缓存行中的新的“b”的值 1,同时 将缓存行设置为“shared”状态。 
    CPU 1 接收到包含“b”值的缓存行,并将其值写到它的缓存行中。 
    CPU 1 现在完成执行 while (b == 0) continue, 由于它发现“b”的值是 1, 它开始处理下一条语句。 
    CPU 1 执行 assert(a == 1),并且, 由于 CPU 1 工作在旧的“a”的值,因此 验证失败。 
    CPU 1 接收到“read invalidate”消息, 并且发送包含“a”的缓存行到 CPU0, 同时使它的缓存行变成无效。但是已经太迟了。 
    CPU 0 接收到包含“a”的缓存行,将且将存储缓冲区的数据保存到缓存行 中,这使得 CPU1 验证失败。 
    

               结果是验证失败了,但是这和我们看到的,和预想的逻辑是不一样的,那怎么解决这个问题 ,引入内存屏障, 内存屏障千呼万唤始出来,只有前面这些铺垫,我们才能真正的理解内存屏障是个啥玩意,它是什么样的条件下产生的,以及他解决了什么问题,我们再看下面这段代码

    void foo(void) { 
      a = 1; 
      smp_mb(); 
      b = 1; 
    } 
    
    void bar(void) 
    { 
      while (b == 0) continue; 
      assert(a == 1); 
     } 
    

    准确的讲,这里需要插入一个写内存屏障,写内存屏障施加的作用就是   

    内存屏障 smp_mb()将导致 CPU 在保存后续的存储操作到缓存行前,刷新它 的存储缓冲区。CPU 可能简单的停下来,直到存储缓冲区变成空,也可能是简 单的使用存储缓冲区保存后续的存储操作,直到前面所有的存储缓冲区已经被保 存到缓存行中。

    然后我们看插入一个写内存屏障之后,cpu的流水线是这样的

    CPU 0 执行 a = 1。缓存行不在缓存中,因此 CPU 0 将“a”的新值放到存 储缓冲区,并发送一个“read invalidate”消息. 
    CPU 1 执行 while (b == 0) continue,但是包含“b”的缓存行不在缓存中, 因此它发送一个“read”消息. 
    CPU 0 执行 smp_mb(),,并标记当前所有存储缓冲区的条目。 (也就是说 a = 1). 
    CPU 0 执行 b = 1。它的缓存行已经存在了。 (也就是说, 缓存行已经处于 “modified”或者“exclusive”状态),但是在存储缓冲区中存在一个标记条目。 因此,它不将新值存放到缓存行,而是存放到存储缓冲区中。 (但是“b”不是 一个标记条目). 
    CPU 0 接收到“read”消息,同时发送包含“b”值的缓存行给 CPU1。它 也标记本地缓存行为“shared”。 
    CPU 1 读取到包含“b”的缓存行,并将它复制到本地缓存中。 
    CPU 1 现在可以装载“b”的值了,但是发现它的值仍然为“0”,因此它重 复该语句。“b”的新值被安全的隐藏在 CPU0 的存储缓冲区中。 
    CPU 1 接收到“read invalidate”消息,并且发送包含“a”的缓存行给 CPU0, 并且使它的缓存行无效。 
    CPU 0 接收到包含“a”的缓存行,并且使用存储缓冲区的值替换缓存行为 “modified”状态。 
    由于被存储的“a”是存储缓冲区中唯一被 smp_mb()标记的条目,因此 CPU0 也能够存储“b”的新值到缓存行中-除非包含“b”的缓存行处于“shared”状态。 
    CPU 0 发送一个“invalidate”消息给 CPU 1。 
    CPU 1 接收到“invalidate”消息,刷新包含“b”的缓存行,并且发送一个 “acknowledgement”消息给 CPU 0. 
    CPU 1 执行 while (b == 0) continue,但是包含“b”的缓存行不在缓存中, 因此它发送一个“read”消息给 CPU 0。 
    CPU 0 接收到“acknowledgement”消息,将包含“b”的缓存行设置成 “exclusive”状态。 CPU 0 现在存储新的“b”值到缓存行。 
    CPU 0 接收到“read”消息,同时发送包含新的“b”值的缓存行给 CPU 1。 它也标记该缓存为“shared”。 
    CPU 1 接收到包含“b”的缓存行,并将它复制到本地缓存中。 
    CPU 1 现在能够装载“b”的值了,由于它发现“b”的值为 1,它退出循环 并执行下一条语句。 
    CPU 1 执行 assert(a == 1),但是包含“b”的缓存行不在它的缓存中。一旦 它从 CPU0 获得这个缓存行,它将使用最新的“a”的值,验证语句将通过。 

      读到这里其实已经很复杂了,上面讲到的写内存屏障这个机制,其实还有一个读内存屏障,读内存屏障标记的是cpu互联模块里面的使无效队列,我们先不列出和读内存屏障相关的cpu流水线,它的原理和写内存屏障类似,下面列出简要的图

     


    在上面讲到的代码中完整的例子应该是这样的

    #如果我们修改 foo 和 bar ,以使用读和写内存屏障,将会是如下所示: 
     void foo(void) 
    { 
      a = 1; 
      smp_wmb(); 
      b = 1; 
    } void bar(void) { 
      while (b == 0) continue; 
      smp_rmb(); 
      assert(a == 1); 
     } 

     

    内存屏障总结

    内存屏障用来标记存储缓冲区和无效队列 
    
    简单的说,一个“读内存屏障” 仅仅标记它的无效队列,一个“写内存屏障”仅仅标记它的存储缓冲区,完整的 内存屏障同时标记无效队列及存储缓存缓冲区。 
    这样的效果是:读内存屏障仅仅保证装载顺序,因此所有在读内存屏障之前 的装载将在所有之后的装载前完成。类似的,写内存屏障仅仅保证写之间的顺序。 完整的内存屏障同时保证写和读之间的顺序。 
    
    
    内存屏障有四个基本变种:
    
    写 (或存储) 内存屏障,
    数据依赖屏障,
    读内存屏障,
    通用内存屏障。

    cpu乱序执行,但是它必须有它基本的规范,就比如我们看到的代码的逻辑,它执行的时候,逻辑也应该是像我们看到的那样,乱序cpu技术规范

    1.每一个 CPU 总是按照编程顺序来感知内存访问。 
    2.仅仅在操作不同地址时,CPUs 才对特定的存储操作进行重新排序。 
    3.一个特定 CPU 在内存屏障之前的所有装载操作 (smp_rmb()) 将被所有随后的读内存屏障后面的操作之前被所有 CPU 所感知
    4.所有在写内存屏障之前的写操作 (smp_wmb()) 都将比随后的写操作先 感知。 
    5.所有在内存屏障之前的内存访问 (装载和存储) (smp_mb())都将比随后的内存访问先感知。

    好了,看到这里,如果你都看明白了,那么恭喜你,内存屏障你大概了解了,内存屏障它的产生背景,以及为了解决什么问题都讲到了,其实整体的逻辑就是为了解决一个问题,采用了一种机制,这个机制又带来新的问题,然后又采用一种机制去解决,如此往复。

     

     

     

     

     

     

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    主要介绍:

    1、内存的分类?

    2、DDR SDRAM内存条的结构?

    3、DDR SDRAM内存的基本工作原理?

    4、DDR SDRAM的主要参数?

    5、内存条的选购

    一、内存的分类:

    1、按内存的工作原理分类

    按内存的工作原理分为:ROM(Read Only Memory,只读存储器)

    RAM(Random Access Memory,随机存储器)。

    这两种基本类型的内存分别有不同的用途,以完成不同的任务。

    (1.)、 ROM

    ROM是一种不靠电源保持数据,只能读取,而不能随意改变内容的内存。

    ROM常用于存储不需要经常更新的重要的信息,ROM中的数据即使断电也不会丢失,例如主板的BIOS。                   根据ROM的工作原理,又分为以下3类。

    (1) ROM(掩模式只读存储器)

    (2) PROM(Programmable ROM,可编程ROM)

    PROM芯片的外观,如图下图所示:

    (3) 多次擦写可编程只读存储器

    这类ROM有三种类型。

    ① EPROM(Erasable Programmable ROM,可擦可编程ROM)

    286、386、486级微机的BIOS采用的就是这种EPROM芯片

    EPROM芯片,如下所示:

    ② EEPROM(Electrically Erasable Programmable ROM,电可擦写可编程ROM)

    主板BIOS EEPROM的容量一般为512Kb~1Mb

    EEPROM芯片,如下所示:

    ③ Flash Memory(闪速存储器)

    主板上BIOS和USB闪存盘上的Flash Memory芯片

    Flash Memory芯片如下所示:

    (2)、 RAM

    根据工作原理和制造技术的不同,RAM又分为:

    (1) SRAM(Static RAM,静态随机存储器)

    (2) DRAM(Dynamic RAM,动态随机存储器)

    2、按内存的外观分类:

    目前微机配件的DRAM有两种形式。

    1. 双列直插封装内存芯片

    DIP芯片一般用于286以下的微机,现在只有在显示卡、硬盘等配件上才能见到它们

    DIP内存芯片:

    2. 内存条(内存模块)

    内存条主要有两种接口类型:SIMM(Single Inline Memory Module,单边接触内存模组),早期的30线、72线        的内存条属于这种接口类型;

    DIMM(Dual Inline Memory Module,双边接触内存模组),

    这种类型接口的内存条的两边都有引脚。168线的SDRAM、184线的DDR SDRAM、240线的DDR2 SDRAM内    存条属于DIMM接口类型。所谓内存条线数即是指引脚数。

    SDRAM内存条用在Pentium II/III级别的微机上,称SDRAM,常见容量有32MB、64MB、128MB和256MB

    SDRAM内存条:

    DDR SDRAM内存条用在Pentium 4级别的微机上,DDR SDRAM有184个接触点,常见容量有128MB、      256MB、512MB等

    DDR SDRAM内存条:

    DDR2 SDRAM内存条用在LGA 775 Pentium 4级别的微机上,DDR2 SDRAM有240个接触点,内存条的SPD芯片与DDR内存不同,通常被安装在内存条的中间位置

    DDR2 SDRAM内存条:

    3、按内存模块的不同标准分类:

    1. SDRAM(Synchronous DRAM,同步动态随机存储器)

    SDRAM的工作频率与系统总线频率是同步的,数据信号在每个脉冲的上升沿处传送出去,    其工作原理示意图

    PC100 SDRAM工作原理示意图:

    2. DDR SDRAM(Dual

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  • 前言:JMM基础-计算机原理 1、物理内存模型带来的问题 2、伪共享 3、Java内存模型(JMM) 4、Java内存模型带来的问题 4.1 可见性问题 4.2 竞争问题 4.3 重排序 5、volatile详解 5.1 volatile特性 5.2 ...
  • C++内存泄露检测原理

    千次阅读 2014-04-29 21:48:27
    本文针对 linux 下的 C++ 程序的...其中包括 C++ 中的 new 和 delete 的基本原理,内 存检测子系统的实现原理和具体方法,以及内存泄漏检测的高级话题。作为内存检测子系统实现的一部分,提供了一个具有更好的
  • SRAM存储原理

    千次阅读 多人点赞 2019-11-19 17:20:13
    概念 静态随机存取存储器(Static Random-Access Memory,SRAM)是随机存取存储器的一种。...然而,当电力供应停止时,SRAM储存的数据还是会消失(被称为volatile memory),这与在断电后还能储存资料的ROM或闪存是...
  • 内存的分配原理

    千次阅读 2012-01-05 09:29:21
    在C++中,内存分成5个区,他们分别是堆、栈、自由存储区、全局/静态存储区和常量存储区。 栈,就是那些由编译器在需要的时候分配,在不需要的时候自动清楚的变量的存储区。里面的变量通常是局部变量、函数参数等。...
  • 磁盘存储原理

    千次阅读 2019-04-19 15:43:14
    磁盘是广泛应用的数据存储设备,存储容量比较大,相比RAM等存储设备价格低,读写速度慢,从磁盘读信息的时间是毫秒级,是DRAM的十万倍,SRAM的一百万倍,后面会对磁盘读取数据耗时计算进行详细的介绍。 1、磁盘构.....
  • 内存与cpu工作原理

    千次阅读 2017-05-03 22:25:47
    内存:通电状态下进行数据存储   cpu内部大致结构 程序控制器(CPU的控制中心) 职责: 1 分析或解释 指令 2 根据或析与解释结果向其他组件发出命令 3 控制cpu的工作进度和工作方式   当一指令进入...
  • 计算机原理学习(3)-- 内存工作原理

    万次阅读 多人点赞 2013-09-05 16:02:01
    前言 前面两篇文章介绍了计算机硬件是如何工作的。而从这一章开始将逐渐的转到软件上面来。...CPU和内存是计算机中最重要的两个组件,前面已经知道了CPU是如何工作的,上一篇也介绍了内存采用的DRAM的存储原理。CP
  • 内存工作原理

    千次阅读 2015-11-29 14:18:51
    现代的PC(包括NB)都是以存储器为核心的多总线结构,即CPU只通过存储总线与主存储器交换信息(先在Cache里找数据,如果找不到,再去主存找)。输入输出设备通过I/O总线直接与主存储器交换信息。在I/O设备和主存储器...
  • java内存屏障的原理与应用

    万次阅读 多人点赞 2019-07-01 10:37:28
    目录 ...基本上,它是这样一指令: a) 确保一些特定操作执行的顺序; b) 影响一些数据的可见性(可能是某些指令执行后的结果)。编译器和CPU可以在保证输出结果一样的情况下对指令重排序,使性能得...
  • 内存的工作原理及时序介绍

    千次阅读 2013-02-06 14:52:03
    内存的工作原理及时序介绍 内存是PC配件中结构最简单的,但在BIOS中却是最难调的,很多玩家超频都卡在内存上。并且,内存原理、结构与时序多年不会改变,无论将来内存技术如何进步,相信这篇文章的存在...
  • 计算机原理(3)-内存工作原理

    千次阅读 2018-01-19 22:21:48
    CPU和内存是计算机中最重要的两个组件,前面已经知道了CPU是如何工作的,上一篇也介绍了内存采用的DRAM的存储原理。CPU工作需要知道指令或数据的内存地址,那么这样一个地址是如何和内存这样一个硬件联系起来的呢?...
  • 计算机原理学习 -- 内存工作原理

    千次阅读 2014-12-26 23:39:49
    这一章不仅仅介绍内存的工作原理,还会介绍内存的编址、内存数据存放。逐渐从硬件过渡到软件上来。为后面介绍程序运行打下基础。   1. 内存工作原理   CPU和内存是计算机中最重要的...
  • (尊重劳动成果,转载请注明出处:https://yangwenqiang.blog.csdn.net/article/details/90544530冷血...MySQL原理与实践(一):一select语句引出Server层和存储引擎层 MySQL原理与实践(二):一update语句引...

空空如也

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内存条储存原理