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  • AD9680.pdf

    2021-05-18 21:04:49
    AD9680.pdf
  • AD9680驱动

    2018-05-07 23:10:41
    ADI公司AD9680驱动,可用于各种嵌入式开发和ADC驱动程序编写
  • AD9680_cn.pdf

    2021-05-18 21:04:49
    AD9680_cn.pdf
  • AD9680评估板的BOM

    2018-12-10 11:22:51
    ad9680是一款双路1G采样率,单路2G采样率的高速ADC,接口为JESD204B。AD9680评估板的物料清单
  • ad9680开发板卡原理图

    2018-11-16 17:59:50
    AD9680对应的V7fpga原理图,含有硬件设计,可以配合代码做参考
  • ad9680开发板原理图

    2015-04-30 09:07:39
    ad9680是一款双路1G采样率,单路2G采样率的高速ADC,接口为JESD204B
  • 随着系统带宽和采样率的不断提高,在一些设备中需要用到高 速数据采集和数据处理技术。JESD204B 协议正是这样一种用于高速 ...DAC,本文主要内容只涉及到高速采集接口,即基于 AD9680 的高速 数据接口的设计
  • 包含AD9680BCPZ-1250等封装,总共几百个封装,是allegro的PCB封装,只有PCB封装,有dra文件,pad文件,psm文件,fsm文件。还包含了一些其他的封装, 所有的封装名和器件名都在excel表里面有对应关系,库文件很全
  • ad9680_setup_jesd204_link(), ad9680.c:823 <p>On ZC706, CPLL allows rates of up to 6.6 Gbps. In this patch we use a QPLL configuration for higher rates. <p>Signed-off-by: Alexandru Tachici </p><p>该...
  • 最近要使用FPGA来采集adc AD9680的数据,看到ADI官网有使用AD9680的EVM板子,就希望生成工程来用。 生成例程的过程比较曲折,记录一下。 官方例程路径

    最近要使用FPGA来采集adc  AD9680的数据,看到ADI官网有使用AD9680的EVM板子,就希望生成工程来用。

    生成例程的过程比较曲折,记录一下。

    1. 官方例程路径  AD-FMCDAQ2-EBZ 开发板资源主页 在页面下方下载全部的资源库,后续根据指引自己make生成工程文件
    2. 下载并解压资源文件,解压后如下:
    3. 接下来按照官方的指引一步步生成 工程文件
      1. 参考的官方指引连接:例程生成指导
      2. 主要是参考TCL构建
      3. 大概步骤如下:  进入开发板对应的文件夹->搜索.tcl文件对应的库->生成各层的工程->综合各个工程到开发板的示例程序
      4. 接下来就可以开始了,
        cd c:/github/hdl/projects/daq2/zc706
        注意:此处的文件路径一定要根据自己实际存储的文件路径以及对应开发板型号修改
        source ../../scripts/adi_make.tcl
        adi_make::lib all
        
        
        若出现报错:
        ERROR: vivado version mismatch; expected 2020.1, got 2018.3.
        This ERROR message can be down-graded to CRITICAL WARNING by setting ADI_IGNORE_VERSION_CHECK environment variable to 1. Be aware that ADI will not support you, if you are using a different tool version.
        
        修改hdl-master\library\scripts下的adi_ip_xilinx.tcl文件,消除版本检查报错,将此处0改为1即可
        到此,所需的库全部生成完毕
        
      5. 接下来就将生成的库综合,生成开发板可以直接使用的工程文件。
        此处有一个bug(姑且认为是bug吧),在vivado界面下的TCL console输入
        source ./system_project.tcl
        命令会导致程序闪退,
        我们就使用命令行来输入
      6. 命令行输出后回车,就可以在C:\github\hdl-master\projects\daq2\kcu105  文件夹下看到整个工程目录了,打开即可
    展开全文
  • 我目前看到的是不进行DDC操作的rx_data解帧,求教如果进行ddc操作后rx_data数据是如何排列的。我的L=4,M=4,F=1,K=32,N=14,N'=...进行了四倍抽取,...
  • AD9680的DDC模式下的调试

    千次阅读 2019-10-05 01:30:32
    //模拟输入差分终端:400Ω,AD9680-1000 assign confi_data[ 7 ] = 24 ' h0934_1F; //输入电容:3pF接地 assign confi_data[ 8 ] = 24 ' h0018_A0; //缓冲控制:AD9680-1000:6.0X assign confi_data[ 9...

    条件:1G采样率下,采样750M中心频率的信号,将其下变频,1/4 fs DDC mode;

    问题:I路有数据,Q路一直为0;

    解决方法:

    改变寄存器0x300(负责DDC同步)的配置顺序,将其放在DDC配置相关寄存器的最后;

    原因:

     

    相关寄存器配置:

     

    assign confi_data[0]  = 24'h0000_81;   //接口配置_A,MSB   //81软复位
    // assign confi_data[1]  = 24'h0001_00;   //接口配置_B
    assign confi_data[1]  = 24'h0001_02;   //接口配置_B
    assign confi_data[2]  = 24'h0002_00; ///正常工作        设备配置(局部):(正常工作)
    assign confi_data[3]  = 24'h0008_03;   //选中CHA和CHB
    assign confi_data[4]  = 24'h000A_00;   //高速暂存存储器
    assign confi_data[5]  = 24'h0015_00; ///正常工作        模拟输入:0(正常工作),1(输入不使能)
    assign confi_data[6]  = 24'h0016_0E;   //模拟输入差分终端:400Ω,AD9680-1000
    assign confi_data[7]  = 24'h0934_1F;   //输入电容:3pF接地
    assign confi_data[8]  = 24'h0018_A0;   //缓冲控制:AD9680-1000:6.0X
    assign confi_data[9]  = 24'h0019_60;   //缓冲控制:AD9680-1000:Setting3
    assign confi_data[10] = 24'h001A_09;   //缓冲控制:AD9680-1000:setting2
    assign confi_data[11] = 24'h011A_20;   //缓冲控制:高频设置:打开
    assign confi_data[12] = 24'h0935_00;   //缓冲控制:低频操作:关闭
    assign confi_data[13] = 24'h0025_08;   //输入满量程范围:1.46V差分:AD9680-1000
    assign confi_data[14] = 24'h0030_18;   //输入满量程控制:(AD9680-1000)
    assign confi_data[15] = 24'h0024_00;   //V_1P0控制位内部参考
    assign confi_data[16] = 24'h0028_00;   //不使用温度二极管
    assign confi_data[17] = 24'h003F_80;   //PDWN/STBY管脚控制,80不使能、00使能
    assign confi_data[18] = 24'h0040_BF;   //芯片管脚控制:bit[7:6]PDWN/STBY:00_PDWN 01_STBY 10_DISABLED BIT
    assign confi_data[19] = 24'h010B_00;   //时钟分频:一分频
    assign confi_data[20] = 24'h010C_00;   //时钟分频器相位:不延迟
    assign confi_data[21] = 24'h010D_00;   //时钟分频器和参考控制
    assign confi_data[22] = 24'h0117_00;   //时钟延时控制
    assign confi_data[23] = 24'h0118_00;   //时钟罚时控制
    
    assign confi_data[24] = 24'h0120_02;   //SYSREF±控制   下降沿采样   位3 clk边沿  0=上升  位2,1 00禁用 01连续 10 N次                               
    assign confi_data[25] = 24'h0121_0F;   //SYSREF±控制    //02
    assign confi_data[26] = 24'h0123_00;   //SYSREF±控制
    
    assign confi_data[27] = 24'h01FF_00;   //芯片同步模式:0正常,1时间戳
    
    assign confi_data[28] = 24'h0200_02;   //芯片应用模式,ddc0/1
    assign confi_data[29] = 24'h0201_02;   //芯片抽取比:4倍抽取
    assign confi_data[30] = 24'h0228_00;   //失调调整
    assign confi_data[31] = 24'h0245_00;   //快速检测 BIT3:0_正常1_强制输出 BIT2:强制值 BIT0:使能
    assign confi_data[32] = 24'h0247_00;   //FD快速检测阈值上限LSB
    assign confi_data[33] = 24'h0248_00;   //FD快速检测阈值上限MSB
    assign confi_data[34] = 24'h0249_00;   //FD快速检测阈值下限LSB
    assign confi_data[35] = 24'h024A_00;   //FD快速检测阈值下限MSB
    assign confi_data[36] = 24'h024B_00;   //FD驻留时间LSB
    assign confi_data[37] = 24'h024C_00;   //FD驻留时间MSB
    
    assign confi_data[38] = 24'h026F_00;   //信号监测器同步控制
    assign confi_data[39] = 24'h0270_00;   //信号监测控制
    assign confi_data[40] = 24'h0271_80;   //信号监测段
    assign confi_data[41] = 24'h0272_00;   //信号监测段
    assign confi_data[42] = 24'h0273_00;   //信号监测段
    assign confi_data[43] = 24'h0274_01;   //信号监测段
    assign confi_data[44] = 24'h0279_00;   //
    assign confi_data[45] = 24'h027A_00;   //                  
    assign confi_data[46] = 24'h0300_10;   //DDC同步控制        00禁用 01连续 03一次
    assign confi_data[47] = 24'h0310_40;   //DDC0:实数混频,禁用nco 可变IFmode,禁用复数转实数,4倍抽取
    assign confi_data[48] = 24'h0311_00;   //DDC0输入为通道A
    assign confi_data[49] = 24'h0314_00;   //DDC0频率LSB
    assign confi_data[50] = 24'h0315_0C;   //DDC0频率MSB
    assign confi_data[51] = 24'h0320_00;   //DDC0相位LSB
    assign confi_data[52] = 24'h0321_00;   //DDC0相位MSB
    assign confi_data[53] = 24'h0327_00;   //DDC0输出测试模式选择 BIT2,0:测试模式1
    assign confi_data[54] = 24'h0330_40;   //DDC1:实数混频,禁用nco IFmode,禁用复数转实数,4倍抽取
    assign confi_data[55] = 24'h0331_05;   //DDC1输入为通道B
    assign confi_data[56] = 24'h0334_00;   //DDC1频率LSB
    assign confi_data[57] = 24'h0335_0C;   //DDC1频率MSB
    assign confi_data[58] = 24'h0340_00;   //DDC1相位LSB
    assign confi_data[59] = 24'h0341_00;   //DDC1相位MSB
    assign confi_data[60] = 24'h0347_00;   //DDC1输出测试模式选择 BIT2,0:测试模式1
    assign confi_data[61] = 24'h0350_00;   
    assign confi_data[62] = 24'h0351_00;   
    assign confi_data[63] = 24'h0354_00;   
    assign confi_data[64] = 24'h0355_00;   
    assign confi_data[65] = 24'h0360_00;   
    assign confi_data[66] = 24'h0361_00;   
    assign confi_data[67] = 24'h0367_00;   //DDC2
    assign confi_data[68] = 24'h0370_00;   
    assign confi_data[69] = 24'h0371_00;   
    assign confi_data[70] = 24'h0374_00;   
    assign confi_data[71] = 24'h0375_00;   
    assign confi_data[72] = 24'h0380_00;   
    assign confi_data[73] = 24'h0381_00;   
    assign confi_data[74] = 24'h0387_00;   //DDC3 
    
    //assign confi_data[74] = 24'h0300_13;   //DDC同步控制        00禁用 01连续 03一次
                   
    assign confi_data[75] = 24'h0550_00; ///正常工作          //ADC测试模式
    assign confi_data[76] = 24'h0551_00;   //测试用户模式1LSB
    assign confi_data[77] = 24'h0552_00;   //测试用户模式1MSB
    assign confi_data[78] = 24'h0553_00;   //测试用户模式2LSB
    assign confi_data[79] = 24'h0554_00;   //测试用户模式2MSB
    assign confi_data[80] = 24'h0555_00;   //测试用户模式3LSB
    assign confi_data[81] = 24'h0556_00;   //测试用户模式3MSB
    assign confi_data[82] = 24'h0557_00;   //测试用户模式4LSB
    assign confi_data[83] = 24'h0558_00;   //测试用户模式4MSB
    assign confi_data[84] = 24'h0559_00;   //输出模式控制1
    assign confi_data[85] = 24'h055A_00;   //输出模式控制2 
    assign confi_data[86] = 24'h0561_01;   //输出二进制补码
    assign confi_data[87] = 24'h0562_00;   //输出超量程
    assign confi_data[88] = 24'h0564_00;   //转换器通道交换:正常通道顺序
    assign confi_data[89] = 24'h056E_10;   //JESD线速率控制
    assign confi_data[90] = 24'h0570_91;/L=4,M=4,F=2
    assign confi_data[91] = 24'h0571_14;   /JESD链路测试
    assign confi_data[92] = 24'h0572_00;   
    assign confi_data[93] = 24'h0573_00;   /
    assign confi_data[94] = 24'h0574_00;   //JESD204B连接模式控制:ILAS
    assign confi_data[95] = 24'h0578_00;   //JESD204B LMFC偏移
    assign confi_data[96] = 24'h0580_00;   //JESD DID
    assign confi_data[97] = 24'h0581_00;   //JESD BID
    assign confi_data[98] = 24'h0583_00;   
    assign confi_data[99] = 24'h0584_01;   
    assign confi_data[100] =24'h0585_02;   
    assign confi_data[101] =24'h0586_03;   //JESD LID
    assign confi_data[102] =24'h058B_83;   //JESD204B参数SCR/L  03不加扰
    assign confi_data[103] =24'h058D_0F;   //JESD204B K配置   K=16
    assign confi_data[104] =24'h058F_8D; /JESD204B CS/N配置   CS=2 N=14
    assign confi_data[105] =24'h0590_2F;   //JESD204B N’配置  N'=16
    assign confi_data[106] =24'h05B0_AA;   //JESD204B链路掉电  SERDOUT[3:0]均使能
    assign confi_data[107] =24'h05B2_00;   
    assign confi_data[108] =24'h05B3_11;   
    assign confi_data[109] =24'h05B5_22;   
    assign confi_data[110] =24'h05B6_33;   //JESD204B链路SERDOUT±分配
    assign confi_data[111] =24'h05BF_05;   //JESDJESD串行器驱动器调整
    assign confi_data[112] =24'h05C1_00;   //去加重选择  均禁用
    assign confi_data[113] =24'h05C2_00;
    assign confi_data[114] =24'h05C3_00;
    assign confi_data[115] =24'h05C4_00;  
    assign confi_data[116] =24'h05C5_00;
    
    assign confi_data[117] = 24'h0300_01;   //DDC同步控制        00禁用 01连续 03一次

     

    转载于:https://www.cnblogs.com/Z-selfadd/p/11449250.html

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  • 最近有做过这3个AD的驱动开发,等有空的时候来更新一下具体驱动
    最近有做过这3个AD的驱动开发,等有空的时候来更新一下具体驱动
    
    展开全文
  • 有关该话题的更详细讨论可参见:"祖父时代的ADC已成往事," 以及"千兆采样ADC确保直接RF变频." 这些文章进一步讨论了 AD9680和 AD9625,以及它们的DDC功能。图2. 使用RF ADC(集成DDC)的接收器信号链本文主要关注AD...
  • sync失锁

    2019-11-12 21:39:05
    ad9680 zcu102 我发现我的sync经常会掉,不知道是什么原因,请大家帮忙给点意见

    ad9680 zcu102
    我发现我的sync经常会掉,不知道是什么原因,请大家帮忙给点意见在这里插入图片描述

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  • JESD204B学习之关键点问答

    千次阅读 多人点赞 2019-02-01 19:53:38
    JESD204B学习之关键点问答 1.概述 本文是用于记录JESD204B学习中的关键点,以问答的形式陈诉便于理清思路。 2.参考文档 1.《pg066-jesd204》 ... 2.... 3.《AD9680》 4.《AD9144》 3.JES...
  • <p>Oddly enough https://zec3.trezor.io/api/tx/949ab7c08c2f9ad9680af5e06176bfc1b46190789bee674a991785b831b7672d has version field, but not the other fields (zec2 has the same error as zec1 - missing ...
  • 本文讨论一种利用多频段无线电接收机——使用RF采样ADC,比 如AD9680——对两个独立而使用广泛的频段进行数字化和处理。本文第一部分解释了功能框图级别的实现,并讨论了双频段无线电系统中使用GSPS ADC的优势。本文...
  • 文中对AD9680系列产品所含DDC的几个技术方面进行了探讨。其中一个方面就是,更高的输入采样带宽允许无线电架构在更高的RF频率下直接采样,并将输入信号直接转换为基带。DDC可使RF采样ADC对此类信号进行数字化,而...
  • 该模块遵循 VITA57 标准,可直接与 FPGA 载卡配合使用,板卡 ADC器件采用 ADI 的 AD9680 芯片,该芯片具有两个模拟输入通道和两个JESD204B 输出数据通道对,可用于高达 2GHz 的宽带模拟信号采样。 DAC 器件采用 TI ...
  • 本篇内容的姊妹篇为:[1]数字插值滤波与...本文的高速ADC芯片为ADI的AD9680-1000. ADC芯片对信号进行下变频 仿真与实验 1、DAC不进行插值仿真 我们进行DA的波形是15.625MHZ的正弦波,采样率为250MHZ,即每周期...
  • <p><img width="318" alt="Screen Shot 2020-11-18 at 7 26 23 PM" src="https://user-images.githubusercontent.com/30255708/99539262-05ad9680-29d4-11eb-873c-2103dff58d88.png" /> Please give your thoughts ...
  • 加扰 论文 .rar

    2020-04-20 23:52:24
    基于AD9680的高速数据接口设计_李武建.pdf 基于FPGA的串行64B_66B编解码IP核设计与研究_庞志锋.pdf 基于FPGA的可配置扰码模块设计与应用_罗学平.pdf 基于FPGA的扰码器和解扰码器的设计_薛礼妮.pdf 基于HDMI2_0的加解...
  • 4,9680,940404075,-;R10: 0000000000000000 R11: 0000000000000040 R12: ffff8e3b30c211c0 4,9681,940404075,-;R13: ffffb8ab41ee3d08 R14: ffffffffb4890810 R15: ffff8e3ac9c05000 4,9682,940404077,-; ? get_work...
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  • <div><p>Dark mode: <img alt="image" src="https://user-images.githubusercontent.com/150329/98463526-9680a880-2170-11eb-9fc2-9018604ff1ad.png" /> <p>Light mode: ...
  • <img alt="image" src="https://user-images.githubusercontent.com/2816034/50200297-54cb9680-037b-11e9-911b-c5f0830ad3d5.png" /> <p>I'm on Win7, 64bit</p><p>该提问来源于开源项目:Qalculate/...
  • 0x7ffff6fe9680 <_io_2_1_stderr_>, data=0x7fffffffb450, n=116) at fileops.c:1183 #2 0x00007ffff6ea775f in new_do_write (fp=fp=0x7ffff6fe9680 <_io_2_1_stderr_>, data=...

空空如也

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ad9680