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  • 数字电路中D触发器和D锁存器分别有什么作用?

    万次阅读 多人点赞 2019-02-14 20:11:32
    用数字信号完成对数字量进行算术运算和逻辑运算的电路称为数字电路,或数字系统。...  数字电路中D触发器和D锁存器分别有什么作用?下面用6种方法,分别是功能的文字叙述、功能表、状态转移真值表...

      用数字信号完成对数字量进行算术运算和逻辑运算的电路称为数字电路,或数字系统。由于它具有逻辑运算和逻辑处理功能,所以又称数字逻辑电路。现代的数字电路由半导体工艺制成的若干数字集成器件构造而成。逻辑门是数字逻辑电路的基本单元。存储器是用来存储二进制数据的数字电路。

      数字电路中D触发器和D锁存器分别有什么作用?下面用6种方法,分别是功能的文字叙述、功能表、状态转移真值表、特征方程、状态图、时序图,下面进行详细介绍。

      方法一:功能的文字叙述

      1)D锁存器:

      数字电路中D触发器和D锁存器分别有什么作用?

      功能分析文字描述:C = 0时,输出状态保持不变;C = 1时,输出随输入状态而改变。

      2)D触发器:

    master latch 在clk沿锁存数据,其它时刻停止工作,即不再受输入影响;

    slave latch 在其它时刻工作,将数据继续锁存并输出;

      数字电路中D触发器和D锁存器分别有什么作用?

      功能分析文字描述: CLK=0时,主锁存器工作,接收输入信号Qm = D;从锁存器不工作,输出 Q 保持不变。

      CLK=1时,主锁存器不工作,Qm保持不变;从锁存器工作,将Qm传送到输出端。

      方法二:功能表

    数字电路中D触发器和D锁存器分别有什么作用?

      方法三:状态转移真值表

    数字电路中D触发器和D锁存器分别有什么作用?

      方法四:特征方程

    数字电路中D触发器和D锁存器分别有什么作用?

      方法五:状态转换图

      D锁存器状态转换图


    数字电路中D触发器和D锁存器分别有什么作用?

      D触发器状态转换图

    数字电路中D触发器和D锁存器分别有什么作用?

      方法六:时序图

      D锁存器时序图

    数字电路中D触发器和D锁存器分别有什么作用?

      D触发器时序图

    数字电路中D触发器和D锁存器分别有什么作用?

     

      数字电路中D触发器和D锁存器作用描述:

      D型触发器的输入输出关系简单明了,是多位寄存器的基本结构。触发器是时钟上升沿(↑)触发,瞬间保存数据;锁存器是时钟高电平期间输出跟随输入变化,下降沿(↓)保存数据。二者就是触发方式不同,适用于不同的场合。如 CPU 复用总线的地址锁存就是用锁存器。

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  • 光栅尺,D触发器应用

    2019-10-15 10:24:00
    1PRE 1CLR,干什么的我不是非常清楚,反正所谓的置位和复位功能,大概意思初始化Q和Q非的初始状态。反正直接接5V就可以了。 作者没学过数电,对触发器理解一直不到位。看不懂时序图。 今天才知道,这个触发器...

    作者较菜,内容很多都为自己理解。网上说的都比较专业,此文是为给自己记录开发的过程。

    选用芯片为74LS74最常见的芯片,但去买芯片老板说这个停产了。

    1PRE 1CLR,干什么的我不是非常清楚,反正是所谓的置位和复位功能,大概意思是初始化Q和Q非的初始状态。反正直接接5V就可以了。

    作者没学过数电,对触发器理解一直不到位。看不懂时序图。

    今天才知道,这个触发器是看上下跳边沿的,而不是看高低电平的(重点)。(作者很菜)

    D触发器,有两个输入,一个是CLK,一个是D。

    假设A相是CLK输入,在上图的正向旋转中,那么在CLK高电平工作期间,D接口的信号全部是下降沿,而非工作区域(CLK低电平的时候),D接口全是上升沿。那么Q输出全程应该是低电平。那么就知道这时候的方向就是某一个方向。

     

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  • D触发器是在(上升)边沿进行锁存数据的,也就是clk从在0→1的时候锁存数据,那我们就看看这个上升沿的时候发生了什么: 假设原来的数据1(也就是从锁存器锁存的数据1),然后我们要锁存的数据0。  首先,要...

    为什么会有建立时间和保持时间的要求?

    从D触发器到主锁存器
    D触发器的门级结果如下所示:
    在这里插入图片描述
    D触发器是在(上升)边沿进行锁存数据的,也就是clk从在0→1的时候锁存数据,那我们就看看这个上升沿的时候发生了什么:
    假设原来的数据是1(也就是从锁存器锁存的数据是1),然后我们要锁存的数据是0。
     首先,要让时钟上升沿之后Q输出为0,根据D触发器的功能:在时钟上升沿的时候锁存在时钟上升沿采到的输入值,并且保持一个时钟周期。
    ——就是要主锁存器在时钟上升沿之后稳定地锁存住0,换个角度看就是:在上升沿到来以及到来之后,主锁存器负责锁存数据,而从锁存器则是负责传输主锁存器所锁存好的数据;这样一来,我们的研究重点就放在了主锁存器。

    从主锁存器到建立时间
     在时钟上升沿到来后,我们要让Q输出0。假如数据的建立时间不足,会发生什么呢,也就是数据0相对于时钟上升沿来得太晚了会怎么样呢?
      假设在T=0ns的时候,clk从0变成1(为方便分析,假设时钟是理想的,没有跳变延时)。我们假设一个数据D1=0在T=-0.7ns(即比时钟上升沿提前0.7s)的时候到达数据的端口,然后另一个数据D2=0在T=-0.3ns的时候才来到数据端口(也就是说,D1来得早,而D2来得比较晚即建立时间不足)。
      然后D1这个0翻山越岭越过了反相器,变成1,经过了与门(由于与门的另一个输入clk经非门为1)变成了1,经过或非门之后,使输出Q变成了0,也就是变成了从锁存器要锁存的0值。然后主锁存器Q刚输出0的时候,还不稳定,需要通过反馈使得自己的或非门的输入为1就是需要t1+t2+t3的时间进行维持Q的稳定。
     在这里插入图片描述
    简单来说,在clk由0→1之前,输入D要经过这么多个门电路和传输线带来的延迟,才能被主锁存器锁住。
    然后我们再看看D2数据翻山越岭,可能刚刚翻到与门那里,时钟沿就来了,它就变不成了从锁存器要锁存的0值,这就是建立时间不足的引起锁存不住值的问题。

    保持时间
    接着我们看一下保持时间,还是从主锁存器这边看。假如0时刻时钟clk发生0→1的上升沿跳变时,clk的1信号首先需要经过反相器(inst10)变成0信号后传到后面的与门(inst13和inst14),经过t1的延迟时间 ,锁存器保持。(clk=0,主D锁存器打开;clk=1,主D锁存器保持)
    那么在这个t1时刻之前,主D锁存器打开的情况下,如果输入端D发生跳变,从0变成1(也就是低电平0这个信号保持得不够久),变换后的数据端高电平1经过t2延时之后,到达与门的另一个输入端。
    当t2<t1的时候(由于时钟需要经过反相,一般情况下t1>>t2),相当于主D锁存器打开的情况下,输入从0变为1,相应的锁存的数据就是1,而不是我们要求的0了,即输出错误了。
    在这里插入图片描述
    实际上就是时钟沿跳变之后的值到达与门inst14前,输入D必须保持不变。
    我们需要输入D在时钟沿跳变之后保持不变,这个保持时间的实质就是这个t1与t2的差值,即数据到达之后,要保持t1-t2。假如这跟导线很长,即t2的延迟很长,比t1还长,那么保持时间就是一个负值,这时候就完全没有必要关注保持时间了。
    从上面的分析还可以知道,保持时间一般情况下会比建立时间小

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  • Oracle触发器

    2017-02-13 16:50:00
    1.什么是触发器?  首先触发器是一个特殊的存储过程。一个与表相关联的,存储的pl/sql程序。每当一个数据操作语句(insert delete update)在指定表上执行时,Oracle数据库就会来执行触发器中定义的语句序列。 2....

    1.什么是触发器?

      首先触发器是一个特殊的存储过程。是一个与表相关联的,存储的pl/sql程序。每当一个数据操作语句(insert delete update)在指定表上执行时,Oracle数据库就会来执行触发器中定义的语句序列。

    2.触发器的应用场景?

      a.进行复杂的安全检查

      b.进行数据的确认

      c.实现审计的功能

      d.数据的备份和同步

    3.触发器的基本语法。

      

    create trigger sayNewEmp--创建触发器sayNewEmp
    after insert--执行DML insert操作
    on emp--在员工表中
    declare
    begin
    dbms_output.put_line('成功插入操作新员工');--打印
    end;
    /

     3.语句级和行级操作的区别

      语句级不管这条语句有多少行,触发器的命令会在语句的执行的前后执行。

      行级触发就是针对于表的行或者某一行when

    insert into emp select * from emp1 when empno = 10;--多条插入

      那么这里的当行级操作时,每插入一行就会执行这个触发器。

    4.进行复杂的安全检查(以判断时间为例)

    create or replace trigger securityEmp
    before insert
    on emp
    begin 
    if 
    to_char(sysdate,'day')in('星期六','星期日') or
    to_number(to_char(sysdate,'hh24'))not between 9 and 18 then raise_application_error(-20001,'禁止非工作时间插入新员工');
    end if;
    end;
    /

    5.进行数据的确认(确认涨的工资是正值)

    create or replace trigger checkEmp
    before update
    on emp
    for each row--行级操作
    begin 
    if :new sal<:old sal then then   --:new 表示update后
    raise_application_error(-20002,'涨的工资非正值');
    end if;
    end;
    /

     

    转载于:https://www.cnblogs.com/bingscode/p/6392916.html

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  • 数字电路 触发器

    2021-04-15 15:55:36
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    首先,任何外设都需要时钟,51单片机,stm32,430等等,因为寄存器D触发器组成的,往触发器里面写东西,前提条件有时钟输入。 51单片机不需要配置时钟,因为一个时钟开了之后所有的功能都可以用了,而这个...
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  • 时序逻辑最基本的单元就是寄存器,寄存器具有存储功能,一般D 触发器构成,由时钟脉冲控制,每个 D 触发器D Flip Flop ,DFF)能够存储一位二进制码。 其复位又分为同步复位和异步复位。同步复位的 D 触发器...
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    组合逻辑最大的缺点就是会存在竞争冒险,时序逻辑最基本的单元就是寄存器,寄存器具有存储功能,一般D 触发器构成,由时钟脉冲控制,每个 D 触发器D Flip Flop ,DFF)能够存储一位二进制码。 其复位又分为...
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    万次阅读 2007-04-09 00:08:00
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空空如也

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