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  • FPGA信号发生器

    2012-07-10 13:55:37
    基于FPGA信号发生器,能够输出正弦波,三角波,方波
  • FPGA 信号发生器

    千次阅读 2018-10-28 19:13:45
    1锯齿波 module juchi ( input clk, input rst_n, input [11:0]adr, output reg [9:0]q ); always@(posedge clk or negedge rst_n) if(!rst_n) q<=0; else q<=adr[11:2];...mod...

    1锯齿波

    module juchi
    (
    input clk,
    input rst_n,
    input [11:0]adr,
    output reg  [9:0]q
    );
    
    always@(posedge clk or negedge rst_n)
    	if(!rst_n) q<=0;
    		else 
    			q<=adr[11:2];
    			
    endmodule 

    2.三角波

    module sanjiao(
    input OutClock,
    input Reset,  
    output reg [9:0] Q,
    input   [11:0]Address 
    );
    
    always@(negedge OutClock or negedge Reset) 
     if(!Reset)    Q<=0;  
    	 else if(Address >=2047)Q<=1024-Address [11:2];
              else Q<=Address [11:2];
    endmodule 

    3.方波

    module fang
    (
    input clk,
    input rst_n,
    input [11:0]pwm,
    input [11:0]adr,
    output  reg [9:0]q
    );
    always@(posedge clk or negedge rst_n)
    begin 
     if(!rst_n)q<=0;
    	 else if(adr>=pwm)q<=512;
    		  else q<=1024;
    end 
    endmodule 

     

    展开全文
  • 基于测试专用的FPGA信号发生器,可产生正弦波,余弦波两种波形;可产生0-1M的混频信号,幅度和初相位可以自定义,以IP打包的方式进行调用,IP可以自己修改,已经过无数次的验证可行,稳定性高。
  • 通信工程毕设:基于FPGA信号发生器论文
  • 基于FPGA的Verilog HDL语言的DDS 信号发生器,给出的代码是常规结构的12位数据。 注意注意注意!!!代码中的fword和fword_r是32位的,需要修改!!!
  • FPGA信号发生器DDS

    2013-08-30 21:35:12
    基于FPGA的DDS双相信号发生器,简单明了,
  • 基于FPGA信号发生器的设计,本人的论文,用了一个月写出的,
  • 基于FPGA的函数信号发生器,可选正弦波、方波和三角波,频率可调,幅度可调。
  • 本篇给大家带来一个小制作,基于FPGA信号发生器,并且通过LCD1602来进行显示信号发生器每个通道的频率信息等。 1.DDS信号发生模块 主要分为DDS信号发生器以及LCD1602的显示两大部分,其中第一部分(DDS信号发生器...

    本篇给大家带来一个小制作,基于FPGA的信号发生器,并且通过LCD1602来进行显示信号发生器每个通道的频率信息等。
    在这里插入图片描述

    1.DDS信号发生模块
    主要分为DDS信号发生器以及LCD1602的显示两大部分,其中第一部分(DDS信号发生器)在之前的文章中给大家介绍过,这里面就不赘述了—DDS信号发生器文章链接

    2.LCD1602显示模块
    第二部分是之前没有涉及到的LCD1602显示,接下来就主要说一下控制LCD1602显示屏显示的方法。
    在这里插入图片描述
    LCD1602可以显示两行数据,这里需要注意的是FPGA控制的LCD1602需要使用3.3V的LCD1602,对于5V的LCD1602使用不了。
    在这里插入图片描述
    使用LCD1602主要是根据LCD1602的指令表来进行控制,根据LCD1602的一般初始化过程然后在FPGA中使用状态机的思路来进行对LCD1602进行指令编写,比如在程序中一般可以分为几个状态:
    1602LCD的一般初始化(复位)过程:
    1.延时15mS
    2.写指令38H(不检测忙信号)
    3.延时5mS
    4.以后每次写指令、读/写数据操作均需要检测忙信号
    5.写指令38H:显示模式设置
    6.写指令08H:显示关闭
    7.写指令01H:显示清屏
    8.写指令06H:显示光标移动设置
    9.写指令0CH:显示开及光标设置

        localparam IDLE 		= 16'b0000_0000_0000_0001;
    	localparam DELAY15MS 	= 16'b0000_0000_0000_0010;	
    	localparam CMD38H1 		= 16'b0000_0000_0000_0100;	
    	localparam DELAY5MS 	= 16'b0000_0000_0000_1000;
    	localparam CMD38H2 		= 16'b0000_0000_0001_0000;
    	localparam CMD08H 		= 16'b0000_0000_0010_0000;
    	localparam CMD01H 		= 16'b0000_0000_0100_0000;	
    	localparam CMD06H 		= 16'b0000_0000_1000_0000;	
    	localparam CMD0CH 		= 16'b0000_0001_0000_0000;
    	localparam USER_CMD 	= 16'b0000_0100_0000_0000;
    	localparam WAIT_DONE 	= 16'b0000_1000_0000_0000;
    

    所以在控制LCD1602时候就要根据这几个状态来进行控制,这里面需要注意的是每个指令之间需要遵循LCD1602的读写时序图来进行控制,LCD1602的读写时序图如下图所示:
    在这里插入图片描述
    所以在这里还需要一个状态机来控制写入数据的时刻,需要对RS,RW,E,DB[7:0]之间的时序进行控制才可以。

    LCD1602的显示如下图所示:
    在这里插入图片描述
    示波器上实时显示的双通道数据波形:
    在这里插入图片描述

    3.整体硬件逻辑rtl视图:
    在这里插入图片描述

    整体程序设计根据RTL视图可以看出来,主要分为频率控制(幅度相位等控制也可以加进去),DDS信号产生模块以及LCD1602显示模块,就是完成本次设计的3个程序模块。

    对于设计中有不明白,或者在制作过程中遇到难题可以咨询QQ:2859340499,也可以在下方留言。

    展开全文
  • fpga信号发生器_v2.0

    2018-04-22 13:43:02
    FPGA_产生两个相差90度的正弦_频率通过按键调节,详细见注释
  • 产生幅度和频率可变的方波,三角波,正弦波。
  • 通过fpga生成用户所需的信号,可以通过更改预先设定的波形实现。
  • FPGA实现信号发生器

    2016-08-24 16:10:04
    FPGA实现信号发生器
  • 基于FPGA波形发生器和扫频信号发生器.rar
  • 基于FPGA信号发生器设计 基于FPGA信号发生器设计 基于FPGA信号发生器设计
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    2013-11-27 16:25:50
    基于FPGA的函数信号发生器,可以看看,资源还是很不错的
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  • 基于FPGA信号发生器

    2019-01-10 23:26:18
    1. 信号发生器在同一端口能产生正弦波、锯齿波、方波、和三角四种周期性波形。 2. 输出频率范围10Hz~10MHz。 3. 实现输出信号频率和幅度可调节。 1.根据设计要求,合理选择系统所需的外设组件,并完成相应电路的设计...
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