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  • rs触发器
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    2021-04-16 22:46:21

    ▪ RS触发器实验

    RS触发器是时序电路中最基础的,所以务必学的透彻。

    RS触发器,我们可以简单将它理解为一个存储单元,可以存储一位数据(0或者1)。

     

    基本的RS触发器可以用两个 与非门 或者 或非门 实现:

     

    此处我们利用两个 或非门 组成的RS触发器实验,先建立一个感性的认识,便于理解。

     

    这个电路我们引出了 R端(橙色线),S端(灰色线);同时 Q 连接上面的LED灯,`Q 连接下面的 LED 灯,便于查看实验结果。

     

    电路搭建完成后,直接上电(如上图),可以发现 LEDQ 一直处于闪烁,这是因为输入端(R,S)开路,电压确定原因导致的。

    实验结果参照下图中的 “RS触发器 特征表”,Q=1 时偏上的LED亮,Q=0 时偏下的LED亮(因为`Q=1)

     

    RS触发器 中的 R 表示 Reset(复位),S 表示 Set(置位)

    在上面的 “RS触发器 特征表” 中:0 表示低电平,1 表示高电平。

     

    对于 或非门 的 RS触发器,即:

    • R=1、S=0时,那么 Q = 0
    • R=0、S=1时,那么 Q = 1
    • R=0、S=0时,那么 Q 保持上个状态
    • R=1、S=1时,禁止、不稳状态

     

    所谓高电平有效,就是说某引脚施加高电平时,该引脚的功能就触发了

    虽然 RS触发器 输出有 Q和`Q(它们的值反相),但是平时沟通时是以Q为默认,比如说 RS 触发器输出1,那么就是指 Q 输出 1

     

     

    ▪ RS触发器基础理论

    虽然组合逻辑电路能够很好地处理像加、减等这样的操作,但是要单独使用组合逻辑电路,使操作按照一定的顺序执行,需要串联起许多组合逻辑电路,而要通过硬件实现这种电路代价是很大的,并且灵活性也很差。为了实现一种有效而且灵活的操作序列,我们需要构造一种能够存储各种操作之间的信息的电路,我们称这种电路为时序电路。

    组合电路和存储元件互联后组成了时序电路。存储元件是能够存储二进制信息的电路。存储元件在某一时刻存储的二进制信息定义为该时刻存储元件的状态。时序电路通过其输入端从周围接受二进制信息。时序电路的输入以及存储元件的当前状态共同决定了时序电路输出的二进制数据,同时它们也确定了存储元件的下一个状态。

     

    触发器具备数据记忆功能,是时序电路的基本单元,触发器分为:RS触发器、T触发器、JK触发器、D触发器

    触发器 学名 “双稳态多谐振荡器(Bistable Multivibrator)”,所谓 双稳态 就是能保持两种状态(0或1),触发器(Flip Flop)是一种可以存储电路状态的电子元件。最简单的触发器就是由两个 与非门 或者 或非门 实现,复杂一些的触发器有带 时钟段 和 D(Data)端。

     

    ▪ RS触发器为什么能 “保持上一状态”

    触发器就是在常规的门电路的基础上加入了反馈,这样触发器就实现了存储数据的功能。这也是上面章节 “RS触发器实验” 的 RS触发器特征表 中第3条 “保持上一个状态” 的原因。

    这点非常非常重要,同时也比较难理解;所谓存储数据,并不是像大家所想的直接把数据位刻在哪里,而是利用反馈的数据,这样 R端 或 S端 某个脚脱离高电平后然后再接入低电平时,输出的Q和`Q结果不会变化。

    比如 R=0,S=1 时,Q输出为1;此时我们把 S 端 的脚和高电平断开(此时悬空了),由于 Q 反馈到N2(Q=1),所以 S 端断开后 N2 仍就输出 0,整个RS触发器输出保持不变。

     

    ▪ RS触发器为什么有 “禁止、不稳的状态”

    在上面章节 “RS触发器实验” 的 RS触发器特征表 中第4条中我们有一个状态:“禁止、不稳的状态” 。这个状态是由当 R=1,S=1 时触发的。

     

    虽然当 R=1,S=1 时 RS触发器 的电路也能达到一个稳定状态,但是在设计 RS触发器 的时候,就已经规定了 Q和`Q 必须是反相的,基于 RS触发器 的其他应用也默认 Q和`Q 是反相进行设计。

    所以当 R=1,S=1 就是非法的。我们在编写或设计电路的时候就要规避这个情况。

     

    还有一种情况就是当 R=1、S=1 近乎同时跳变到 R=0、S=0 时。虽然近乎同时,但实际:

    • 有可能 R 先变为 0(那么此时 Q 就输出1,那么N2因为Q反馈的原因,`Q=0)
    • 也有可能 S 先变为 0(那么此时 `Q 就输出1,那么 N1 因为 `Q反馈的原因,Q=1)

    由于无法确定R或S哪个先变为0,那么就会出现不稳定因素,这也是 R=1,S=1 非法的原因之一。

     

    ▪ RS触发器总结

    无论是或非门还是与非门:

    • 当 R=1,S=0 时,表示 Reset 激活了,那么 Q = Reset = 0
    • 当 R=0,S=1 时,表示 Set 激活了,那么 Q = Set = 1

     

    禁止,不稳定的状态:

    • 或非门时 R = S = 1 时禁止,因为Q和`Q输出都是0;为了方便记忆,可以认为非门时,1 强于 0,所有反馈无法改变和 1 的非值,RS触发器也就无法自我调节
    • 与非门时 R = S = 0 时禁止,因为Q和`Q输出都是1;为了方便记忆,可以认为与门时,0 强于 1,所有反馈无法改变和 0 的与值,RS触发器也就无法自我调节

     

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    目录

    基本RS触发器(与非门构成)如下图所示:

    基本含义:

    R、S触发器逻辑表达式:

    真值表、特征表:

    1.与非门真值表:

    2.基本RS触发器特征表:

    特征表含义:

    那么为什么R、S都为0时输出不稳定?

    时序图分析理解:

    状态1:

    状态2:

    状态3:

    状态4:

    状态5:


    基本RS触发器(与非门构成)如下图所示:

    基本含义:

    S是Set 的首字母,也就是设置端。

    R 是Reset 的首字母,也就是复位端。

    触发器属于时序逻辑电路,与组合逻辑电路不同,组合逻辑电路的输出状态只取决于同时刻的输入信号状态。基本RS触发器把输出信号引回到输入信号,形成一个反馈。这样使得输出信号的状态不但取决于同时刻输入信号的状态,也与输出之前的状态有关。

    输出信号的状态就是(Q^(N+1) 次态) 同时刻输入信号的状态就是(S、R) 输出之前的状态就是(Q^N 现态)

    R、S触发器逻辑表达式:

    真值表、特征表:

    1.与非门真值表:

    2.基本RS触发器特征表:

    把上图RS触发器包装起来就是:

    红色的圈表示R、S均为输入低电平有效。

    特征表含义:

    第一行:

    R是复位端,低电平有效,也就是当R为0时有效,当S为1(设置端无效)时,使得输出Q^(N+1)为0。

    第二行:

    S是设置端,低电平有效,也就是当S为0时有效,当R为1(复位端无效)时,使得输出Q^(N+1)为1。

    第三行:

    输入R、S都为1,也就是复位端、设置端都有效时。输出保持,为Q^N。

    证明:

    先假设QN=1,那么QN 非就等于0:

    第一个与非门输入 1和0,根据与非门真值表可知,Q^(N+1)输出为1。

    第二个与非门输入1和1,根据与非门真值表可知,Q^(N+1) 非输出为0。

    Q(N+1)=QN,输出保持不变。

    再假设QN=0,那么QN 非就等于1:

    第一个与非门输入 1和1,根据与非门真值表可知,Q^(N+1)输出为0。

    第二个与非门输入0和1,根据与非门真值表可知,Q^(N+1) 非输出为1。

    Q(N+1)=QN,输出保持不变。

    综合两次假设:当输入R、S都为1时,输出保持不变。

    第四行:

    当R、S都为0时为不稳定状态,运用触发器时要尽量避免此状态。

    当R、S都输入为0时,

    根据与非门的特性,两个输出端都为1。

    那么为什么R、S都为0时输出不稳定?

    基本RS触发器1.pdf那么为什么R、S都为0时输出不稳定?-嵌入式文档类资源-CSDN文库https://download.csdn.net/download/zhjysx/85593546

    时序图分析理解:

    状态1:

    R、S输入均为1,输出保持不变仍然为0

    状态2:

    R输入为1,S输入为0,输出置1

    状态3:

    R、S输入均为1,输出保持不变仍然为1

    状态4:

    R输入为0,S输入为1,输出置0

    状态5:

    R输入为1,S输入为0,输出置1

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    本文原创首发CSDN,链接 https://blog.csdn.net/qq_41464123/article/details/90084796 ,作者博客https://blog.csdn.net/qq_41464123 ,转载请带上本段文字,尤其是脚本之家、码神岛等平台,谢谢配合。


    《电子技术》之数电部分  即将结束

    今天花了一个晚上总结归纳了时序逻辑电路的相关知识

    特意写个总结,以便之后需要时能够及时巩固。

     

    使用教材:《电子技术》第三版 高有华

    一:基本RS触发器

    PS:我的目标是记住各个触发器的真值表,学会各个触发器的波形画法,下同。

    以上是基本RS触发器的电路结构和逻辑结构,了解一下即可。

    重点:真值表:

    波形在例题9-1,总体来说就是只要R或者S其中一个变了,那么输出Q可能会发生转换,所以要重新判断,其余情况保持即可。


    二:同步RS触发器

    真值表:

    总体来说 都是0就不变,都是1就不确定,不然看S,S是1,输出就是1,反之就是0

    波形:


     三:主从RS触发器

    真值表:

    CP=1 保持

    CP=0

    R

    S

    Q

    0

    0

    不变

    0

    1

    1

    1

    0

    0

    1

    1

    不定

    波形见例题9-4


    本文原创首发CSDN,链接 https://blog.csdn.net/qq_41464123/article/details/90084796 ,作者博客https://blog.csdn.net/qq_41464123 ,转载请带上本段文字,尤其是脚本之家、码神岛等平台,谢谢配合。


    四:JK触发器

    真值表:


     五:D触发器

    真值表:

     

    波形见例题9-6


    作业是我用钢笔做的,书写墨汁方面比较尴尬。

    先是目录,作业是红色打勾部分:

    另外作业不一定完全正确,如有不足之处,欢迎指出!

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