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  • DRC检查

    2020-09-21 10:53:48
    DRC检查处理 1、双击错误,会跳转到对应的错误显示:没有连接的线进行连接,错误放置位置的进行重新摆放等。 2、修改规则 孔错误

    DRC检查处理

    1、双击错误,会跳转到对应的错误显示:没有连接的线进行连接,错误放置位置的进行重新摆放等。

     

    2、修改规则

    孔错误

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  • PCB DRC检查报错求助

    2020-09-08 17:44:54
    [img=https://img-bbs.csdn.net/upload/202009/08/1599558281_918647.jpg][/img][img=https://img-bbs.csdn.net/upload/202009/08/1599558282_377857.jpg][/img]
  • PCB文件DRC检查规则

    2019-01-29 18:29:49
    Altium Designer中DRC检查规则,此规则适用于FBGA等高速电路设计
  • 10 AD运行DRC检查

    万次阅读 多人点赞 2018-04-24 14:52:28
    DRC检查是依据自行设置的规则进行的。例如自己设置的最小间距是8mil,那么实际PCB中,出现小于6mil的间距就会报错。并不是DRC有错误的板子就不能使用,例如丝印的错误不会影响电气属性。接下来简单分析几种常见的...

     

    DRC检查是依据自行设置的规则进行的。例如自己设置的最小间距是8mil,那么实际PCB中,出现小于6mil的间距就会报错。

    并不是DRC有错误的板子就不能使用,例如丝印的错误不会影响电气属性。接下来简单分析几种常见的错误。

    运行DRC以后,会弹出一个页面和message。只看Message,双击message可以快速定位错误。

    错误类型

    [Clearance Constraint Violation]

    间隙约束违规,一般是敷铜的网络会设置间隙约束,例如网络属性为VCC3.3的导线和GND的敷铜连在了一起,其实只要间隙小于规定值例如20mil,就会报错。

     

    问题 [Width Constraint Violation]

    宽度约束违规

    这根线的宽度是40mil

    但是定义的线宽最大为30mil

     

    [Short-Circuit Constraint Violation]

    短路,不同的网络被强行接在一起。

     

    Hole Size Constraint Violation]

    过孔大小不合适

     

    Hole To Hole Clearance Constraint Violation

    孔和孔接到一块了

     

    以下是网络上的一些

    1.Rule Violations Count 
    违反数 

    2.Short-Circuit Constraint (Allowed=No) (All),(All)

    短路约束=不允许)(全部),(全部) 

    3.Un-Routed Net Constraint ( (All) ) 26 
    Un-Routed净约束(所有)26岁 

    4.Clearance Constraint (Gap=9mil) (All),(All) 
    间隙约束(间隙= 9 mil)(全部),(全部) 

    5.Power Plane Connect Rule(Relief Connect )(Expansion=20mil) (Conductor Width=10mil) (Air Gap=10mil) (Entries=4) (All)

    功率平面连接规则(救济连接)(扩展= 20 mil)(导体宽= 10 mil)(气隙= 10 mil)(条目= 4)(全部)0 

    6.Width Constraint (Min=8mil) (Max=20mil) (Preferred=15mil) (All)

    宽度约束(Min = 8 mil)( Max= 20 mil)(优先15例mil)(全部)
    问题应该出在你设置和实际的冲突,你的Protel所设置的最小线宽是25mil,最大线宽也是25mil,默认线宽还是25mil,这本没错,但可能是你的某根GND线不是25mil,或者你用了覆铜,而覆铜的线条(Track Width)也不是25mil,所以才出错!建议在Design 的Rule里设置一下Width Constraint的最大和最小线宽,调整到合适范围,就不会报错了。

    7.Height Constraint (Min=0mil) (Max=1000mil) (Prefered=500mil) (All)

    高度约束(Min = 0 mil)( Max = 1000 mil)(优先= 500 mil)(全部)

    8.Hole Size Constraint (Min=1mil) (Max=150mil) (All) 
    孔尺寸约束(Min = 1 mil)( Max = 150 mil)(全部)

    修改尺寸,设计孔大于你设置的规则的值
    9.Hole To Hole Clearance (Gap=6mil) (All),(All)

    洞孔间隙(间隙= 6 mil)(全部),(全部)

    引脚安全间距问题,一般是封装的问题,如果确定封装没问题,这个错误基本你可以忽略。

    10.Minimum Solder Mask Sliver (Gap=1mil) (All),(All) 
    最低焊接面罩银(间隙= 1 mil)(全部),(全部)
    你的某个元件的焊盘间距 大于1mil,你可以选择该规则或者把封装中的焊盘间距改大一点。
    11.Silkscreen Over Component Pads (Clearance=1mil) (All),(All)

    丝网印刷在组件垫(许可= 1 mil)(全部),(全部)

    顶层丝印与元件焊盘距离近(小于1mil)
    按D、R将规则中的Silkscreen Over Component Pads 改小一些就可以了
    12.Silk to Silk (Clearance=1mil) (All),(All)

    丝印丝印(间隙= 1 mil)(全部),(全部)

    两个丝印之间的距离太近,这个错误可以忽略
    13.Net Antennae (Tolerance=0mil) (All)

    网络天线(耐受= 0 mil)(全部) 

    14.Clearance Constraint (Gap=6mil) (InComponent(U1)),(All)

    间隙约束(间隙= 6 mil)(InComponent(U1)),(所有)

     

     

     

     

     

     

     

     

     

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  • PCB学习笔记——DRC检查

    万次阅读 2019-03-23 22:41:13
    https://seujxh.wordpress.com/2018/05/08/drc检查/

    在PCB设计完成后,铺铜以后,要进行设计规则检查,

    DRC,即Design Rule Check设计规则检查

    当PCB Layout 完成后可以利用DRC检查遗漏和错误。

    执行菜单命令Tools-Design Rule Check可以打开DRC设置
    在这里插入图片描述
    注意:第一个Create Report File和第二个Create Violations应该勾选,这样DRC检查后在PCB板上就会显示出冲突错误,并会以一个报告的形式给出检查结果。

    第三个Sub-Net default是子网络详细描述,用于对网络连接关系进行检查并生成报告。

    Verify shorting copper用于对敷铜或非网络连接造成的短路进行检查。

    同时将Stop when ______ violations found的数量调整到50000以上,避免因为警告过多而中断了DRC。

    我们主要设置的是检查的内容

    在这里插入图片描述

    可以看到右侧有Online和Batch两列

    Online表示在PCB设计过程中会实时显示DRC检查结果,而Batch则只有当手工执行DRC检查后进行批量处理才会将存在问题的以报错显示出来。如果想暂时关闭在线drc检查,提高软件运行流畅度,可以在Preference-PCB editor-general中取消勾选Online drc

    对于电气Electrical设置,由于待更新敷铜容易造成软件计算量过大而卡顿,通常在PCB设计过程中可以不用勾选这一项,如上图。

    而其余的电气属性包括了短路、开路、间距的问题,显然都是需要严格控制的,因此我们都勾选。

    对于布线Routing选项卡,建议全部勾选。

    对于SMT选项卡和Testpoint保持默认即可,不需要另外调整

    而制造Manufacturing选项卡比较复杂,我们先到Design-Rules中的Manufacturing设置中查看对应规则:

    首先是Stub线头,在人工布线的过程中,常常会出现遗漏,导致出现部分线头,在信号传输过程中则会相当于一根天线,不断接受和发射电磁信号,尤其在高速信号中,容易给走线导入串扰。通常将天线的长度报错设置在1mil。
    在这里插入图片描述

    丝印与阻焊间距检查,由于阻焊会阻止绿油的覆盖,当丝印放置在阻焊的区域上时,会造成丝印缺失。

    在这里插入图片描述

    但丝印并不影响板子的正常使用,因此对于非强迫症患者,没必要勾选这些DRC检查选项,或者勾选上但在DRC检查中忽略这些警告即可。

    在这里插入图片描述

    对于元件放置Placement选项卡,一般全部取消勾选即可,如果对于板子高度有限制,可以在规则中将高度限定并打开高度限制检查。对于元件放置间距,一般利用3D模型图查看即可。如果实在需要设置元件排布规则,建议将Minimum Horizontal Clearance水平间距和Minimum Vertical Clearance垂直间距设置为2mil,以保证元件工艺误差不会对板子造成影响。

    全部设置完成后点击左下角的Run即可运行DRC检查了
    在这里插入图片描述

    如果PCB的文件名和路径名不含有中文,那么单击DRC结果报告中的报错会跳转到PCB的相应位置。

    如果不含有中文也无法跳转,请检查是否禁用了JS脚本(具体的我也没遇到过。)

    如果含有中文的话,也可以通过双击Message框中的报错,同样能跳转到PCB的具体位置

    参考文章:
    https://seujxh.wordpress.com/2018/05/08/drc检查/
    参考书籍:《Altium Designer 16 电路设计与仿真从入门到精通 》

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  • Allegro 中如何关闭DRC检查

    千次阅读 2019-09-21 16:27:53
    setup--constraints--modes--design modes(package),在这里就能选择关闭package to package的DRC检查

    setup--constraints--modes--design modes(package),在这里就能选择关闭package to package的DRC检查了

     

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  • AD19有时DRC检查特别慢的问题

    千次阅读 2020-06-25 21:40:05
    今天遇到好多次AD19的DRC检查特别慢的问题。 正常时, DRC检查就10秒不到。慢的时候,10分钟检查不完(PCB没啥大改动,就将DRC检查出的问题修正了1,2处)。这是AD19的bug啊。 最后总结一下,要DRC检查为正常速度的方法...
  • ALLEGRO DRC检查

    万次阅读 2018-10-26 13:53:20
    1,查看状态 Display -->Status:   PCB单项检查:Tools --> Quick Reports 1,Unconnected Pins Report ...3, Design Rules Check(DRC) Report 等。 敷铜检查: Shape---> Glo...
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  • AD18进行DRC检查显示警告

    千次阅读 2019-07-29 11:56:49
    AD18进行DRC检查显示警告:“ Design contains shelved or modified (but not repoured) polygons…”,这是你铺铜没铺好的问题,把有问题的铜块删掉重新铺。 再次进行DRC检查,警告还在,可能是你设定的铺铜规则与...
  • Altium未连接的网络DRC检查不出的问题 最近在Altium软件下进行硬件设计,发现明明有网络被连接,但是DRC却检查不出,给出Un-Routed Net Constraint ( (All) ):0 这样的误导性提示,导致在最近设计的一块PCB里有一根...
  • allegroDRC检查

    千次阅读 2018-10-22 10:36:42
    第一步:check-design statues (相当于之前版本的drawing options),检查元件和...第三步 检查数据库 check - database check ,在弹出来的方框中勾选update all drc 和check shape outline,保证数据库没有问题。...
  • 在画完PCB后进行DRC检查的时候总是报Short Circuit Constraint错误,仔细检查PCB感觉也没有那个地方短路。我做了一个最简单的实验,仅仅将导线连接到一个焊盘上再做DRC检查同样会报 Short Circuit Constraint错误。...
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    万次阅读 2016-10-26 22:07:08
    于是乎就去折腾下DRC检查的功能,以前也没用过。 好了打开DRC检查的菜单步骤: 1、打开ORCAD软件,先选中整个dsn文件; 2、在Tools中点击Design Rules Check; 3、打开显示界面 ①Scope:范围,是检查整个设计,...
  • 第六章 PCB 的 DRC 检查、拼版设计及资料输出 6.1 DRC检查及丝印的调整 进入 PCB 文件(PcbDoc)。 DRC(Design Rule Check) 检测:通过 DRC 检测,检查是否达到设计时的各项指标; · 启动 DRC:菜单栏...
  • ORCAD16.6中原理图DRC检查(下)

    万次阅读 2016-10-31 20:22:49
    接ORCAD16.6中原理图DRC检查(上) 上次说了电气规则,下面接着说物理规则。 参考了http://blog.sina.com.cn/s/blog_e0ae98f10101fhg1.html; 5、物理规则 check power pin visible——检查电源引脚可视...
  • AD中PCB检查设计错误规则设置 遇到的问题:在设计好的PCB电路中,我们不能保证所有的线是否一次性全部布好,此时我们一般情况下需要设置电路的布线规则检查,以确保电路在布线的时候不会发生错误,下面我将向大家...
  • 在进行DRC检查时,出现很多如下警告: 双击警告回到原理图, 出现上述警告的原因时网络名称与标号不相同(aliase本身的意思时别名),但是这并不影响原理图的绘制,解决办法,可以将接地的符号命名为GND等操作 .....
  • 对于前面提到的后台自动运行的持续的DRC检查器,也是在DRCcontin.c中实现的,核心方法为DRCContinuous,由WindDispatch()调用,这个函数会一直运行,检查当前窗口中是否有待DRC的区域,如果有则就会使用恰当的方式...
  • AD20-DRC检查

    千次阅读 2020-04-20 18:36:02
    红圈中是安全间距检查,勾选可以检查板子中的安全间距。之后点击左下角的运行DRC,就行了,板子中有错误的话就会报错。有错改错就行了。 其实还有文件的输出部分,那部分有需要的话上百度搜就行了。 谢谢观看! 欢迎...
  • Allegro设计PCB文件的时候,进行DRC检查,如果报错:Package to Package Spacing ,是否会影响实际使用,实践经验表明不影响。 1、该规则是软件进行元器件间距检查时候用到的,安全距离取得很大,对于开发PCB人员来...
  • orCAD原理图 DRC检查

    2021-03-29 14:42:53
    问题现象: 电气规格检查包如下图错误 -------------------------------------------------- Checking Schematic: SCHEMATIC1 -------------------------------------------------- Checking Electrical Rules ER...
  • 2.进入DRC设置界面 如下图,依次选中“dsn→Tools→Design Rules Check” 然后会跳出来一个提示框,点击Yes即可 3.进行DRC规则设置 上面第二步结束之后,就进入到了DRC规则设置界面,主要有四个类别进行设置。如下...
  • Altium Designer之DRC检查学习笔记

    千次阅读 2020-05-24 14:38:13
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  • 添加缝合孔:可以选择自己添加约束区域,设置参数选择网络。 设计规则检查:运行DRC
  • orcad DRC检查,元件C2都没连接,为什麼不报错 分割线------------------------------------------------------------------------------------------------------------------------------------------ ...

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